2 PCI 9054外接FIFO的設計

　　PCI 9054 內部有6種FIFO用于提高數據傳輸速率,解決本地總線和PCI總線之間的異步接收。但掛于PCI 9054本地總線的速率往往較慢,為了保證可靠性,往往需要擴充FIFO加以緩存。下面以IDT 72205 FIFO為例,介紹用PCI 9054本地總線擴充FIFO的具體設計方法。

2.1 9054工作方式選擇

　　PCI 9054可工作在M,C,J三種模式,其中C模式時序較為簡單。本設計選擇PCI 9054工作在C模式,總線周期采用“PCI目標讀單周期”以及“PCI目標寫單周期”。下面介紹部分引腳信號。

　　LHOLD:輸入信號,申請使用本地總線。

　　LHOLDA:輸入信號,對LHOLD應答。

　　ADS:輸出信號,表示新的總線訪問有效地址的開始。在總線訪問的第一個時間周期設置。

　　BLAST:輸出信號,表示總線訪問的最后傳送。

　　LW/R:輸出信號,高電平表示讀操作,低電平表示寫操作。

　　LA:地址線。

　　LD:數據線。

　　READY:輸出信號,表示總線上讀數據有效或寫數據完成。用以連接PCI 9054等待狀態產生器,輸入信號。

2.2 電路設計

　　IDT72205是容量為256×18bit的高速、低功耗同步/異步FIFO存儲器,具有獨立的收、發時鐘控制,將之掛于PCI 9054的本地總線可以實現PCI 9054 FIFO 的擴充。圖3為PCI 9054和IDT 72205連接的電路圖。

對CPLD要求:當EF=1(FIFO不空),LW/R=0,LCLK為上升沿時,OE產生負脈沖,寬度為2時周期。

PCI 9054是一種性能/價格比高的PCI橋路芯片,比PCI 9080,PCI 9050等性能更優越。本文設計的FIFO擴充方法具有通用性,可用于PCI 9054本地總線其它I/O或存儲器的擴充。