全球領先的數字信號處理器(DSP)內核和平臺解決方案授權廠商CEVA公司宣布推出世界上首個專為先進無線基礎設施解決方案而設計的浮點矢量(vector floating-point) DSP內核——CEVA-XC4500 DSP。
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CEVA ARM 嵌入式 DSP
您是不是需要復雜可編程邏輯器件(CPLD)但又不愿放棄固件?或者說您希望最好在單個芯片中同時集成微控制器和CPLD?PSoC? 5LP是賽普拉斯半導體公司的最新片上可編程系統，當它用作CPU時，它就是一款32位的67 MHz ARM Cortex-M3處理器，而用作CPLD時，其可編程邏輯提供的基于LUT的FPGA門，相當于20,000多個門。
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ARM 嵌入式 FPGA PSoC UDB
搞嵌入式的工程師們往往把單片機、ARM、DSP、FPGA搞的得心應手，而一旦進行系統設計，到了給電源系統供電，雖然也能讓其精心設計的程序運行起來，但對于新手來說，有時可能效率低下，往往還有供電電流不足或過大引起這樣那樣的問題，本文十大金律輕松搞定DCDC電源轉換電路設計。
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DC/DC FPGA DSP 穩壓器
模數轉換器(ADC)、數模轉換器(DAC)聽的多了，時間數字轉換器(TDC——Timer Digital Converter)是什么原理的器件?為什么是ARM CortexM3，而不是M0、M4? 還有，超聲波水表這種創新產品形式是否到了大規模商用階段呢?本文將介紹TDC-GP22在智能超聲波水表中起到何種關鍵作用，ARM CortexM3 MCU如何在超低功耗突破方面再助一臂之力?
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世強 TDC-GP22 ARM MCU 超聲波
Testbench，就是測試平臺的意思，具體概念就多不介紹了，相信略懂FPGA的人都知道，編寫Testbench的主要目的是為了對使用硬件描述語言(HDL)設計的電路進行仿真驗證，測試設計電路的功能、部分性能是否與預期的目標相符。
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FPGA Quartus Testbench 開發板 異步復位
安謀國際(ARM)展現其進攻汽車及工業控制市場的雄心。ARM于23日正式發布專為嵌入式系統處理器所設計的ARMv8-R架構，并強調其即時運算的效能，主要鎖定汽車及工業控制運用。
ARM行銷總監RichardYork表示，ARMv8-R架構承襲32位元ARMv7-R架構的優點，且與ARMv8-A架構相容;前一代的ARMv8-A架構訴求的是高效能，而ARMv7-R架構則更加強調其即時運算處理的能力。不過，ARMv7-R架構目前僅支援32位元暫存器(Register)，暫時無法滿足64位元嵌入式應
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ARM 架構
2013年10月22日，萊迪思半導體公司(NASDAQ: LSCC)宣布推出新的超低密度iCE40? FPGA，提供世界上最靈活的單芯片傳感器解決方案，使得新一代環境感知、超低功耗的移動設備成為現實。iCE40 FPGA系列新增加的器件使客戶能夠在一個更小的空間內集成更多的功能。
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萊迪思 FPGA 傳感器
致力于提供幫助功率管理、安全、可靠與高性能半導體技術產品的領先供應商美高森美公司(Microsemi Corporation，紐約納斯達克交易所代號：MSCC) 宣布提供低成本IGLOO?2 FPGA評測工具套件，為客戶提供PCI? Express (PCIe)兼容外形尺寸評測平臺。
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美高森美 FPGA 以太網
ARM周二發布了2013財年第三季度財報，凈利潤為4850萬英鎊(約合7830萬美元)，營收為1.84億英鎊。
在截至9月30日的第三財季，ARM總營收為1.84億英鎊，與去年同期的1.446億英鎊相比增長27%。按美元計算，ARM第三財季營收為2.867億美元，與去年同期的2.279億美元相比增長26%。
其中，版稅營收為1.371億美元，同比增長13%，占公司總營收的48%。授權營收為1.231億美元，同比增長48%，占公司總營收的43%。
開發系統營收為1210萬美元，同比持平
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ARM 芯片
ARM周二發布了2013財年第三季度財報，凈利潤為4850萬英鎊(約合7830萬美元)，營收為1.84億英鎊。
在截至9月30日的第三財季，ARM總營收為1.84億英鎊，與去年同期的1.446億英鎊相比增長27%。按美元計算，ARM第三財季營收為2.867億美元，與去年同期的2.279億美元相比增長26%。
其中，版稅營收為1.371億美元，同比增長13%，占公司總營收的48%。授權營收為1.231億美元，同比增長48%，占公司總營收的43%。
開發系統營收為1210萬美
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ARM 處理器
將虛擬儀器技術同FPGA技術結合，設計了一個頻率可控的DDS任意波形信號發生器。在闡述直接數字頻率合成技術的工作原理、電路構成的基礎上，分別介紹了上位機虛擬儀器監控面板的功能和結構，以及實現DDS功能的下位機FPGA器件各模塊化電路的作用。經過設計和電路測試，輸出波形達到了技術要求，工作穩定可靠。
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信號發生器 設計 DDS 儀器 FPGA 虛擬 基于
為了滿足載荷與衛星進行可靠通信的目的，設計并實現了基于FPGA和BU-65170協議芯片的1553B遠程終端。自行設計了用于控制BU-65170的主控制狀態機，采用16位零等待緩沖接口模式，使用單消息和雙緩沖模式進行消息傳輸。創新性地引入RS 422總線與1553B總線進行通信，方便測試過程，結果直觀可見。采用專用測試板卡Alta ECD54-1553對系統進行測試，獲得預期的可靠結果。FPGA取代傳統CPU來控制1553B通信并集成數據傳輸功能，采用Verilog HDL硬件描述語言有利于軟件移植，縮短
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終端 設計 實現 遠程 1553B FPGA BU-65170 基于
簡要介紹了FIR數字濾波器的結構特點和基本原理，提出基于FPGA和DSP Builder的FIR數字濾波器的基本設計流程和實現方案。在Mat lab／Simulink環境下，采用DSP Builder模塊搭建FIR模型，根據FDATool工具對FIR濾波器進行了設計，然后進行系統級仿真和ModelSim功能仿真，其仿真結果表明其數字濾波器的濾波效果良好。通過SignalCompiler把模型轉換成VHDL語言加入到FPGA的硬件設計中，從QuartusⅡ軟件中的虛擬邏輯分析工具SignalTapⅡ中得到數
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設計 實現 濾波器 數字 FPGA FIR 基于
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