2008年5月20號，北京——Altera公司(NASDAQ: ALTR)今天發布Quartus® II軟件8.0，支持公司的40-nm Stratix® IV FPGA和HardCopy® ASIC，延續了公司在設計軟件性能和效能上的領先優勢。和最相近的競爭軟件相比，這一版本的Quartus II軟件在高端FPGA上平均快出兩個速率等級，編譯時間縮短了3倍。8.0版增加了新的效能特性，支持業界最先進的FPGA，進一步印證了Altera幫助FPGA設計人
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Altera Quartus II FPGA
ACTEL公司宣布推出兩款實現人機接口 (HMI) 和微型電機控制功能的插入式子卡，進一步擴展其基于業界最低功耗現場可編程門陣列 (FPGA) 的便攜式市場產品系列。新的HMI子卡和電機控制子卡將以Actel備受歡迎的IGLOO Icicle開發工具包的插件形式推出。Actel相信，這兩款產品與公司先前推出的IGLOO存儲及顯示開發板、設計樣例和IP核相結合，將構成新的控制解決方案，可以提高Actel的5µW低功耗IGLOO FPGA在快速增長的便攜式市場上的份額。
Actel副總裁
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ACTEL FPGA IGLOO 便攜 控制
電動車由于具有無廢氣污染、無噪音、輕便美觀等特點，受到眾多使用者的青睞。但使用中也暴露出它的局限性，那就是蓄電池的容量決定了它的使用范圍，而且存在充電時間長的缺點。目前隨著電動自行車的發展，急需解決的問題就是如何實現快速靈活的充電。
隨著電子技術、可編程邏輯器件(FPGA,CPLD)、EDA技術的飛速發展，基于硬件編程語言的自上而下(TOP-TO-DOWN)設計方法給數字系統的開發設計帶來了革命性變革，僅使用單片機來實現系統控制的傳統方法正在被越來越多的以MCU+FPGA/CPLD為核心的最新設
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CPLD SPCE061A FPGA EDA 充電 電動自行車
0引言
對于一個普通的GPS(全球定位系統)接收機來說，其對信號的捕獲和追蹤均由硬件進行處理，主要是用ASIC(專用集成電路)實現。用ASIC的主要好處之一是它的有效性，能夠對GPS信號進行有效處理，但它的造價較高，而目前GPS技術還在高速發展，各種算法還在不斷研究，如果都用ASIC來實現，顯然并不現實。而使用軟件來模擬搭建GPS的接收系統，不但可以方便地對現有的一些算法進行比較，而且也能快速地應用到實際中。在該系統中，用A／D轉換器將輸入的模擬信號數字化，然后交由軟件接收機處理，由此重構的系統
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GPS ASIC A／D轉換器 MATLAB
引 言
SOPC(System On Programmable Chip)即可編程片上系統，或者說是基于大規模FPGA的單片系統，是美國Altera公司于2000年提出的。它將處理器、存儲器、I／O口、LVDS、CDR等系統設計需要的功能模塊集成到一個PLD器件上，將其構建成一個可編程的片上系統；具有靈活的設計方式，可裁減、可擴充、可升級，并具備軟硬件在系統可編程的功能。由于SOPC系統具有靈活的設計方式、高效的開發手段、廉價的設計成本，可以實現過去不可能實現的更高的系統性能，因此它在通信和工業
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引言
在基于軟件無線電的某無線通信信號偵收平臺的設計中，天線接收到的信號經過變頻器處理和A/D變換之后，經過高速通道把采集的信號送入主控板進行數據分發處理。系統的結構框圖如圖1所示。
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FPGA DMA 接口 微處理器 SDMA IDMA
Catalyst半導體繼續快速擴展電壓監控產品線，為微處理器、微控制器，ASIC器件和其它系統處理器的應用新增一款高精度超低功耗5通道監控器件。5通道電壓監控被整合于一個小尺寸的8引腳MSOP封裝之內，CAT885能有效降低系統成本、節約電路板空間。
CAT885具備低有效漏極開路輸出及手動復位輸入的特點，可針對各種電子產品完成系統復位和監控功能。CAT885可以監控多達5通道的系統電壓，若所有被監控的電源電壓已經超過額定電平值，并且隨后被啟動的器件內部計時器超時溢出后，有效的復位輸出才會終止，
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Catalyst 電壓監控器 微處理器 微控制器 ASIC
基于ARM和FPGA的嵌入式超聲探傷系統,進行數字信號處理，利用TCP/IP協議實現C/S模式下的數據傳輸，實現了超聲探傷的跨平臺遠程監控。嵌入式探傷儀通過多線程技術進行多任務處理，集超聲探傷、數據存儲、網絡通信于一體。
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探傷 系統 超聲 嵌入式 ARM FPGA 基于
5月12日，四川汶川大地震震驚了世界。有專家認為，誘發這次地震的原因可能與在該地震帶進行梯級水電開發有關。
十幾年來，尋找更多的能源成為各國的大事。目前的狀況是：化石燃料價格飛漲；太陽能、風能等可再生能源成熟還要等上數十年；生物燃料消耗的能源比化石燃料還要高，尤其糧食漲價更讓生物燃料前景黯淡；核能還不夠安全穩定；燃料電池在試制，水能（水電站）帶來了氣候改變、地震……
能源和環保，真是令全世界大傷腦筋！環境問題、經濟問題、政治問題，自然災害、戰爭…&
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汶川 地震 能源 環保 Actel FPGA 低功耗
引 言
隨著片上系統(SoC，System on Chip)時代的到來，包括復雜可編程邏輯器件(CPLD，Complex ProgrammableLogic Devi(e)和現場可編程門陣列(FPGA，Field Programmable Gate Array)的可編程邏輯器件(具有在系統可再編程的獨特優點)，應用越來越廣泛。這給用于可編程邏輯器件編程的下載電纜提出了更高的要求。
本文研究基于IEEEll49．1標準的USB下載接口電路的設計及實現。針對Altera公司的FPGA器件Cy-
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CPLD USB FPGA 下載電纜 SoC
許多通信系統都要用到多速濾波器(multirate filter)，多速濾波器是指輸出數據速率與輸入數據速率不相等的濾波器，常用于某個物理接口如數模轉換器(DAC)或模數轉換器(ADC)的接口處。
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ASIC DSP PLD 濾波器設計
1 ADC08D1000的結構
ADC08D1000是NS(National Semiconductor，國家半導體)公司于2005年推出的雙通道低功耗的高速8位A／D轉換器，其最高單通道采樣頻率達l.3 GHz，全功率帶寬(FPBW)為1．7 GHz，在500 MHz標準信號輸入的情況下可以獲得7．4位的有效采樣位數。整個A／D轉換器用單電源1．9V供電，內帶高質量參考源和高性能采樣保持電路，每個通道均為差分輸入，采樣范圍可選為650 mV或870 mV(峰一峰值)。在高速數／模轉換系統中，有
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硬件電路 NS A／D轉換器 FPGA LVDS
世界級ASIC設計晶圓廠及定制解決方案供應商VeriSilicon Holdings Co., Ltd.（VeriSilicon）“已經加盟功耗前鋒倡議”（ Power Forward Initiative，PFI），計劃為其ASIC客戶提供基于通用功率格式（Common Power Format，CPF）的設計解決方案。
VeriSilicon采用Cadence低功耗解決方案，是業界領先的完整的設計流程，以Si2標準的CPF為基礎，貫穿邏輯設計、驗證、實現等技術。這種針
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晶圓 VeriSilicon ASIC 低功耗 CPF
FPGA工藝尺寸的進步和更加靈活的設計配置、以及基于FPGA的系統取得的進步已經使FPGA制造商充滿信心地進入了以前由微處理器和ASIC供應商壟斷的市場。最近，Xilinx的VirtexTM和Altera的Stratix產品系列分別推出了新器件，進一步縮小了性能差距，再次提高了性能標準。盡管這些器件的通用和可配置性吸引了系統設計師，但是控制這些器件內部工作方式的設計規則及其外部接口協議的復雜性導致需要廣泛的培訓、基準設計評估、設計仿真和驗證。因此，FPGA供應商提供了詳盡的硬件和固件支持，旨在幫助系統設計
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DC/DC ，解決方案，FPGA
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