- 最近一段時間一直在研究基于FPGA的圖像處理，乘著EEPW這個機會和大家交流一下，自己也順便總結一下。主要是為了大家對用FPGA做圖像處理有個感性的認識，如果真要研究的話就得更加深入學習了。本人水平有限，如有錯誤，歡迎大家批評指正。
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FPGA 圖像處理 計數器 存儲器
- Ice(冰)，意味著寒冷，把芯片命名為iCE，可見其能耗之低。近日，萊迪思半導體公司(Lattice)宣布其iCE40家族增加新成員——iCE40LM FPGA，提供靈活的單芯片傳感器解決方案，使得新一代環境感知、超低功耗的移動設備成為現實。
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萊迪思 FPGA 處理器 201311
- 2013年11月6日，萊迪思半導體公司(NASDAQ: LSCC)發布了一系列可編程解決方案用以構建智能、低功耗的移動設備，支持異構網絡(HetNet)的全球性推廣。與Azcom Technology合作，萊迪思的HetNet解決方案系列使系統設計人員能夠實現一流的互連、控制路徑和電源管理解決方案，同時使用多模式LTE小型蜂窩的系統級參考設計加快設計開發。
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萊迪思 HetNet FPGA
- Altera公司 (NASDAQ: ALTR)日前宣布發布Quartus? II軟件13.1版，通過大幅度優化算法以及增強并行處理，與前一版本相比，編譯時間平均縮短了30%，最大達到70%，進一步擴展了在軟件效能方面的業界領先優勢。軟件還包括最新的快速重新編譯特性，適用于客戶對Altera Stratix? V FPGA設計進行少量源代碼改動的情形。
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Altera Quartus FPGA Qsys
- 引言無人機廣泛應用于軍事偵察以及民用測繪等領域，其中的機載視頻圖像系統是機載電子系統中的重要環節之一。...
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FPGA DSP
- Altera公司 (NASDAQ: ALTR)今天宣布發布Quartus? II軟件13.1版，通過大幅度優化算法以及增強并行處理，與前一版本相比，編譯時間平均縮短了30%，最大達到70%，進一步擴展了在軟件效能方面的業界領先優勢。軟件還包括最新的快速重新編譯特性，適用于客戶對Altera Stratix? V FPGA設計進行少量源代碼改動的情形。采用快速重新編譯特性，客戶可以重新使用以前的編譯結果，從而保持性能，不需要前端設計劃分，進一步將編譯時間縮短了50%。
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Altera Quartus FPGA DSP
- Altera公司意欲通過更先進的制程工藝和更緊密的產業合作，正逐步強化FPGA協同處理器，大幅提升SoC FPGA的整體性 ...
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SoC FPGA
- 2.2.2 定時誤差檢測設計 定時誤差檢測程序采用獨立于載波相位偏差的GA-TED算法。該算法每個符號周期只 ...
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FPGA 通用位 同步器
- 本文主要是先闡述傳統Gardner算法的原理，然后給出改進后的設計和FPGA實現方法，最后對結果進行仿真和分析，證明 ...
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FPGA 位同步器
- 本文采用FPGA作為實現控制邏輯的核心部件，提出了基于FPGA的基帶64×64 數據分配矩陣設計方案，并介紹了上位機 ...
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FPGA 數據分配 矩陣設計
- 0 引言 傳統的淺海地形測量以船只為平臺，采用聲納技術進行，這種測量方法對于一些船只難以駛入的區域便形 ...
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FPGA 多普勒測振計 信號采集
- 業界首顆64位系統單芯片（SoC）現場可編程門陣列（FPGA）搶先亮相。Altera宣布將以英特爾（Intel）14納米（nm）三門極 （Tri-g ...
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高效能 SoC FPGA
- 0引言時間延時積分電荷耦合器件(TimeDelayandIntegra-tionChargeCoupledDevices,TDICCD)易于實現實...
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FPGA TDICCD8091 驅動時序
- 隨著科學技術的不斷發展，工業生產線逐步走向自動化和智能化。自動化作為工廠生產的利器，未來有三大發展方向：性 ...
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FPGA MCU
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