- IPTV系統中的FPGA供電問題解決方案,目前越來越多的家用電器從低速的撥號上網向寬帶互聯網接入或互聯網協議電視(IPTV)轉移，尤其是IPTV有望在中國獲得快速的發展。比較而言，IPTV的基礎設施成本相當低，因為這種方法不需要銅軸電纜，而是采用DSL或寬帶鏈
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問題 解決方案 供電 FPGA 系統 IPTV
- 摘要：針對電路設計中經常碰到數據的噪聲干擾現象，提出了一種Kalman濾波的FPGA實現方法。該方法采用了TI公司的高精度模數轉換器ADSl25l以及Altera公司的EPlCl2，首先用卡爾曼濾波算法設計了一個濾波器，然后將該濾波
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Kalman FPGA 濾波器
- 在低成本FPGA中實現動態相位調整,在FPGA中，動態相位調整(DPA)主要是實現LVDS接口接收時對時鐘和數據通道的相位補償，以達到正確接收的目的。ALTERA的高端FPGA，如STRATIX(r) 系列中自帶有DPA電路，但低端的FPGA，如CYCLONE(r)系列中是沒有的。本文主
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相位 調整 動態 實現 FPGA 成本
- 萊迪思半導體公司今日宣布Nu Horizons Electronics Corp. 即日起將在全球范圍內代理萊迪思的全部產品。Nu Horizons目前在整個亞太地區代理萊迪思產品。
Nu Horizons全球代理部總裁Kent Smith 表示：“Nu Horizons Electronics 非常高興能與萊迪思一起拓展全球業務。萊迪思是全球領先的FPGA、PLD、可編程時鐘和電源管理器件、軟件設計工具和IP核供應商之一，并且我們的全球銷售和工程師團隊對于可編程邏輯技術非常了解。萊
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萊迪思 FPGA PLD 可編程時鐘 電源管理器件
- 摘要：本文提出了一種基于FPGA的圖像裁剪電路的設計方法，利用像素的抽取改變圖像的分辨率，從而達到圖像裁剪的效果。與傳統的方法相比，這種方法簡單易行，開發成本低，圖像的清晰度能滿足一定的要求。此方法數據處
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FPGA 圖像 裁剪 電路
- 摘要：為了解決PCI9052和雙口RAM之間讀寫時序不匹配的問題，本設計采用可編程器件來實現它們之間的接口電路。此電路可以使系統更加緊湊。核心邏輯部分采用有限狀態機實現，使控制邏輯直觀簡單，提高了設計效率。
通
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FPGA PCI9 RAM PCI
- 引言隨著信息化和數字化的發展，現在社會中人們的生活變得更加豐富多彩，生活更加便利。但是有一種...
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FPGA 智能導盲犬
- 目前，顯示屏按數據的傳輸方式主要有兩類:一類是采用與計算機顯示同一內容的實時視頻屏;另一類為通過USB、以太網等通信手段把顯示內容發給顯示屏的獨立視頻源顯示屏，若采用無線通信方式，還可以隨時更新顯示內容，靈
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視頻 LED 系統 獨立 全彩 ARM FPGA 甚于
- IPTV視頻廣播中采用FPGA作為編碼和解碼平臺的好處是明顯的。然而，為FPGA供電可能是一個挑戰，而采用根據電源要求設計的專用電源管理器件，如MIC68200，將極大地縮短新系統的上市時間。
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供電 問題 FPGA 系統 IPTV 基于 通信協議
- 上海宏力半導體制造有限公司 (宏力半導體)，專注于差異化技術的半導體制造業領先企業之一， 開發了其針對不同應用的多樣化設計方案。基于該設計方案，客戶可在宏力半導體經過硅驗證的技術平臺上進行設計，從而更為有效，同時減少風險。
豐富的高性能、通過硅驗證的IP模塊系列，對客戶現有的IC設計起到了優勢互補的作用。該系列可提供各種混合信號IP，內嵌ESD保護電路的高性能IO，以及嵌入式閃存IP模塊 (包括BIST和flash macros等)。
宏力半導體是唯一一家由SST授權擁有0.25-0.13
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宏力 嵌入式閃存 IP
- NGN業務具有端到端(Peer-to-Peer)及永久在線(Always-on-Line)的通信模式，需要分配大量IP地址，存在公網IP地址不足的問題。同時運營商在城域網中必須采用靜態路由、動態路由、策略路由和路由策略等技術設置城域網路由
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路由 設計 規劃 分配 地址 承載 IP NGN
- FPGA的嵌入式系統USB接口設計,摘要：設計基于FPGA的IP-BX電話應用系統，用于傳統的電話網絡(PSTN)與PC機之間的接口連接。USB2．0接口器件EZ-USB FX2 CY7C68013A-56工作在slave FIFO模式，為基于FPGA的嵌入式系統與PC機之間提供數據和命令通道，從
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接口 設計 USB 系統 嵌入式 FPGA
- 基于NiosII處理器的通用AD IP核的設計與實現,提出了一種采用基于NiosII處理器的通用AD IP核來實現嵌入式數據采集系統的新方案。它能將市面上任意一款AD芯片制作成IP核并集成到NiosII系統中使用，且整個IP核的控制與運算邏輯由一片FPGA芯片來完成。
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IP 設計 實現 AD 通用 NiosII 處理器 基于 數字信號
- 對許多包含并行性或可流水化的算法而言，由于裕量連接帶寬可實現用戶自定義的數據通路，這樣，邏輯可在一個時鐘周期內訪問存儲器或訪問另一個邏輯塊的結果，從而使FPGA的持續性能可接近峰值性能。由于固定架構具備預先確定的用以實現不同功能的邏輯塊集合，所以可以為FPGA配置支持某種給定算法的最優邏輯函數比例來實現器件資源的最佳利用。
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進展 處理 FPGA 交換
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