“英特爾精尖制造日”活動今天舉行，展示了英特爾制程工藝的多項重要進展，包括：英特爾10納米制程功耗和性能的最新細節，英特爾首款10納米FPGA的計劃，并宣布了業內首款面向數據中心應用的64層3D NAND產品已實現商用并出貨。
英特爾公司全球副總裁兼中國區總裁楊旭 歡迎來自合作伙伴、客戶、政府部門和學術界的嘉賓以及新聞媒體出席2017年9月19日在北京舉行的“英特爾精尖制造日”活動。此次活動著眼于快速發展的中國技術生態系統，重申英特爾與中國半導體產業共成長
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英特爾 FPGA
萊迪思半導體公司(NASDAQ: LSCC)，客制化智能互連解決方案市場的領先供應商，今日宣布Valve采用萊迪思的低功耗、低成本iCE40? FPGA為SteamVR?跟蹤平臺實現實時數據采集和處理功能。 作為SteamVR跟蹤平臺上的低功耗、低延遲傳感器中心，萊迪思iCE40 FPGA大大減少了傳感器到應用處理器/微控制器的印刷電路板(PCB)信號布線數量，從而降低EMI干擾和PCB擁塞程度，并提高信號完整性。 萊迪思半導體資深業務發展經理陳英仁表示：“我們的低功
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萊迪思 FPGA
前言 在4月19號的舊金山AWS技術峰會上，亞馬遜CTO Werner Vogels宣布了多項AWS新功能，其中就包括眾人期待已久的FPGA實例F1。 F1 實例配有最新的 16 nm Xilinx UltraScale Plus FPGA，目前有f1.2xlarge和f1.16xlarge兩種類型，其中f1.2xlarge配備有1個FPGA卡， f1.16xlarge配備有8個FPGA卡。 使用
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FPGA 神經網絡
這里談談一些經驗和大家分享，希望能對IC設計的新手有一定的幫助，能使得他們能少走一些彎路!
在IC工業中有許多不同的領域，IC設計者的特征也會有些不同。在A領域的一個好的IC設計者也許會花很長時間去熟悉B領域的知識。在我們職業生涯的開始，我們應該問我們自己一些問題，我們想要成為怎樣的IC設計者?消費?PC外圍?通信?微處理器或DSP?等等。
IC設計的基本規則和流程是一樣的，無論啥樣的都會加到其中。HDL，FPGA和軟件等是幫助我們理解芯片的最好工具。IC的靈魂是知識。因此我們遇到的第一個
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FPGA
網絡路由器帶有用于性能監控、流量管理、網絡追蹤和網絡安全的統計計數器。計數器用來記錄數據包到達和離開的次數以及特定事件的次數，比如當網絡出現壞包時。數據包的到達會使多個不同的統計計數器發生更新;但一臺網絡設備中的統計計數器的數量及其更新速度常常受到存儲技術的限制。 管理統計計數器需要高性能的存儲器才能滿足多重的讀—修改—寫操作。本文將描述一種使用IP方法的獨特統計計數器，這種計數器的一端可以連接網絡處理器(NPU)，另一端可以連接Xilinx公司的QDR-IV存儲控制器。QDR-IV統計計數器IP是
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QDR-IV IP
1. 概述 隨著集成電路技術的快速發展，半導體存儲、微處理器等相關技術的發展得到了飛速發展。FPGA以其可靠性強、運行快、并行性等特點在電子設計中具有廣泛的意義。作為一種可編程邏輯器件，FPGA在短短二十年中從電子設計的外圍器件逐漸演變為數字系統的核心。伴隨著半導體工藝技術的進步，FPGA器件的設計技術取得了飛躍發展及突破。 分頻器通常用來對某個給定的時鐘頻率進行分頻，以得到所需的時鐘頻率。在設計數字電路中會經常用到多種不同頻率的時鐘脈沖，一般采用由一個固定的晶振時鐘頻率來產生所需要的不
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FPGA 數字分頻器
人工智能算法的實現需要強大的計算能力支撐，特別是深度學習算法的大規模使用，對計算能力提出了更高的要求。而從人工智能芯片所處的發展階段來看，從結構層面去模仿大腦運算雖然是人工智能追求的終極目標，但距離現實應用仍然較為遙遠，功能層面的模仿才是當前主流。
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人工智能 FPGA
現有的可穿戴設備大部分都是智能手表或健康手環。這些應用本質上并不“智能”，而是對智能手機的擴展，用于輕松訪問副屏和/或進行低速和低功耗生理體征測量，如計步器和心率測量等。隨著語音、AR和AI技術的發展，我們將會看到更多更加智能的可穿戴設備，涵蓋語音控制的智能耳機到可以進行空間、手勢和目標識別的AR眼鏡。這些全新的應用，特別是涉及到空間測量(例如音頻波束形成或AR手勢檢測)時，需要實時工作的低功耗傳感器中心來同時捕捉和處理來自傳感器陣列的數據。與其他應用處理器、MCU和DSP相比，萊迪思FPGA能夠提供靈活
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可穿戴 FPGA 萊迪思
自從機器學習(machinelearning;ML)與人工智能(AI)在近期受到歡迎后，包括英特爾(Intel)等科技大廠也積極抓緊機會投入開發相關領域。該公司高層日前也表示，英特爾正利用現場可編程閘陣列(FPGA)技術，提供ML或AI的解決方案。據NewElectronics報導，為了搶搭ML與AI風潮，英特爾透過收購與內部發展打造解決方案。英特爾的可編程系統事業群(ProgrammableSystemsGroup;PSG)前身為Altera，AI產品專家BillJenkins表示，PSG專注在機器
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英特爾 FPGA
本文設計了一種以FPGA為核心，基于AD5422實現多路高精度輸出的PLC模擬量擴展單元模塊。設計先對現有的方案進行了分析和討論，之后對FPGA內部相關處理機制和實現方案做了詳盡的論述，經過仿真和測試驗證了設計的可行性。相比于傳統的模擬量擴展單元模塊，本系統具有處理速度快、方便、靈活，電路精簡，抗干擾能力強等優點。
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FPGA AD5422 串行外設接口 201709
在高動態環境中，由于載波多普勒頻移和收發端時鐘漂移等因素的存在，直擴接收機必須通過載波同步才能在接收端消除頻差并重構載波相位，以實現相干解調。在傳統的載波同步技術中，鎖頻環具有較大的捕獲帶寬但頻率跟蹤精度相對較低;鎖相環雖然具有較高的跟蹤精度卻受到捕獲帶寬的限制。在同步時間要求不高的通信系統中，可以采用鎖頻環與鎖相環級聯的載波同步方法，使接收機既能承受環路帶寬與動態性能之間的折中，又同時滿足跟蹤精度和一定動態性能。但本文所涉及的短時猝發式擴頻通信系統要求更大的捕獲帶寬(±30kHz)，且導頻符號僅為2
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FPGA 載波同步
在同步電路設計中，邊沿檢測是必不可少的! 例如：在一個時鐘頻率16MHz的同步串行總線接收電路里，串行總線波特率為1Mbps。在串行總線的發送端是在同步時鐘(1MHz)的上升沿輸出數據，在接收端在同步時鐘的下降沿對輸入數據進行接收采樣。在這個接收電路里檢測同步時鐘的下降沿是必不可少的。假設主時鐘-clk，同步時鐘-rck，同步數據-data。 有些人在邊沿檢測的時候就喜歡這樣做：
但是大家忽略了一種情況，就是clk與rck之間比沒有必然的同步關系，當r
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FPGA 邊沿檢測
Achronix今日宣布其已在上海開設新的辦公室，以組建由工程與技術支持專業人員組成的本地團隊。新辦公室的這支團隊將與Achronix在全球其他地點的團隊密切合作，為大中華地區的客戶提供支持。該辦公室位于上海張江高科技園區長泰廣場，所在區域為我國集成電路產業中心之一。 Achronix在2017年的營業收入將比上年增長700%，使其成為2017年成長最快的半導體公司之一;其快速增長的營業收入得益于客戶對最高性能、低功耗、可編程的基于FPGA的硬件加速解決方案的強勁需求。這些需求來自于諸如軟件定義網絡
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Achronix FPGA
對大多數人來說，微芯片是一些長著小小的金屬針，標著看似隨機的字母或數字的字符串的黑盒子。但是對那些懂的人來說，有些芯片就像名人一樣站在紅毯上。有許多這樣的集成電路直接或間接地為改變世界的產品賦能，從而得到榮耀，也有一些芯片對整個計算環境造成了長期的影響。也有一些，它們的雄心壯志失敗后成為警世的故事。 為了紀念這些偉大的芯片，并講述它們背后的人和故事，IEEE Spectrum 制作了這個“芯片名人堂”(Chip Hall of Fame)。登堂的是7
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FPGA NAND
引言 傳統測量頻率的方法主要有直接測量法、分頻測量法、測周法等，這些方法往往只適用于測量一段頻率，當被測信號的頻率發生變化時，測量的精度就會下降。本文提出一種基于等精度原理的測量頻率的方法，在整個頻率測量過程中都能達到相同的測量精度，而與被測信號的頻率變化無關。本文利用FPGA(現場可編程門陣列)的高速數據處理能力，實現對被測信號的測量計數;利用單片機的運算和控制能力，實現對頻率、周期、脈沖寬度的計算及顯示。 等精度測量原理等精度測量的一個最大特點是測量的實際門控時間不是一個固定值，而
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Verilog FPGA
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