- 在2005年，FSAN(全業務接入網)組商定了千兆位無源光網絡(GPON)規范(見圖1)。此規范建立了語音、數據和視頻具有成本效益的遞交過程，這包括遞交到終端用戶的服務質量。‘first mile’接入技術采用光纖連接(光纖到用戶系統連接)可增加寬帶內容選擇。GPON很可能超過以太網無源光網絡成為未來光網絡的選擇。
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FSAN GPON FPGA
- 芯片功能的增加和數據吞吐量的要求，促使芯片行業從較低數據率的并行連接，轉向較高速度的串行連接。SERDES(Serializer-Dese rializer，)是經高速差分對，而不是經較低速度的并行總線傳輸串行化的數據。一個實例是用單個PCI-Express通道，替代傳統的32位、64MHz PCI總線(可達到2.112Gb/s)，僅用4條線(運行在2.5GHz)，可達到4Gb/s總數據率。簡言之，SERDES協議允許用較少的引腳數傳輸較高的數據率。
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SERDES FPGA
- 大量出現的無線應用具有嚴格的功耗設計要求和低價格。除功耗和低價設計任務外，還有高數據率要求和符合行業標準。系統設計師也需要保證最后產品的高性能和靈活性。
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IF FPGA OFDMA WiMAX
- FPGA和DSP之間的“智能配分”可使無線系統設計師獲得最佳性能組合和成本——效能。應用DSP和FPGA組合可使成本降低。對于無線基站，組合有DSP可編程邏輯的系統配分，可促使更大的產品設計和市場成功率。
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FPGA DSP
- 在數字通信系統中,必須以符號速率對解調器的輸出進行周期性地采樣.為此,接收器需要一個采樣時鐘信號,這個時鐘信號的頻率和符號速率相等,相位則必須保證采樣時刻是最佳的.在接收器中獲得這個采樣時鐘的過程被稱為符號
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FPGA 模糊控制 同步器
- 耗費數月精力做出的設計卻無法滿足時序要求，這確實非常令人傷心。然而，試圖正確地對設計進行約束以保證滿足時序要求的過程幾乎同樣令人費神。找到并確定時序約束本身通常也是非常令人頭痛的問題。時序問題的惱人之
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FPGA 發現 時序
- 如果高速PCB設計能夠像連接原理圖節點那樣簡單，以及像在計算機顯示器上所看到的那樣優美的話，那將是一件多么美好的事情。然而，除非設計師初入PCB設計，或者是極度的幸運，實際的PCB設計通常不像他們所從事的電路設
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PCB FPGA 版圖設計 設計技術
- 雖然現在市面上有很多類似的基于GPS的防盜系統，但并不能很好地實現防盜和丟失后找回功能。本作品利用Spartan-3E開發板彌補了以上缺陷。系統由防盜目標終端和尋找指引終端組成。兩終端均基于FPGA設計實現。當裝有防盜目標終端的物品丟失后，防盜目標終端將其所在經緯度位置信息加密并發送給尋找指引終端，指引終端解密該信息并計算出與目標終端的相對位置并通知用戶,從而最大限度地幫助人們找回丟失的物品的同時也保證了傳送信息的安全。
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GSM FPGA 定位追蹤
- 本作品主要目的在于針對ZigBee無線傳感器網絡中中心節點到控制中心的信息通信過程中存在的信息泄露和安全隱患，自行設計一套可移動基于FPGA平臺的高可靠通信系統。在獨立開發的基于CC2430芯片的無線傳感器星型網絡中，無線網絡節點與Spartan平臺進行信息交互，其中端到端的數據傳輸均實現AES加密。中心節點的服務器對有線網絡進行實時安全監測，當網絡中存在危險情況時通過GSM報警，由此實現了高可靠的網絡通信保障環境。
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ZigBee FPGA 加密
- ??????? “我們新的管理團隊大部分人來自ASIC公司。”在Xilinx二十五周年慶典之時，Xilinx全球副總裁湯立人風趣的說道，“他們也是因為看到了ASIC已達到局限性，因此決定‘棄暗投明’了。”
????????繼Altera于2008年底發布了首款基于40-nm技術的FPG
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FPGA 40nm ASIC
- 2009年2月25日，在上海舉行的“2009年中國半導體市場年會”上，“第三屆中國半導體創新產品和技術評選”活動的評選結果正式公布并舉行了頒獎儀式。埃派克森微電子的光電導航SOC芯片被評選為“2008年度中國半導體創新產品和技術”。
該評選是在工業和信息化部的指導下，由中國半導體行業協會(CSIA)、中國電子材料行業協會(CEMIA)、中
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埃派克森 半導體 光電導航 SOC
- 1 系統設計 在工業控制領域，利用ZigBee和傳感器網絡，使得數據的自動采集、分析和處理變得更加容易，作為決策輔助系統的重要組成部分，ZigBee無線傳感器網絡在無線數據采集及監控等領域得到了廣泛應用。無線傳感
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FPGA 通信系統
- 1引 言擴頻通信系統是將基帶信號的頻譜擴展到很寬的頻帶上，然后進行傳輸，通過增大頻帶寬度來提高信噪比的一種系統。由于擴頻系統具有抗干擾能力強、保密性高、截獲概率低、多址復用和任意選址等優點，在移動通信等
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FPGA 數字 解調 模塊設計
- 進行硬件設計的功能調試時，FPGA的再編程能力是關鍵的優點。CPLD和FPGA早期使用時，如果發現設計不能正常工作，工程師就使用“調試鉤”的方法。先將要觀察的FPGA內部信號引到引腳，然后用外部的邏輯分析儀捕獲數據。然而當設計的復雜程度增加時，這個方法就不再適合了，其中有幾個原因。第一是由于FPGA的功能增加了，而器件的引腳數目卻緩慢地增長。因此，可用邏輯對I/O的比率減小了，參見圖1。此外，設計很復雜時，通常完成設計后只有幾個空余的引腳，或者根本就沒有空余的引腳能用于調試。
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萊迪思 FPGA 邏輯分析儀
- 工程師在設計過程中，經常需要一定的創造力(不妨稱之為數字管道膠帶)才能夠保證設計的順利完成。過去8年時間里，我曾經目睹許多優秀工程師利用這一方法出色地完成了許多工作，而他們采用的最主要工具就是FPGA Editor。
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賽靈思 FPGA Editor
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