意法半導體(ST)宣布,該公司的SPEAr可配置型系統芯片系列新增加一款生力軍,新款的SPEAr基本型產品采用當前最先進的65nm低功耗制造工藝,可滿足各種嵌入式應用的需求,如入門級打印機、傳真機、數碼相框、網絡電話(VoIP)等設備。
ST的SPEAr(Structured Processor Enhanced Architecture,結構化處理器增強型架構)不僅能夠降低在開放市場銷售的標準產品的制造成本,加快
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ST SPEAr 嵌入式 SoC 芯片
引言
PCB 光板測試機基本的測試原理是歐姆定律,其測試方法是將待測試點間加一定的測試電壓,用譯碼電路選中PCB 板上待測試的兩點,獲得兩點間電阻值對應的電壓信號,通過電壓比較電路,測試出兩點間的電阻或通斷情況。 重復以上步驟多次,即可實現對整個電路板的測試。
由于被測試的點數比較多, 一般測試機都在2048點以上,測試控制電路比較復雜,測試點的查找方法以及切換方法直接影響測試機的測試速度,本文研究了基于FPGA的硬件控制系統設計。
硬件控制系統
測試過程是在上位計算機的控制下,控
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FPGA PCB 測試機 硬件電路
針對傳統數字視頻廣播系統碼流分析儀價格昂貴、使用不方便的問題,本文提出一種性價比較好的補充設計方案,它以通用的FPGA和RTOS為基礎、基于嵌入式硬件平臺來實現碼流分析功能。文中還闡述了碼流采集、碼流分析和信息顯示等多項關鍵技術。
碼流分析儀可用作數字電視設備的調試工具,如檢測MPEG編碼器、復用器、調制解調器等設備的輸入輸出碼流是否符合MPEG-2/數字電視廣播(DVB)標準等。作為標準檢驗設備,碼流分析儀是整個數字電視系統的不可缺少的重要設備。實際使用中的數字電視集成系統是一項龐大、復
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嵌入式 碼流分析 FPGA RTOS
0 引言
在許多嵌入式系統的實際應用中,需要擴展FPGA(現場可編程門陣列)模塊,將CPU實現有困難或實現效率低的部分用FPGA實現,如數字信號處理、硬件數字濾波器、各種算法等,或者利用FPGA來擴展I/O接口,如實現多路PWM(脈寬調制)輸出、實現PCI接口擴展等。通過合理的系統軟硬件功能劃分,結合優秀高效的FPGA設計,整個嵌入式系統的效率和功能可以得到最大限度的提高。
在電機控制等許多應用場合,需要產生多路頻率和脈沖寬度可調的PWM波形。本文用Altera公司FPGA產品開發工具Quar
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FPGA 邏輯仿真 PWM
??????? 在系統級芯片(SoC)的設計當中,MIPS的RISC處理器是一種應用非常廣泛的嵌入式CPU,它具有高性能、低功耗的特點,可以很方便地集成到一個完整的片上系統之中,使開發者能夠專注于用戶IP模塊的設計。MIPS架構的處理器占據了數字機頂盒微處理器和解碼器用CPU架構市場領域的領先地位。在MIPS家族的產品當中,32位的4KcTM處理器是具有代表性的一款,它采用了MIPS32的CPU架構,支持MIPS IITM指令集。在本文
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嵌入式CPU SoC MIPS 總線接口模塊
美國國家儀器有限公司(簡稱NI)推出4種用于PXI平臺的新型R系列?I/O模塊,這些模塊都配備了高性能的Xilinx?Virtex?-5現場可編程門陣列(FPGA)芯片。NI?PXI-7841R,?PXI-7842R,?PXI-7851R?和PXI-7852R模塊具有8個模擬輸入、8個模擬輸出和96個數字I/O通道,而且模擬輸入的速率比以前版本的R系列設備快3.5倍以上。這些新型模塊為工程師和科學家們提供了即時可用的硬件;不僅如此,這
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NI I/O模塊 FPGA LabVIEW
Altera公司近日發布了業界首款40nmFPGA(現場可編程門陣列)和HardCopyASIC(專用集成電路)。兩者都提供收發器,在密度、性能和低功耗上遙遙領先。
StratixIV系列有680K邏輯單元,比Altera的StratixIII系列高兩倍,是目前市場上密度最大的FPGA。器件滿足了眾多市場對各種高端應用的需求,例如無線和有線通信、廣播和ASIC原型開發等。
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Altera 40nm FPGA
引言
PCB 光板測試機基本的測試原理是歐姆定律,其測試方法是將待測試點間加一定的測試電壓,用譯碼電路選中PCB 板上待測試的兩點,獲得兩點間電阻值對應的電壓信號,通過電壓比較電路,測試出兩點間的電阻或通斷情況。 重復以上步驟多次,即可實現對整個電路板的測試。
由于被測試的點數比較多, 一般測試機都在2048點以上,測試控制電路比較復雜,測試點的查找方法以及切換方法直接影響測試機的測試速度,本文研究了基于FPGA的硬件控制系統設計。
硬件控制系統
測試過程是在上位計算機的控制下
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FPGA PCB 硬件電路 測試機
在嵌入式系統設計中常使用通用異步接收和發送器UART(Universal Asynchronous Receiver/Transmitter)實現系統控制信息或低速數據信息的傳輸,而UART所采用的奇偶校驗方式不具備前向糾錯能力,檢錯能力也有限,所以在設計UART時要盡可能提高其抗干擾能力,以加強系統的可靠性。
1 基于最佳接收的UART
目前UART中的接收器多采用如圖1所示的設計。
同步模塊
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UART 最佳接收 FPGA 同步模塊 邏輯優化
你是否有過這樣的經歷:見到一個人后,整個世界一下子明亮起來。所謂的“華堂升輝”、人們所說的“光彩照人”,連又聾又瞎的海倫?凱勒都說“點亮了我心中的明燈”。
如果你還沒有這樣的經歷,建議你去接觸一下FPGA界的人士吧!在半導體業的星光大道上,FPGA行業絕對是個群星燦爛的領域。激發你獲得靈感。
筆者多年前去美國參加一個會議,整日浸泡在英語的海洋中,非常boring。因此當采訪了A公司和Q公司的市場人員,深受震撼。他們都是高大健美,高高的鼻梁,深邃的眼睛,年齡三、四十,你隨便提
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FPGA 半導體
辭職頻繁
一個月前,X公司的VP來京和記者朋友們親切交談、共進午餐,大談X公司的發展前途,由于出差在外而沒有機會赴此盛宴的媒體人都十分惋惜。可沒想到幾周后,他卻悄然辭職了。
兩年前,A公司負責中國業務的B總來京慷慨激昂地講演,展望FPGA美好的未來,回去后記者賣力地寫稿稱頌。但是令人費解的是,幾個月后在處理另一篇邀請函時,發現B總怎么成了另一家新公司的老總?打電話一問,才知道B君已辭職,自己創辦了這家公司。
“投敵叛變”
最令人難以理解的是,互相跳到競爭
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FPGA 半導體
隨著集成電路制造技術的迅速發展,SOC設計已經成為當今集成電路設計的發展方向。SO C設計的復雜性對集成電路設計的各個層次,特別是對系統級芯片設計層次,帶來了新挑戰,原有的HDL難以滿足新的設計要求。
硬件設計領域有2種主要的設計語言:VHDL和Verilog HDL。而兩種語言的標準不統一,導致軟硬件設計工程師之間工作交流出現障礙,工作效率較低。因此,集成電路設計界一直在尋找一種能同時實現較高層次的軟件和硬件描述的系統級設計語言。Synopsys公司與Coware公司針對各方對系統級設計語言的
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SOC SystemC 集成電路 VHDL Verilog HDL
2008年5月,美國國家儀器有限公司(簡稱NI)推出4種用于PXI平臺的新型R系列 I/O模塊,這些模塊都配備了高性能的Xilinx Virtex-5現場可編程門陣列(FPGA)芯片。NI PXI-7841R, PXI-7842R, PXI-7851R 和PXI-7852R模塊具有8個模擬輸入、8個模擬輸出和96個數字I/O通道,而且模擬輸入的速率比以前版本的R系列設備快3.5倍以上。這些新型模塊為工程師和科學家們提供了即時可用的硬件;不僅如此,這些硬件還可通過NI LabVIEW FPGA軟件進行圖
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NI I/O模塊 FPGA 嵌入式 設計
? 為幫助設計人員提高集成度,進一步創新,Altera公司今天發布了業界的首款40-nm FPGA和HardCopy? ASIC。Stratix? IV FPGA和HardCopy IV ASIC都提供收發器,在密度、性能和低功耗上遙遙領先。Stratix IV系列有680K邏輯單元(LE),比Altera的Stratix III系列高2倍,是目前市場上密度最大的FPGA。HardCopy IV ASIC系列在密度上和Stratix IV器件等價,具有1330萬邏輯門。Alte
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Altera 40-nm FPGA ASIC
介紹了以ARM+DSP體系結構為基礎的FPGA實現。在其上驗證應用算法,實現了由ARM負責對整個程序的控制,由DSP負責對整個程序的計算,最大程度地同時發揮了ARM和DSP的各自優勢。
ARM通用CPU及其開發平臺,是近年來較為流行的開發平臺之一,而由ARM+DSP的雙核體系結構,更有其獨特的功能特點:由ARM完成整個體系的控制和流程操作,由DSP完成具體的算法和計算處理。這樣,不但可以充分地發揮ARM方便的控制優勢,同時又能最大限度地發揮DSP的計算功能。這在業界已逐漸成為一種趨勢。
本
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ARM DSP FPGA 軟硬件協同驗證 SoC
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