1 編碼器和分解器的類型
編碼器分為增量和絕對兩個基本類別。增量編碼器可以監控輪軸上的兩個位置，可以在輪軸每次經過這兩個位置時產生A或B脈沖。獨立的外部電動計數器然后從這些脈沖解讀出轉速和旋轉方向。雖然適用于眾多應用，但是增量式計數器確實存在某些不足。例如，在輪軸停轉情況下，增量編碼器在開始運行之前必須首先通過調回到某個指定校準點來實現自身校準。另外，增量式計數器易受到電氣干擾的影響，導致發送到系統的脈沖不準確，進而造成旋轉計數錯誤。不僅如此，許多增量編碼器屬于光電器件，如果對目標應用有影響，則
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編碼器 分解器 RDC FPGA 脈沖
2015年芯片大戰已經開始，聯發科Helio=逆襲高端？三星Exynos 7420=跑分破表？高通驍龍820=810補救？Intel Sofia計劃落實，智能手機芯片改名X3進軍低端？中端市場仍是主戰場，為爭奪份額芯片廠商們可謂是八仙過海，各顯神通。
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ARM 移動芯片
Xilinx的新一代設計套件 Vivado 相比上一代產品 ISE， 在運行速度、算法優化和功能整合等很多方面都有了顯著地改進。 但是對初學者來說，新的約束語言 XDC 以及腳本語言 Tcl 的引入則成為了快速掌握 Vivado 使用技巧的最大障礙，以至于兩年多后的今天，仍有很多用戶缺乏升級到 Vivado 的信心。
本文介紹了 Tcl 在 Vivado 中的基礎應用，希望起到拋磚引玉的作用，指引使用者在短時間內快速掌握相關技巧，更好地發揮 Vivado 在 FPGA 設計中的優勢。
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Xilinx VivadoTcl FPGA cells
1 FPGA浮點運算推陳出新
以往FPGA在進行浮點運算時，為符合IEEE 754標準，每次運算都需要去歸一化和歸一化步驟，導致了極大的性能瓶頸。因為這些歸一化和去歸一化步驟一般通過FPGA中的大規模桶形移位寄存器實現，需要大量的邏輯和布線資源。通常一個單精度浮點加法器需要500個查找表(LUT)，單精度浮點要占用30%的LUT，指數和自然對數等更復雜的數學函數需要大約1000個LUT。因此隨著DSP算法越來越復雜，FPGA性能會明顯劣化，對占用80%～90%邏輯資源的FPGA會造成嚴重的布線擁
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Altera FPGA LUT DSP 數據通路
本文提出了一種采用VHDL硬件描述語言設計新型三相正弦脈寬調制（SPWM）波形發生器的方法。該方法以直接數字頻率合成技術(DDS)為核心產生三相SPWM信號。并且利用VHDL設計了死區時間可調的死區時間控制器，解決了傳統的模塊電路等待方法很難產生帶精確死區時間控制的SPWM信號的問題。該方法在Quartus II 9.1環境平臺下進行了仿真驗證，并將設計程序下載到DE2-70實驗板進行實驗測試，用示波器測試得到了死區時間可控制的SPWM波形。
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VHDL SPWM DDS 死區時間 FPGA 201505
設計并實現了一種基于OMAP3730的低成本高清屏媒系統，能夠充分發揮可編程C64+DSP的強大計算功能， 利用硬件實現常用視頻格式的高清硬解碼播放，利用軟件兼顧不常有視頻格式的解碼播放，同時針對屏媒系統的特點利用DSP實現轉屏，達到在橫屏和豎屏上的自適應播放的效果。
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OMAP3730 ARM DSP GstDiscover 硬解碼 201505
本文針對成像聲納擴展圖像動態范圍和增強圖像細節的需求，提出了一種基于開方運算的動態范圍擴展方法。基于課題組研制的多波束成像聲納原理樣機的研制，分析了數據動態范圍壓縮導致圖像細節丟失的原因及其對成像質量的影響，采用JPL快速平方根近似算法改善了開方運算FPGA實現過程的資源占用和系統延時。最后，對改進設計方案進行了實驗驗證，通過多波束成像聲納系統的消聲水池實驗證明了本文動態范圍擴展方法的有效性和可行性，系統成像質量改善明顯，達到優化設計的預期目標。
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成像聲納 動態范圍 平方根 FPGA 波束成像 201505
本文對數字中頻信號處理技術進行了研究，采用軟件無線電的設計思想和解決方案，提出了一種基于“AD+FPGA”的中頻信號處理技術，在頻譜分析儀及信號分析儀等接收機中應用廣泛。
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數字中頻 軟件無線電 AD FPGA 分析儀 201505
本文通過對多種壓縮算法作進一步研究對比后發現，LZO壓縮算法是一種被稱為實時無損壓縮的算法，LZO壓縮算法在保證實時壓縮速率的優點的同時提供適中的壓縮率。如圖1(A)給出了Linux操作系統下常見開源壓縮算法的壓縮速率的測試結果，LZO壓縮算法速率極快;如圖1(B)給出了Gzip壓縮算法和LZO壓縮算法的壓縮率測試結構，從圖中可以看出，LZO壓縮算法可以提供平均約50%的壓縮率。
1 LZO壓縮算法基本原理分析
1.1 LZO壓縮算法壓縮原理
LZO壓縮算法采用(重復長度L，指回
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LZO FPGA LZSS RAM 壓縮算法
1 USB Type-C接口介紹
二十年前，第一代通用串行總線(Universal Serial Bus, USB 1.0)的出現，為各自為政的電子行業通信標準注入了互通性。而最新發布的USB Type-C接口規范將USB技術提升到了一個新的高度，能夠滿足21世紀電子行業的需求，同時也將再一次改變計算機、消費類電子產品以及移動設備之間的互連方式。輕薄、堅固、無需區分插頭方向的USB Type-C連接器拓展了由USB 3.1超速(SuperSpeed+)規范定義的各項功能，采用雙通道實現高達20
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FPGA USB Type-C 充電器 嵌入式
1 理解Thumb-2
首先，讓我們從一個看起來并不明顯的起點開始討論節能技術—指令集。所有Cortex-M CPU都使用Thumb-2指令集，它融合了32位ARM指令集和16位Thumb指令集，并且為原始性能和整體代碼大小提供了靈活的解決方案。在Cortex-M內核上一個典型的Thumb-2應用程序與完全采用ARM指令完成的相同功能應用程序相比，代碼大小減小到25%之內，而執行效率達到90%(當針對運行時間進行優化后)。
Thumb-2中包含了許多功能強大的指令，能夠有效減少
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ARM Cortex-M CPU 存儲器 MCU
1 藍牙低功耗技術
低功耗無線連網功能，是穿戴式技術發展過程中一大要素。不論是活動追蹤器等相對簡單的單一傳感器穿戴式產品，或是內建平視顯示器以顯示GPS/地圖與距離/速度數據的滑雪護目鏡等整合了眾多環境傳感器數據的高端產品，藍牙低功耗技術(Bluetooth LE，或依Bluetooch SIG命名為藍牙智能﹝Bluetooth Smart﹞)都是穿戴式科技眾多元素中的重要一環。
雖然還是有其他無線技術參與競爭，藍牙低功耗仍具備成為主流連網技術標準的條件。低功耗的特性，讓穿戴式產品只須小小
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藍牙 ARM 穿戴式產品 微控制器 物聯網 Cortex
1 系統方案
智能加樣器系統以FPGA為控制核心，通過控制步進電機的運動，結合到位傳感器，控制整個設備機械平臺的正常運轉;通過處理液位傳感器信號和控制泵閥一體模塊，實現加樣功能;同時，采用無線網絡與安卓手機通訊，將安卓手機作為無線控制終端和數據顯示平臺。系統的設計方案如圖1所示。
為了提高系統加樣速率與效率，設計了以試管架作為加樣單位的加樣方式。如圖2所示，系統由步進電機帶動機械推臂和行車，實現試管架在進樣倉、加樣區與出樣倉之間的推動轉移，并在加樣區實現對試管的依次加樣。這種新型的加樣
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FPGA 傳感器 液位探測 注射器 單片機
1 簡易旋轉倒立擺及控制裝置及其功能要求
設計并制作一套簡易旋轉倒立擺及其控制裝置。旋轉倒立擺的結構如圖1所示。電動機A固定在支架B上，通過轉軸F驅動旋轉臂C旋轉。擺桿E通過轉軸D固定在旋轉臂C的一端，當旋轉臂C在電動機A驅動下作往復旋轉運動時，帶動擺桿E在垂直于旋轉臂C的平面作自由旋轉。
1.2 基本要求
(1)擺桿從處于自然下垂狀態(擺角0°)開始，驅動電機帶動旋轉臂作往復旋轉使擺桿擺動，并盡快使擺角達到或超過-60°~ +60°;
(2)從擺桿
關鍵字：
ARM 單片機 PWM PID 旋轉臂
ARM體系急劇沖擊，PC業績低迷，壟斷地位備受關注，PC和服務器市場的王者Intel不好過，帝國是否就要崩塌，我們用以下數據說話。
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Intel ARM
fpga+arm介紹
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