- 盛群半導體(HOLTEK)推出內建放大器(OPA)的A/D型微控制器HT46R343。 HT46R343的ROM為4kx15、RAM為192bytes、I/O最多為37埠，除此之外HT46R343的A/D分辨率為12bits且總共有16個通道可以使用;內建OPA組件的輸入Offset可以透過軟件調整的方式調整至
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模擬技術 電源技術 盛群 半導體 MCU HT46R343 MCU和嵌入式微處理器
- 英飛凌科技股份公司(Infineon)近日推出了全新32位的XC2700系列MCU，瞄準不斷增長的全球摩托車引擎控制市場。32位的XC2700系列微控制器助力打造經濟高效的摩托車電子引擎裝置，并滿足即將頒布的排放標準要求。
XC2700系列以C166SV2高性能微控制器內核為基礎，可在80MHz的頻率下，通過66MHz五級管線提供單周期執行。它還集成了內存、穩壓器和接口等關鍵外設，以降低系統總體成本，而且該全新的微控制器系列可以采用現有的C166SV2開發軟件，使該系列成為經濟高效的解決方案。
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嵌入式系統 單片機 英飛凌 MCU XC2700系列 MCU和嵌入式微處理器
- 近日，Altera公司在清華大學拉開了全國大學教師會議的序幕， 來自全國118所高校的近300名教師、Altera公司高層參加了這一為期兩天的學術盛會。這已是Altera公司第五次舉辦的全國范圍內的大學教師會議。自2003年以來，Altera公司一年一度的大學教師會議，將全國各大高校的教師匯聚一堂，通過若干專題研討會以及經驗交流，讓廣大高校老師對可編程邏輯技術的發展及其在大學課程中的應用有更深入的了解，對課程設置的改革有更清晰的概念，為高校教師的應用教學搭建起交流學習的平臺。 在今年
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FPGA Altera
- 英飛凌科技股份公司近日推出了全新微控制器系列，瞄準不斷增長的全球摩托車引擎控制市場。
32位的XC2700系列微控制器以其卓越的性能將助力全球系統制造商打造經濟高效的摩托車電子引擎裝置，并滿足即將頒布的排放標準要求。中國和印度是世界上最大的摩托車市場，將在明年推出更加嚴格的排放控制標準，這進一步推動了市場對經濟高效的電子引擎管理系統的需求。
預計到2010年，印度的摩托車產量將達到1500萬輛，遠高于2005年的670萬輛。中國到2010年的摩托車產量更將高達2100萬輛，而2005年則為
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- 當前對于各種加密算法.除了有針對性的破解算法，最基本的思想就是窮舉密鑰進行匹配，通常稱為暴力破解算法。由于暴力破解算法包含密鑰個數較多，遍歷的時間超過實際可接受的范圍。如果計算速度提高到足夠快。這種遍歷的算法因結構設計簡便而具有實際應用的前景。
PCI總線(外設互聯總線)與傳統的總線標準——ISA總線(工業標準結構總線)相比，具有更高的傳輸率(132MBps)、支持32位處理器及DMA和即插即用等優點，用于取代ISA總線而成為目前臺式計算機的事實I/O總線標準，在普通PC機和工控機上有著廣泛的應
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- 引 言
FIR(finite impulse response)濾波器是數字信號處理系統中最基本的元件，它可以在保證任意幅頻特性的同時具有嚴格的線性相頻特性，同時其單位沖激響應是有限的，沒有輸入到輸出的反饋，是穩定的系統。因此，FIR濾波器在通信、圖像處理、模式識別等領域都有著廣泛的應用。
目前FIR濾波器的硬件實現有以下幾種方式：
一種是使用單片通用數字濾波器集成電路，這種電路使用簡單，但是由于字長和階數的規格較少，不易完全滿足實際需要。雖然可采用多片擴展來滿足要求，但會增加體積和
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- Altera公司技術開發副總裁Mojy Chian博士來到北京，在媒體座談會上介紹了該公司45nm IC開發的情況。他說，45nm相對65nm的優勢要比65nm相對90nm的優勢更大，同時開發難度也更高。Altera通過選擇正確的合作伙伴、采用“第一片硅投產”的方法以及協作設計和工藝開發的方式來實現2008年45nm FPGA的生產。
那個叫Moore的人真幸運。他沒有發現真正的物理定律。他只不過總結并預測了半導體產業的發展規律，但他可能比大多數發現真正定律的物理學家都著名。說他幸運，是因為那個
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嵌入式系統 單片機 FPGA 45納米 IC 模擬IC
- 摘要：在分析了RS-485總線與CAN部遲疑不決的異同點后，以PCA82C250型接口電路為例提出了用CAN總線通信物理層接口電路來替代RS-485總線接口中電路與單片機直接連接進行通信網絡設計，從而可形成一個高性能、低價格且數據通信安全、可靠的分布式測控系統。
關鍵詞：通信物理接口 RS-485總線 CAN總線 MCU
1 概述
用于多機間數據通信的通信物理層接口是分布式測控系統數據共享的工作基礎，傳統的以單片機為核心的分布式多機測控系統為簡化通信物理
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通信物理接口 RS-485總線 CAN總線 MCU MCU和嵌入式微處理器
- 在設計上能減少結構探索時間的C語言平臺，在結構上如何以新思考突破?
以往半導體業者大多使用FPGA(Field Programmable Gate Array)製作樣品(Prototype)，接著鎖定幾項晶片重要規格，依此找出最適合該晶片的結構，這種方式最大缺點是作業時間非常冗長。然而，C語言平臺的設計方式則是，利用軟體模擬分析檢討晶片結構，以往FPGA平臺的樣品，大約需要半年左右的結構探索時間，如果採用C語言平臺的設計方式，只需要花費約2周~1個月的時間。
目前開發最快的是日本沖電氣，以
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- 考慮一個數字信號處理的實例，比如有限沖擊響應濾波器（FIR）。用數學語言來說，FIR濾波器是做一系列的點積。取一個輸入量和一個序數向量，在系數和輸入樣本的滑動窗口間作乘法，然后將所有的乘積加起來，形成一個輸出樣本。 類似的運算在數字信號處理過程中大量地重復發生，使得為此設計的器件必須提供專門的支持，促成了了DSP器件與通用處理器（GPP）的分流： 1 對密集的乘法運算的支持 GPP不是設計來做密集乘法任務的，即使是一些現代的GPP，也要求多個指令周期來做一次乘法。而DSP處理器使用專門的硬件來實
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DSP MCU MCU和嵌入式微處理器
- 無線射頻識別 (RFID) 將成為第一種與條碼技術并存并最終將在低成本識別和個人數據存儲領域取代條碼技術的新興技術。 與條碼技術相比，它具有多種優勢，包括： 1.) 可以存儲更多數據，2.) 可以在標簽中集成一定智能，3.) 可以在一定距離外掃描，以及 4.) 可以減少人為干預。 所有這一切皆因MCU 的使用而成為可能。
EPC 技術對智能標簽的影響
在消費層的部署中，下一代標簽系統必須發展一種新的復雜級別，以應對新應用和全球互操作性所帶來的復雜性。
就像統一產品編碼 (UPC) 是
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MCU 智能卡 MCU和嵌入式微處理器
- 1 引言
隨著數字信號處理器、超大規模集成電路的高速發展，語音記錄技術已從模擬錄音階段過渡到數字錄音階段。在數字化錄音技術中，壓縮后的語音數據有些存儲在硬盤中，有些存儲在帶有掉電保護功能的RAM或FLASH存儲器中。筆者介紹的語音存儲與回放系統，未使用專用的語音處理芯片，不需要擴展接口電路，只利用FPGA作為核心控制器，就能完成語音信號的數字化處理，即實現語音的存儲與回放。
2 系統總體結構
數字化語音存儲與回放系統的基本工作原理是將模擬語音信號通過模數轉換器(A/D)轉換成數字信號
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嵌入式系統 單片機 FPGA 語音存儲 MCU和嵌入式微處理器
- 64 Kbit/s的A律或μ律的對數壓擴PCM編碼在大容量的光纖通信系統和數字微波系統中已得到廣泛應用，但由于占用較大的傳輸帶寬和具有復雜的成幀結構，PCM編碼不適合無線語音系統的應用。連續可變斜率增量(Continuously Variable Slope Delta，CVSD)調制以其較低的應用難度、成本和編碼速率，較好的語音質量廣泛應用于戰術通信網、衛星通信、藍牙等無線語音傳輸領域。近年來FPGA不斷發展演化，并在構架方面針對DSP應用有了顯著增強。這些增強使得FPGA能夠支持各領域的眾多復雜D
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嵌入式系統 單片機 FPGA CVSD 語音編解碼器 MCU和嵌入式微處理器
- 筆者結合FPGA的靈活性、強大的數字信號處理能力、較短的開發周期，提出了基于FPGA的32 Kbit/s CVSD語音編解碼器。
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