當前電機控制的發(fā)展越來越趨于多樣化、復雜化，現場也提出越來越苛刻的性能要求。因此客戶有可能考慮自己開發(fā)專用的控制芯片，FPGA的可編程性正是可以滿足這種需求。上期講解了三大電機控制方案之MCU篇，這期來看看FPGA。
對于電機控制提出的不同要求，FPGA芯片固有的可編程性和并行處理的特點十分適合于中高端的電機控制應用。由于它以純硬件的方式進行并行處理，而且不占用CPU的資源，所以可以使系統(tǒng)達到很高的性能。
在電機控制的市場上，眾多專注于FPGA技術的廠商接連推出了各具特色的解決方案，本系列
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FPGA Actel
自從Lattice(萊迪思半導體)并購了Silicon Blue后，在當時就為FPGA產業(yè)投下一顆震撼彈，后來又在2015年，并購Silicon Image來強化影像處理方面的產品陣容。在歷經了約莫一年左右的時間，Lattice趁勝追擊推出了全新產品線：CrossLink，它被Lattice定義成可編程的ASSP，簡稱為pASSP。
Lattice亞太區(qū)資深事業(yè)發(fā)展經理陳英仁表示，之所以會推出這樣的產品，原因主要有兩個，一是影音訊號輸入與輸入不相容的問題，其次則是輸入與輸出的通道無法匹配。舉例來
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Lattice FPGA
Arteris公司今天宣布推出1.5版本NCore cache一致性互連IP。Arteris公司是從事系統(tǒng)級芯片(SoC)互連IP的創(chuàng)新性供應商，它的商用系統(tǒng)級芯片NoC互連IP已經廣泛被采用。NCore IP是分散式異構cache一致性互連解決方案，系統(tǒng)設計師可以用它高效率地設計出cache一致性的系統(tǒng)，它的優(yōu)點是具有多個可配置的Snoop Filter和嵌入式高速緩存(cache)。在今天的SoC設計中通常使用傳統(tǒng)固定式或集中式cache一致性式互連，與之相比，NCo
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Arteris SoC
Arteris公司是商用系統(tǒng)級芯片(SoC)互連IP的創(chuàng)新性供應商，今天宣布推出一種半導體設計技術，在用不同供應商的IP設計出高速緩存一致性(Cache Coherent)高效率系統(tǒng)時，它提高了系統(tǒng)級芯片設計師的設計能力。利用這項新技術，推出了業(yè)界第一個分散式、異構高速緩存一致性(Cache Coherence)互連，幫助設計人員實現更高的頻率，更低的功耗，高效率地生產有特色的系統(tǒng)級芯片，縮短產品進入市場的時間。這種系統(tǒng)級芯片跨越多個設計領域，如移動設備、高清晰度電視、企業(yè)級存儲、
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Arteris SoC
萊迪思半導體公司，客制化智能互連解決方案市場的領先供應商，今日宣布針對工業(yè)市場推出19款HDMI?產品。HDMI發(fā)送器、接收器、端口處理器和視頻處理器套件保證了無縫的“即插即用”連接，超越了傳統(tǒng)消費電子和移動應用。 視頻應用在整個工業(yè)產品市場普遍存在，在今天的智能自動化系統(tǒng)中扮演著重要的角色。萊迪思提供了一系列可編程器件，滿足工業(yè)環(huán)境和長時間工作的要求，同時保持連續(xù)工作和無與倫比的可靠性。隨著HDMI產品的加入，萊迪思可以幫助制造商解決關鍵橋接問題或實現視頻處理功能，增強了人機界面、安全監(jiān)控以及數字
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萊迪思 FPGA
今年2月底，一個收購消息在國外安全社區(qū)開始傳播。IBM Security 正在收購網絡安全應急響應公司 Resilient Systems，據知情人士透露，收購價約為1億美金。
實際上，自從 IBM Security 在2012年正式建立之后，連續(xù)收購了Trusteer(10億美金)、CrossIdeas和Lighthouse三家安全公司。而且IBM安全正式成立之前，IBM還收購了 包括Q1 Labs、Algorithmics、BigFix、Guardium、Watchfire、Consul R
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IBM SOC
一個單片機應用系統(tǒng)的硬件電路設計包含兩部分內容：一是系統(tǒng)擴展，即單片機內部的功能單元，如ROM、RAM、I/O、定時器/計數器、中斷系統(tǒng)等不能滿足應用系統(tǒng)的要求時，必須在片外進行擴展，選擇適當的芯片，設計相應的電路。二是系統(tǒng)的配置，即按照系統(tǒng)功能要求配置外圍設備，如鍵盤、顯示器、打印機、A/D、D/A轉換器等，要設計合適的接口電路。 系統(tǒng)的擴展和配置應遵循以下原則： 1、盡可能選擇典型電路，并符合單片機常規(guī)用法。為硬件系統(tǒng)的標準化、模塊化打下良好的基礎。 2、系統(tǒng)擴展與外圍設備的配置水平應充分滿
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單片機 SoC
Altera，現在已屬英特爾公司，今天發(fā)布新的產品版Quartus? Prime Pro設計軟件，進一步提高了FPGA設計性能和設計團隊的效率。Quartus Prime Pro軟件設計用于支持英特爾下一代高度集成的大容量FPGA，這將推動云計算、數據中心、物聯網及其連網等領域的創(chuàng)新。內置在最新版軟件中的功能前所未有的縮短了編譯時間，提供通用設計輸入方法，簡化了知識產權(IP)的集成，從而加速了大規(guī)模FPGA設計流程。 英特爾的FPGA軟件和IP市場營銷總監(jiān)B
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Altera FPGA
當產生門控時鐘的組合邏輯超過一級時，證設計項目的可靠性變得很困難。即使樣機或仿真結果沒有顯示出靜態(tài)險象，但實際上仍然可能存在著危險。通常，我們不應該用多級組合邏輯去鐘控PLD設計中的觸發(fā)器。 圖1給出一個含有險象的多級時鐘的例子。時鐘是由SEL引腳控制的多路選擇器輸出的。多路選擇器的輸入是時鐘(CLK)和該時鐘的2分頻 (DIV2)。由圖1的定時波形圖看出，在兩個時鐘均為邏輯1的情況下，當SEL線的狀態(tài)改變時，存在靜態(tài)險象。險象的程度取決于工作的條件。 多級邏輯的險象是可以去除的
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FPGA CPLD
FPGA是一個需要長期積累的過程，而FPGA是為特殊需要而生的，注定無法是大眾的，產業(yè)細分才是王道。
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FPGA 京微雅格
業(yè)內有些公司套取政府資金上癮了，公司就是公司，少拿自主創(chuàng)新說事，更不要打著民族的名義要錢。
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京微雅格 FPGA
可綜合的意思是說所編寫的代碼可以對應成具體的電路，不可綜合就是所寫代碼沒有對應的電路結構，例如行為級語法就是一種不可綜合的代碼，通常用于寫仿真測試文件。 建立可綜合模型時，需注意以下幾點： 不使用initial 不使用#10之類的延時語句 不使用循環(huán)次數不確定的循環(huán)語句，如forever，while等 不使用用戶自定義原語(UDP元件) 盡量使用同步方式設計電路 用always塊來描述組合邏輯時，應列出所有輸入信號作為敏感信號列表，即always@(*) 所有的內部寄存器都應該能夠被復
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verilog FPGA
Altera，現在已屬英特爾公司，今天宣布啟動其設計解決方案網絡(DSN，Design Solutions Network)，這一全球輔助支持系統(tǒng)將穩(wěn)健的設計服務網絡、IP、電路板和商用現貨產品(COTS)公司合并到一個計劃中。DSN計劃將客戶與網絡成員連接起來，通過統(tǒng)一的搜索網站，為他們提供Altera CPLD、FPGA、SoC和Enpirion?電源器件相關的產品或者設計服務，幫助客戶加速產品創(chuàng)新，網站位于www.altera.com.cn/dsn。 Intel可
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Altera FPGA
通信基帶才是SoC能在市場上能脫穎而出的制勝法寶，擁有基帶的廠商在競爭中的優(yōu)勢不言而喻，手機廠商們在選擇SoC方案時必然要考慮這方面的因素，而活到今天依然滋潤的芯片廠商大都也是擁有基帶的廠商。
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SoC 基帶
智能互聯和自動駕駛是未來汽車產業(yè)的一個大的趨勢，其中安全問題和汽車圖像處理問題變得尤為重要。瑞薩電子面對這一趨勢會有怎樣的對策呢?又將怎樣看待中國的汽車電子業(yè)?
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MCU/SoC 智能互聯 自動駕駛 趙明宇 201605
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