- Synopsys宣布應用其擴展的業界領先的VMM方法，幫助產品開發團隊更有效地定義、測量并實現他們的驗證目標。新一代VMM解決方案可通過三個新的部分實現更高的驗證生產效率，即VMM Planner、VMM Applications和VMM Automation。VMM Planner有助于經理們系統地計劃和跟蹤驗證進展，提高驗證的可視性和可預測性；VMM Applications有助于架構師迅速構建有效的驗證環境，縮短測試工作臺的創建時間；VMM&nbs
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Synopsys VMM方法 單片機 嵌入式系統 生產效率
- Synopsys宣布意法半導體在其90nm和65nm 的ASIC設計流程中，應用Design Compiler拓樸繪圖技術，縮短了整個設計時間。意法半導體在其ASIC方法集中應用Design Compiler拓樸繪圖技術，從而消除了設計的反復(Iteration)，實現了內部設計團隊和外部客戶整個設計環節工作的順暢。 在ASIC模式下，設計能否按計劃完成，在很多程度上取決于設計收斂完成前，網表在客戶與ASIC供應商間反復時間的縮短。Design Compil
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ASIC設計 Compiler拓樸繪圖技術 Design ST Synopsys 單片機 嵌入式系統 EDA IC設計
- Synopsys的SystemVerilog解決方案被用于驗證針對網絡、外設和消費應用的下一代 片上互連架構 全球電子設計自動化軟件工具（EDA）領導廠商Synopsys（Nasdaq: SNPS）近日宣布，全球領先的移動、汽車和PC/音頻視頻半導體系統解決方案供應商—瑞薩科技采用其VCS®的功能驗證解決方案，開發復雜的芯片上系統（SoC），并選定了VMM方法集，即《Verification Methodology Manual (VMM) for
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- 解決45納米及以下工藝相關變異問題 創新的工藝識別DFM系列產品有助于設計者減少工藝變異的影響， 改善先進半導體的制造設計 全球領先的電子設計自動化（EDA）軟件工具領導廠商Synopsys推出了具備工藝識別功能的可制造性設計(DFM)新系列產品PA－DFM，用于分析45納米及以下工藝定制/模擬設計階段的工藝變異的影響。隨著工藝尺寸的日益減小，先進硅技術將引起更多如應力工程的變異問題，這將越來越影響電路的性能。Synopsys PA-DFM系列的核心產品Seismos 和 P
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DFM Synopsys 通訊 網絡 無線
- 易于移植、強有力的技術發展路線圖等優勢使其在競爭中脫穎而出 全球電子設計自動化軟件工具（EDA）領導廠商Synopsys（Nasdaq: SNPS）近日宣布，美國威捷半導體公司（Silicon Optix）采用Synopsys IC Compiler下一代布局布線解決方案，設計其高性能視頻處理器。長期以來，威捷半導體一直是Synopsys布局布線技術的用戶。為了轉向90納米工藝，威捷半導體評估了市場上所有的解決方案，并最終選定了IC Compiler，這是
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- Synopsys與聯華電子合作，以低功耗和DFT功能加強90納米參考流程 針對聯華電子的90納米工藝，Synopsys的 Galaxy®設計平臺業已通過多電壓 （Multi-Vdd）功能的實戰驗證 全球電子設計自動化軟件工具（EDA）領導廠商Synopsys（Nasdaq: SNPS）與世界半導體晶圓專工領導者臺灣聯華電子共同宣布，雙方合作以Synopsys的Galaxy™ 設計解決方案平臺為基礎，針對聯華電子的90納米工藝，在參考設計流程中增
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- 華虹NEC選擇Synopsys作為其首選EDA供應商 全球領先的電子設計自動化（EDA）軟件工具領導廠商Synopsys 與中國最先進的集成電路制造商之一上海華虹NEC電子有限公司今日宣布，雙方將攜手開發應用于華虹NEC 0.18微米工藝的參考設計流程 2.0。華虹NEC選擇Synopsys作為其首選EDA供應商后，將充分利用Synopsys Professional Services開發基于Synopsys Galaxy™
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Synopsys 參考設計流程 測量 測試 單片機 華虹NEC 嵌入式系統
- TensilicaÒ宣布增加了自動可配置處理器內核的設計方法學以面對90納米工藝下普通集成電路設計的挑戰。這些增加支持Cadence和Synosys工具的最新能力，包括自動生成物理設計流程腳本，自動輸入用戶定義的功耗結構以及支持串繞分析。 Tensilica利用Synopsys的Power Compiler™的低功耗優化能力，同時在Xtensa LX內核和所有設計者自定義的擴展功能中自動的插入精細度時鐘門控，從而降低動態功耗。新自動生成的Xtensa布線腳本可
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- 在設計過程早期發現并解決問題
在電路和系統設計中，需要昂貴的驗證周期這一點證明電子設計師和 EDA 供應商也都是不免要犯錯的，所以最好使用能避免大多數錯誤的工具和方法。 要 點 ● 制造能力與工程生產率之間的差距繼續在加大。 ● 現在不存在標準的驗證方法。 ● 形式證明可減小設計師對功能驗證的依賴性。 ● 由于深亞微米加工存在許多電子物理學問題，電路驗證的重要性正在增加。 設計驗證需要每個設計小組花費大量的時間和資源。設計驗證費用與設計的規模和
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- 國家集成電路人才培養基地首期先進課程講學活動于近期在杭州舉行。此次活動邀請來自美國頂級高等院校的8位集成電路方面的權威教授，向17所國內高校的教師及特邀人員講授了集成電路領域最先進的技術和最新的分析研究方法。此次活動得到了Synopsys公司的大力支持，幫助邀請并組織了這8位權威教授來華講學。通過此次合作，Synopsys為中國培養集成電路人才提供了多方面的支持，也是Synopsys與中國戰略伙伴之間開展長期合作的一個延續。www.synopsys.com
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Synopsys
- Synopsys公司宣布已與智芯科技公司(IPCore)簽署了一項協議，IPCore將采用Synopsys的Galaxy設計平臺、Discovery驗證平臺和廣泛的DesignWare IP產品系列作為其首選的內部設計流程。通過此次兩家公司的合作，將為130nm及以下的流片工藝開發出全面的深亞微米級設計流程。同時，根據協議內容， Synopsys 專業化服務部也將通過有選擇性地在轉包合同基礎上與IPCore進行合作，從而拓展自身在中國的業務提供能力。www.synopsys.com
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Synopsys
- 3月下旬，全球領先的EDA軟件提供商Synopsys宣布啟用擴建后的上海研發中心，該中心擁有200多名銷售、研發和技術支持人員。上海研發中心已經成為Synopsys在海外最大的研發中心，它將與位于美國總部的研發中心一起，為全世界的IC設計者開發新一代的設計工具，并不斷為中國的半導體產業提供深入支持。目前，Synopsys與中國科學院及國內知名高校建立了戰略合作關系，包括與中國科學院共建先進的SoC設計聯合實驗室，以及支持國家集成電路設計產業化基地孵化器建設項目等。此外，中芯國際（SMIC）也表示，把中芯國
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Synopsys
- Synopsys公司為其Galaxy測試解決方案推出DFT編譯器和自動測試模式生成工具TetraMAX。其中DFT的快速掃描綜合技術和標準測試DRC引擎可加速掃描插入與測試設計規則檢查，從而使設計人員在短時間內完成測試性設計。而改進的TetraMAX ATPG算法將有助于數百萬門設計中優化壓縮的模式生成。www.synopsys.com
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Synopsys 存儲器
- 新思科技(Synopsys)與聯電宣布針對聯電0.13mm工藝及新思的Galaxy平臺開發出參考設計流程。該流程使用了新思的Design Compilera、DFT Compilera、VCS、Formality、Physical Compilera、Astroa、PrimeTimea、Star-RCXTa、以及HerculesaPVS等工具，以協助客戶面對深亞微米工藝所帶來的挑戰。www.synopsys.com
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Synopsys
- 為幫助中國科學院培養出能夠掌握最先進IC設計軟件和硬件平臺的高級人才，從而推動中國IC產業的發展，Synopsys與SUN公司聯手，通過美國Charles Babbage基金會向中國科學院EDA中心贈予20套IC設計全流程EDA工具軟件、20臺工作站和1臺服務器。作為對中國市場長期承諾的一部分，Synopsys公司一直致力于幫助中國加快IC產業，特別是IC設計業的成長。在此次合作中，Synopsys除了上述捐贈活動外，還將提供相應的技術培訓與咨詢服務。該中心的IC設計開發人員在應用Synopsys最先進工
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