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Cadence為AI數(shù)字信號服務(wù)提供商提出了新的方向
- 語音人工智能和沉浸式音頻在家庭娛樂、汽車信息娛樂和智能手機中的重要性促使Cadence宣布推出第六代優(yōu)化DSP IP——Tensilicia HiFi iQ DSP，專為設(shè)備內(nèi)語音AI和音頻設(shè)計。HiFi DSP家族的最新成員基于專門設(shè)計的架構(gòu)，擁有公司HiFi 5s DSP的兩倍計算能力和更高AI性能。它節(jié)能——Cadence聲稱大多數(shù)工作負(fù)載能節(jié)省超過25%，同時還聲稱能提升音頻編解碼器性能40%。Cadence表示，增強的自動矢量化技術(shù)使編程更為簡便，并縮短了上市時間。還集成支持FP8、BF16及其
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Cadence及其合作伙伴排隊購買預(yù)驗證芯片組
- 你有沒有想過芯片組是什么？可以把它看作是一小塊專用的硅片（“芯片”），設(shè)計用來與其他芯片集成在同一封裝內(nèi)，因此成品器件表現(xiàn)得像一塊大型芯片。設(shè)計師沒有打造龐大的單體SoC，而是將計算、I/O、內(nèi)存接口及其他功能拆分為混合搭配的構(gòu)建模塊，然后用高速的點對位鏈路連接起來。它的吸引力在于更高的良率、更多的重復(fù)使用，以及可以將每個功能放在最適合它的工藝節(jié)點上。Cadence 的核心布局Cadence正試圖通過將知識產(chǎn)權(quán)合作伙伴和包裝技術(shù)納入“規(guī)格到組件”流程，使芯片組不再是定制的科學(xué)項目。它的理念是，從芯片組規(guī)范
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Cadence采用下一代低功耗DRAM和Microsoft RAIDDR ECC技術(shù)，為人工智能應(yīng)用提供企業(yè)級可靠性
- 楷登電子（美國 Cadence 公司）近日宣布，推出業(yè)界首款專為企業(yè)與數(shù)據(jù)中心應(yīng)用設(shè)計的高可靠性 LPDDR5X 9600Mbps 內(nèi)存 IP 系統(tǒng)解決方案。該創(chuàng)新方案融合了 Cadence 經(jīng)過量產(chǎn)驗證的 LPDDR5X IP 與微軟的先進冗余獨立雙倍數(shù)據(jù)速率陣列（RAIDDR）糾錯碼（ECC）編碼方案，實現(xiàn)了兼具高性能、低功耗與穩(wěn)健可靠性的強強組合。微軟已成為首個部署該新款系統(tǒng)解決方案的客戶。在 AI 基礎(chǔ)設(shè)施構(gòu)建浪潮中，LPDDR5X 憑借其在處理 AI、HPC 及其他內(nèi)存密集型工作負(fù)載方面的卓越能
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Cadence在臺積電N3P上以64Gbps的速率對UCIe IP進行錄送
- Cadence已開發(fā)出第三代通用芯片互連快遞（UCIe）IP解決方案，支持臺積電N3P流程中每通道最高64 Gbps的數(shù)據(jù)速率。這一發(fā)展反映了基于芯片組架構(gòu)的持續(xù)勢頭，設(shè)計師們推動更高帶寬和更緊密的集成，尤其是在先進節(jié)點上。此次更新具有相關(guān)性，因為UCIe IP正日益影響工程師如何處理多芯片集成，尤其是在AI加速器、高性能計算和數(shù)據(jù)中心平臺中，帶寬密度和能效正成為系統(tǒng)層面的限制。UCIe IP 目標(biāo)是高級節(jié)點的更高帶寬據(jù)Cadence稱，流片的UCIe IP符合UCIe規(guī)范，旨在支持尖端工藝技術(shù)下的可擴展
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Caliber互聯(lián)加速復(fù)雜的芯片組和ATE硬件設(shè)計，采用Cadence Allegro X和Sigrity X解決方案
- Caliber Interconnects Pvt. Ltd. 宣布，已在復(fù)雜的芯片組和自動化測試設(shè)備（ATE）硬件項目中實現(xiàn)了加速周轉(zhuǎn)時間和首次正確結(jié)果。公司完善了其專有的設(shè)計與驗證流程，整合了強大的Cadence解決方案，從設(shè)計初期階段起就優(yōu)化性能、功耗和可靠性。Caliber先進的方法論顯著提升了設(shè)計高復(fù)雜度集成電路封裝和密集PCB布局的效率和精度。通過利用Cadence Allegro X設(shè)計平臺進行PCB和高級封裝設(shè)計，該平臺具備亞原始管理和自動路由功能，Caliber團隊能夠在不同電路塊間并行
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Cadence電子設(shè)計仿真工具標(biāo)準(zhǔn)搭載村田制作所的產(chǎn)品數(shù)據(jù)
- 株式會社村田制作所（以下簡稱“村田”）已在 Cadence Design Systems, Inc.（總部：美國加利福尼亞州，以下簡稱“Cadence”）提供的 EDA 工具(1) “OrCAD X Capture”以及“AWR Design Environment”中標(biāo)準(zhǔn)搭載了部分產(chǎn)品數(shù)據(jù)。由此，在 EDA 工具中即可選擇村田產(chǎn)品并開展仿真，可用于應(yīng)對用戶多樣化的設(shè)計需求與規(guī)格的選項較以往進一步增多，從而有助于推動電路設(shè)計的高階化。注釋(1)?? EDA 工具：電子設(shè)計自動化
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Cadence借助NVIDIA DGX SuperPOD模型擴展數(shù)字孿生平臺庫
- 楷登電子（美國 Cadence 公司）近日宣布，Cadence? Reality? Digital Twin Platform利用搭載 DGX GB200 系統(tǒng)的 NVIDIA DGX SuperPOD 數(shù)字孿生系統(tǒng)實現(xiàn)了庫的重大擴展。借助 NVIDIA 高性能加速計算平臺的新模型，數(shù)據(jù)中心設(shè)計人員與操作人員將能夠在 AI 工廠的構(gòu)建中輕松部署世界領(lǐng)先的 AI 加速器。作為一款創(chuàng)新解決方案，Cadence Reality Digital Twin Platform 能夠在物理實施之前，根據(jù)特定服務(wù)等級協(xié)議
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Cadence攜手NVIDIA革新功耗分析技術(shù)，加速開發(fā)十億門級AI設(shè)計
- 楷登電子（美國 Cadence 公司）近日宣布，通過與NVIDIA的緊密合作，公司在硅前設(shè)計功耗分析方面取得重大飛躍。借助 Cadence? Palladium? Z3 Enterprise Emulation Platform 的先進功能，利用 Cadence 全新 Dynamic Power Analysis（DPA）應(yīng)用程序，Cadence 與 NVIDIA 實現(xiàn)了業(yè)界曾認(rèn)為難以企及的目標(biāo)：在短短數(shù)小時內(nèi)完成對十億門級 AI 設(shè)計的硬件加速動態(tài)功耗分析，覆蓋數(shù)十億個周期，分析精度高達 97%。得益于
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英偉達采用賽迪斯功率分析工具重新生產(chǎn) Rubin 芯片
- Cadence Design Systems 開發(fā)了一種動態(tài)功率分析（DPA）應(yīng)用程序，該應(yīng)用程序可以擴展到具有超過 400 億個門的芯片設(shè)計，例如 Nvidia 最新的 Rubin GPU。DPA 在 Palladium Z3 模擬器上運行，以在幾小時內(nèi)以 97%的精度評估設(shè)計在數(shù)十億個周期內(nèi)的動態(tài)功耗。功率分析是 AI 芯片（如 Nvidia 的 Blackwell 和 Rubin GPU）的主要挑戰(zhàn)之一。不同的 AI 工作負(fù)載在不同時間對芯片設(shè)計的不同部分造成壓力，因此在進行芯片提交到硅之
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EDA巨頭對華出口違規(guī)，遭美國司法部和商務(wù)部罰款超1.4億美元
- 7月28日，美國司法部（DOJ）與加州北區(qū)檢察官辦公室聯(lián)合宣布，總部位于美國加州圣何塞的EDA巨頭公司Cadence Design Systems, Inc.就違反出口管制法律達成認(rèn)罪協(xié)議，以解決其違反《出口管制條例》（EAR）的刑事指控。根據(jù)協(xié)議，Cadence需向司法部支付近1.18億美元刑事罰款，同時與商務(wù)部工業(yè)與安全局（BIS）達成超9500萬美元民事和解，經(jīng)協(xié)調(diào)抵扣后總支付額超1.4億美元，刷新了近年來美國對EDA企業(yè)出口違規(guī)的處罰紀(jì)錄。Cadence必須在命令下達后的30天內(nèi)，向BIS支付其中
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Cadence率先推出業(yè)內(nèi)首款LPDDR6/5X 14.4Gbps內(nèi)存IP，為新一代AI基礎(chǔ)架構(gòu)助力
- 楷登電子（美國 Cadence 公司）近日宣布業(yè)內(nèi)首個 LPDDR6/5X 內(nèi)存 IP 系統(tǒng)解決方案完成流片。該解決方案已經(jīng)過優(yōu)化，運行速率高達 14.4Gbps，比上一代 LPDDR DRAM 快 50%。全新的 Cadence? LPDDR6/5X 內(nèi)存 IP 系統(tǒng)解決方案是擴展 AI 基礎(chǔ)架構(gòu)的關(guān)鍵驅(qū)動因素。經(jīng)過擴展之后，AI 基礎(chǔ)架構(gòu)可以適應(yīng)新一代 AI LLM、代理 AI 及其他垂直領(lǐng)域計算密集型工作負(fù)載對于內(nèi)存帶寬和容量的需求。在這方面，Cadence 目前正在與領(lǐng)先的 AI、高性能計算（HP
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美國EDA大廠新思科技收購案獲中國有條件批準(zhǔn)
- 7月14日，國家市場監(jiān)督管理總局發(fā)布公告，宣布附加限制性條件批準(zhǔn)新思科技公司（Synopsys）收購安似科技公司（Ansys）股權(quán)案。公告稱，鑒于此項經(jīng)營者集中在全球和中國境內(nèi)光學(xué)軟件、光子軟件市場、部分EDA軟件市場和設(shè)計IP市場具有或者可能具有排除、限制競爭效果，根據(jù)申報方提交的附加限制性條件承諾方案，市場監(jiān)管總局決定附加限制性條件批準(zhǔn)此項集中，要求集中雙方和集中后實體履行如下義務(wù)：· 剝離光學(xué)解決方案相關(guān)業(yè)務(wù)，即新思科技整個光學(xué)和光子器件仿真業(yè)務(wù)。· 剝離功耗分析軟件有關(guān)業(yè)務(wù)，即安似科技功耗分析軟件
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Cadence推出面向新一代音頻應(yīng)用的支持緩存一致性的對稱多核處理器HiFi 5s SMP
- 新一代消費電子及汽車音頻系統(tǒng)的復(fù)雜性與日俱增，基于生成式 AI 的音頻處理、沉浸式音效以及軟件定義汽車中的高級信息娛樂系統(tǒng)等市場驅(qū)動因素，對音頻 DSP 性能提出了更高的要求。然而，單個 DSP 已無法滿足日益增長的計算需求，而多個 DSP 又會大幅增加編程難度。如今，原始設(shè)備制造商(OEM)和系統(tǒng)級芯片(SoC)供應(yīng)商必須在日益緊迫的產(chǎn)品上市壓力下，獨立完成所有多核硬件設(shè)計和軟件開發(fā)工作。與此同時，程序員們正艱難應(yīng)對基于軟件的共享存儲域的復(fù)雜同步問題，絞盡腦汁設(shè)法將任務(wù)合理分配到多核集群中。這可能導(dǎo)致設(shè)
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Cadence 將擴大與三星晶圓廠的合作
- 7 月 8 日，Cadence通過其微信公眾號正式宣布，這家美國公司最近決定擴大與三星晶圓廠的合作。雙方已簽署一項新的多年 IP 協(xié)議，以擴展Cadence?存儲器和接口 IP 解決方案在三星晶圓廠先進 SF4X、SF5A 和 SF2P 工藝節(jié)點的部署。這些解決方案將支持人工智能數(shù)據(jù)中心、汽車系統(tǒng)和下一代射頻連接的高性能、低功耗應(yīng)用。通過結(jié)合Cadence的 AI 驅(qū)動設(shè)計和硅解決方案與三星的先進制造技術(shù)，這項合作旨在加速基于三星領(lǐng)先節(jié)點的尖端系統(tǒng)級芯片（SoC）、芯片和 3D-IC 產(chǎn)品的上市時間（TT
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Cadence Design Systems Inc.是全球最大的電子設(shè)計技術(shù)(Electronic Design Technologies)、程序方案服務(wù)和設(shè)計服務(wù)供應(yīng)商。其解決方案旨在提升和監(jiān)控半導(dǎo) [ 查看詳細(xì) ]
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