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asic ip核 文章 最新資訊

萊迪思和FLEXIBILIS推出首個FPGA以太網(wǎng)交換IP核

  • 萊迪思半導體公司（NASDAQ: LSCC）和Flexibilis Oy今日宣布了即可獲取Flexibilis以太網(wǎng)交換（FES）IP核。三速（10Mbps/100Mbps/1Gbps）FES IP核工作在以太網(wǎng)第2層，每個端口具有Gigabit的轉換能力。支持Gigabit光纖和Gigabit雙絞線銅以太網(wǎng)接口。支持的服務質量高達每端口四個隊列。
  • 關鍵字： LSCC  FES – HSR IP核  

數(shù)字下變頻(DDC)中坐標變換模塊的ASIC實現(xiàn)

  • 數(shù)字下變頻(DDC)中坐標變換模塊的ASIC實現(xiàn),數(shù)字下變頻器中坐標變換模塊的ASIC實現(xiàn)1．引言

    數(shù)字下變頻(DDC)技術是軟件無線電接收機的核心技術。其基本功能是從輸人的寬帶高速數(shù)字信號中提取所需的窄帶信號，將其下變頻為數(shù)字基帶信號，并轉換成較低的數(shù)據(jù)率
  • 關鍵字： 模塊  ASIC  實現(xiàn)  變換  坐標  變頻  DDC  數(shù)字  

數(shù)字下變頻器中坐標變換模塊的ASIC實現(xiàn)

  • 1．引言數(shù)字下變頻(DDC)技術是軟件無線電接收機的核心技術。其基本功能是從輸人的寬帶高速數(shù)字信號...
  • 關鍵字： 數(shù)字下變頻  DDC  ASIC  坐標變換  

ASIC后端設計中的時鐘樹綜合

  • 摘要：時鐘樹綜合是當今集成電路設計中的重要環(huán)節(jié)，因此在FFT處理器芯片的版圖設計過程中，為了達到良好的布局效果，采用時序驅動布局，同時限制了布局密度；為了使時鐘偏移盡可能少，采用了時鐘樹自動綜合和手動修改
  • 關鍵字： ASIC  后端設計  時鐘樹    

賽靈思變革生態(tài)系統(tǒng)加速可編程平臺主流應用進程

  • 　　日前， 全球可編程平臺領導廠商賽靈思公司 （Xilinx, Inc. (NASDAQ:XLNX)）宣布，為建立新的 FPGA 應用市場， 賽靈思公司將通過其開放式平臺以及對業(yè)界重要標準的支持變革生態(tài)系統(tǒng)， 推動賽靈思聯(lián)盟計劃向縱深層次發(fā)展。作為該計劃的一部分， 賽靈思將幫助 FPGA 用戶根據(jù)其具體的設計與開發(fā)要求更方便快捷地找到理想的合作伙伴， 同時提升客戶與賽靈思聯(lián)盟計劃成員合作時的滿意度和質量。 　　賽靈思合作伙伴生態(tài)系統(tǒng)及聯(lián)盟高級總監(jiān) Dave Tokic 指出： “客戶開始越來
  • 關鍵字： Xilinx  ASIC  ASSP  

三大系列28nm器件成功融入主流高端ASIC和ASSP市場

  • 　　自上世紀80年代中期FPGA作為1,500 ASIC等效門器件首次進入市場以來，F(xiàn)PGA已經(jīng)取得了長足的發(fā)展。二十年后，隨著賽靈思新款7系列的推出，F(xiàn)PGA準備實踐其曾經(jīng)的承諾，即在某天完全取代ASIC，成為電子行業(yè)的主流邏輯IC。隨著7系列FPGA的推出，通過更低的傳統(tǒng)上由ASIC和ASSP占據(jù)主要地位的中低批量應用市場的總擁有成本，同時為大批量應用市場提供等同的總擁有成本，賽靈思進而從PLD生產(chǎn)商搖身一變成為了一流的邏輯IC供應商。另外，這種總擁有成本上的優(yōu)勢與傳統(tǒng)上FPGA能夠加速產(chǎn)品面市和降低
  • 關鍵字： Xilinx  28nm  ASIC  ASSP  

Tensilica成首家獲DTS廣播認證的音頻IP核供應商

  • 　　Tensilica日前宣布，成為首家獲得DTS廣播和DTS DMP(數(shù)字媒體播放器)認證的音頻IP(自主知識產(chǎn)權)核供應商。該項認證基于Tensilica HiFi 2和HiFi EP音頻DSP(數(shù)字信號處理器)IP核以及優(yōu)化的軟件程序，為開發(fā)人員提供了經(jīng)過驗證的SoC(片上系統(tǒng))解決方案，可縮短新的全兼容設計的面市時間。Tensilica也曾于2009年9月成為首家獲得DTS-HD Master Audio認證的IP核供應商。
  • 關鍵字： Tensilica  IP核  

智能卡控制器IP核的設計與實現(xiàn)

  • 摘要：本文介紹了一款兼容ISO7816-3協(xié)議的智能卡控制器IP核。該IP核能實現(xiàn)對智能卡的探測、電源管理、復位和...
  • 關鍵字： ASIC  ISO7816  智能卡  IP核  Verilog  語言  

ASIC和FPGA的優(yōu)勢與劣勢

  • ASIC和FPGA的優(yōu)勢與劣勢,ASIC和FPGA具有不同的價值主張，在作出選擇前必須仔細評估。兩種種技術對比。這里介紹了ASIC和FPGA 的優(yōu)勢與劣勢：FPGA與ASIC的設計優(yōu)勢
    FPGA 的設計優(yōu)勢
  • 關鍵字： 劣勢  優(yōu)勢  FPGA  ASIC  

ASIC原型驗證板DDR2 速率再攀高峰

  • 　　唐芯微電子(Infix-IP)Altera Stratix IV 530/820 FPGA單顆(MB3100-A5/8)和雙顆(D-MB3100A)原型驗證平臺半年來在用戶項目使用中，從性能、價格、穩(wěn)定性來說已得到了用戶的很高評價，當然，唐芯微人還是不失抓住每一次售后機會，把握用戶提出的問題和建議，配合用戶完成項目的同時對這款產(chǎn)品進行一次次優(yōu)化修正，不但用戶對唐芯微電子售后服務有了更進一步體會，而且?guī)醉椉夹g成果的突破也讓用戶刮目相看。 　　比如，在這一定要再提一下的是，經(jīng)過唐芯微(Infix-IP)
  • 關鍵字： 唐芯微電子  ASIC  

ASIC原型驗證板DDR2 速率再攀高峰

  • 　　唐芯微電子(Infix-IP)Altera Stratix IV 530/820 FPGA單顆(MB3100-A5/8)和雙顆(D-MB3100A)原型驗證平臺半年來在用戶項目使用中，從性能、價格、穩(wěn)定性來說已得到了用戶的很高評價，當然，唐芯微人還是不失抓住每一次售后機會，把握用戶提出的問題和建議，配合用戶完成項目的同時對這款產(chǎn)品進行一次次優(yōu)化修正，不但用戶對唐芯微電子售后服務有了更進一步體會，而且?guī)醉椉夹g成果的突破也讓用戶刮目相看。
  • 關鍵字： ASIC  DDR2  

SOPC設計中自定義IP的開發(fā)

  • 1? SOPC技術與IP核 SOPC的主要思想是提供一個IP庫，用戶從IP庫中選擇IP核來組裝系統(tǒng)，因此IP核是SOPC設計的關鍵技術之一。雖然IP核一詞在眾多場合被使用，但它并沒有一個統(tǒng)一的定義。從概念上可以這樣理解它：IP核是指將一些在數(shù)字電路中常用但比較復雜的功能塊，如FIR濾波器、SDRAM控制器、UART控制器等設計成可修改參數(shù)的模塊，讓其他用戶可以直接調用這些模塊，這樣就大大減輕了工程師的負擔，避免重復勞動，縮短系統(tǒng)開發(fā)時間。
  • 關鍵字： SOPC  IP核  

Tensilica授權富士通音頻、基帶DSP和數(shù)據(jù)處理器IP核

  • 　　Tensilica日前宣布，富士通與Tensilica簽署了一項多年的合作協(xié)議，授權富士通使用音頻、基帶DSP(數(shù)字信號處理器)和數(shù)據(jù)處理器(DPU)IP核，Tensilica DPU IP核結合了高性能DSP和嵌入式控制處理器的功能，在相同的功耗水平下，可以提供超乎普通DSP和嵌入式控制處理器數(shù)十倍的性能。該協(xié)議賦予富士通所有部門使用Tensilica IP核的權限。　
  • 關鍵字： Tensilica  DSP  IP核  

面向ASIC和FPGA設計的多點綜合技術

  • 面向ASIC和FPGA設計的多點綜合技術,隨著設計復雜性增加，傳統(tǒng)的綜合方法面臨越來越大的挑戰(zhàn)。為此，Synplicity公司開發(fā)了同時適用于FPGA或 ASIC設計的多點綜合技術，它集成了“自上而下”與“自下而上”綜合方法的優(yōu)勢，能提供高結
  • 關鍵字： 綜合  技術  設計  FPGA  ASIC  面向  
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