賽靈思公司和Brilliant 電信公司日前宣布：針對下一代有線和無線網絡推出業界第一個基于FPGA的電信級時序(Timing)解決方案。這一聯合開發的解決方案為下一代通信網絡設計人員提供了第一個嵌入式可編程解決方案，該方案具有無與倫比的靈活性、現場可升級能力和定制化能力。通過將時序功能集成到賽靈思FPGA器件中，這一解決方案可顯著降低成本。在賽靈思Virtex™ 或 Spartan™ FPGA中實現的這一解決方案以兩款知識產權(IP)內核—NGNTime 和 FemtoTim
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嵌入式系統 單片機 賽靈思 Brilliant FPGA MCU和嵌入式微處理器
電池管理系統是混合動力汽車中重要的電子控制單元，具有保障電池正常、可靠和高效工作的作用，是電池與用電設備之間的橋梁。在研制以及批量生產過程中都需要對其內部控制參數進行離線或在線匹配標定，而電池管理系統需要采集和處理大量的數據，本文選用TMS320LF2407作為標定用CAN控制器。作為電動汽車上的一個CAN節點，需要接收整車發來的CAN消息來執行對外部繼電器、風扇以及電池等器件的控制命令，本文選用SJA1000。
雙CAN硬件電路和CPLD邏輯設計
雙CAN硬件電路設計
TMS320
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嵌入式系統 單片機 CAN CPLD 電池管理 MCU和嵌入式微處理器
1.引言
隨著集成電路復雜度越來越高，測試開銷在電路和系統總開銷中所占的比例不斷上升，測試方法的研究顯得非常突出。目前在測試源的劃分上可以采用內建自測試或片外測試。內建自測試把測試源和被測電路都集成在芯片的內部，對于目前SOC級的芯片測試如果采用內建自測試則付出的硬件面積開銷則是很大的，同時也增加了芯片設計的難度：因此片外測試便成為目前被普遍看好的方法。由于FPGA具有可重構的靈活性，利用FPGA來作為測試源實現片外測試就是一種非常有效的手段。
由于偽隨機模式測試只需要有限個數的輸入向量便
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嵌入式系統 單片機 FPGA 序列生成器 Verilog HDL MCU和嵌入式微處理器
Altera公司宣布新的零功耗MAX® IIZ CPLD進一步擴展了其低功耗可編程邏輯解決方案產品組合，該器件是專門針對解決便攜式應用市場的功耗、封裝和價格限制而設計開發的。和相競爭的傳統宏單元CPLD相比，MAX IIZ器件具有6倍的密度和3倍的I/O資源優勢，以相同甚至更低的功耗滿足了設計人員對各種功能的需求，同時大大降低了電路板面積。MAX IIZ器件為業界最流行的CPLD系列增加了零功耗和超小型封裝型號，使手持式設備和其他便攜式應用能夠充分發揮CPLD的諸多優勢——包括靈活性、產品快速
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嵌入式系統 單片機 Altera CPLD MAX MCU和嵌入式微處理器
FPGA簡介
FPGA是英文Field Programmable Gate Array的縮寫，即現場可編程門陣列，它是在可編程陣列邏輯PAL(Programmable Array Logic)、門陣列邏輯GAL(Gate Array Logic)、可編程邏輯器件PLD(Programmable Logic Device)等可編程器件的基礎什么是FPGA上進一步發展的產
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FPGA 新手 入門 元器件 其他IC 制程
1 引言
FPGA憑借其方便靈活、可重復編程等優點而日益被廣泛應用;閃速存儲器(Flash Memory)以其集成度高、成本低、使用方便等優點，在眾多領域中也獲得了廣泛應用。在現代數字電路設計中。經常需要保存大量數據，而Flash存儲速度快、體積小、功耗低且價格低廉，可在線電擦寫，信息在掉電后不會丟失，因此成為設計人員的首選。
2 M25P80的介紹
Flash是一種具有電可擦除的可編程ROM，可以分為兩大類：并行Flash和串行Flash。并行Flash存儲量大，速度快;而串行Fl
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嵌入式系統 單片機 FPGA Flash 串 MCU和嵌入式微處理器
1 引言
中國于2006年8月頒布了數字電視的地面廣播標準GB20600-2006，成為繼美國ATSC、歐洲DVB-T、日本ISDB-T之后又一重要的地面數字電視廣播的國家標準。GB20600-2006中對中國數字電視地面傳輸(DigitalTerrestrial Television Broadcasting，DTTB)系統傳輸的幀結構、信道編碼和調制作了具體的規定。其中幀結構的基本單元——信號幀采用了循環擴展的時域幀頭結構，即在每3780個符號的幀體前加入一定長度的經循環擴展后的偽隨機序列作
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嵌入式系統 單片機 數字電視 FPGA 載波 MCU和嵌入式微處理器
引 言
本系統以AD7892SQ和CPLD(復雜可編程邏輯器件)為核心設計了一個多路信號采集電路，包括模擬多路復用、集成放大、A/D轉換，CPLD控制等。采用硬件描述語言Verilog HDL編程，通過采用CPLD使數據采集的實時性得到提高。
1 硬件設計
針對多路信號的采集，本系統采用4/8通道ADG508A模擬多路復用器對檢測的信號進行選擇，CMOS高速放大器LF156對選中的信號進行放大，AD7892SQ實現信號的A/D轉換，CPLD完成控制功能。電路如圖1所示。
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嵌入式系統 單片機 AD7892SQ CPLD 數據采集 MCU和嵌入式微處理器
賽靈思公司宣布開始正式發放高性能計算行業首款針對Intel前端總線(FSB)的FPGA加速解決方案商業許可。基于高性能65nm Virtex™-5 平臺 FPGA 和Intel® QuickAssist技術，賽靈思公司的加速計算平臺(Accelerated Computing Platform, ACP)M1許可包支持實現全速1066MHz FSB性能。ACP M1許可包目前已開始向系統集成商提供，支持他們進行解決方案的開發，以提高基于Intel處理器的服務器平臺的性能，并保證把功
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嵌入式系統 單片機 賽靈思 FPGA FSB
1.引言
示波器測量頻率和相位的方法很多， “李沙育圖形法”就是其中用得最多的一種。“李沙育圖形法”又稱波形合成法，就是將被測頻率的信號和頻率已知的標準信號分別加至示波器的Y軸輸入端和x軸輸入端，在示波器顯示屏上將出現一個合成圖形，這個圖形就是李沙育圖形。李沙育圖形隨兩個輸入信號的頻率、相位、幅度不同，所呈現的波形也不同。
早期的模擬示波器顯示李沙育圖形的原理是將電信號轉換為光信號，核心部分是陰極射線示波管(CRT)。將輸入信號加到示波管內部的偏轉系統，高速電子經聚焦、加速和偏轉后，打到熒
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嵌入式系統 單片機 FPGA 示波器 MCU和嵌入式微處理器
1 引言
TCN(Train Communication Network)總體結構是由WTB(絞線式列車總線)和MVB(多功能車輛總線)組成，符合IEC61375-1標準。本文主要圍繞WTB鏈路控制的幀格式進行研究。鑒于IEC61375-1標準中規定的WTB幀數據格式與IS03309中定義的HDLC(High Level Data Link Control)格式一致，基帶Manchester-Biphase-L技術編解碼器現則圍繞HDLC展開。
隨著深亞微米工藝技術的發展，FPGA(Fie
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本文設計了一種基于FPGA的、通用可配置的通信開發與測試平臺。針對不同信道編碼和調制方式的組合，通過采用實時軟硬件重構技術，該平臺可以在短期內完成相應通信系統的構建、驗證和配置。
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FPGA 可配置 通信 平臺設計
摘要： 基于FPGA/CPLD的UART設計眾多，本文分析了3倍頻采樣方法存在的不足，同時分析了16倍頻采樣對起始位檢測的可靠性，并給出相關的VHDL硬件描述語言程序代碼。
關健詞： 異步數據;UART;FPGA/CPLD;VHDL
概述
隨著電子設計自動化(EDA)技術的發展，可編程邏輯器件FPGA/CPLD已經在許多方面得到了廣泛應用，而UART(通用異步收發器) 是在數字通信和控制系統中廣泛使用的串行數據傳輸協議。因此越來越多用戶根據自己的需要，以EDA技術作為開發手段，用一塊
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0711_A 雜志_設計天地 嵌入式系統 單片機 異步數據 UART FPGA/CPLD VHDL MCU和嵌入式微處理器
引言
圖像處理技術的快速發展，使得圖像采集處理系統在提高農業生產自動化程度中的應用越來越廣泛。目前的圖像采集系統有的基于CCD攝像機、圖像采集卡和計算機，有的基于CCD攝像機、解碼器、FPGA和DSP，而有的基于CMOS圖像傳感器芯片、FPGA和DSP，它們在實時性，靈活性，可維護性方面各有優缺點。而在農業生產中，以基于CCD攝像機、圖像采集卡和計算機的系統居多。本文結合實際系統中的前端圖像處理和圖像數據傳輸需要.充分利用ARM的靈活性和FPGA的并行性特點，設計了一種基于ARM+FPGA的圖像
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嵌入式系統 單片機 圖像處理 CCD FPGA MCU和嵌入式微處理器
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