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dsp+fpga 文章 最新資訊

基于Matlab和FPGA的FIR數(shù)字濾波器設(shè)計及實現(xiàn)

  • 摘要:基于FIR數(shù)字濾波器的原理和層次化、模塊化設(shè)計思想,結(jié)合Altera公司的CycloneII系列FPGA芯片,提出了FIR數(shù)字濾波器的實現(xiàn)硬件方案,給出了采用Matlab、QuartusⅡ設(shè)計及實現(xiàn)32階低通FIR濾波器的方法步驟,仿真及
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CANopen協(xié)議在現(xiàn)場總線網(wǎng)絡(luò)中的應(yīng)用

2009年3月30日,Altera在天津大學(xué)成立國內(nèi)第60所EDA/SOPC聯(lián)合實驗室

  •   Altera公司今天宣布,Altera公司于2009年3月10日在天津大學(xué)成立EDA/SOPC聯(lián)合實驗室。這是Altera自2004年3月在中國電子科技大學(xué)成立首個EDA/SOPC聯(lián)合實驗室以來的國內(nèi)第60所聯(lián)合實驗室和培訓(xùn)中心。該實驗室將為數(shù)字邏輯電路、硬件描述語言、微機原理、電視原理、現(xiàn)代數(shù)字系統(tǒng)設(shè)計等本科或研究生課程的實驗教學(xué)以及電子類課程設(shè)計提供支持,Altera®公司的FPGA開發(fā)環(huán)境將成為貫穿天津大學(xué)電子工程類專業(yè)本科和研究生教育階段的實驗平臺。   作為全球領(lǐng)先的可編程邏輯器件
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基于FPGA的高速圖像采集系統(tǒng)設(shè)計

  • 在高速圖像采集系統(tǒng)中,CPU時鐘資源、I/O端口資源、傳輸單元等都成為系統(tǒng)的瓶頸。本系統(tǒng)采用FPGA+RAM+USB的設(shè)計:FPGA硬件采樣模塊,有效降低采樣時延和CPU時鐘資源;獨特的RAM時序控制與讀寫控制分離設(shè)計,增加了模塊之間的獨立性,降低了控制的復(fù)雜度;USB設(shè)計在實現(xiàn)高速率數(shù)據(jù)傳輸?shù)耐瑫r又具有低成本、易安裝等優(yōu)點。
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Tensilica HiFi 2音頻DSP支持DRM解碼器

  • 2009年3月27日,Tensilica今日宣布,即將推出基于HiFi2音頻DSP的DRM解碼器,設(shè)計人員可以很方便地集成HiFi2引擎...
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C5402 DSP自舉引導(dǎo)方法的分析與研究

  • 在DSP領(lǐng)域,TI公司(德州儀器公司)一直處于世界霸主地位,它生產(chǎn)的TMS320系列DSP芯片以其獨特的哈佛結(jié)構(gòu)、硬件密集型方案和靈活的指令系統(tǒng)成為數(shù)字信號處理器產(chǎn)業(yè)中的領(lǐng)先者[1]。其C5000系列DSP芯片具有功耗小、高度并
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基于DSP Builder的正弦信號源優(yōu)化設(shè)計及其FPGA實現(xiàn)

  • 實現(xiàn)信號源常用的方法是頻率合成法,其中直接數(shù)字頻率合成法是繼直接頻率合成法和間接頻率合成法之后,隨著電子技術(shù)迅速發(fā)展的第三代頻率合成技術(shù)。DDS是一種全數(shù)字技術(shù),它從相位概念出發(fā)直接合成所需頻率,它具有頻
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具有自適應(yīng)通信能力的無線傳感網(wǎng)節(jié)點設(shè)計

DSP與ISA總線PnP卡的接口技術(shù)研究

  • DSP與ISA總線PnP卡的接口技術(shù)研究,為解決多個總線設(shè)備共享系統(tǒng)總線時所帶來的系統(tǒng)底層資源的分配和再分配問題,Microsoft公司在1993年以后相繼公布了即插即用PnP(Plug-and-Play)規(guī)范,包括的總線類型有ISA、EISA、PCMCIA、PCI、VESA及SCSI等。PnP技術(shù)提
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基于DSP的DMA控制技術(shù)

  • 基于DSP的DMA控制技術(shù),TMS320C2XX是美國TI公司推出的一種低價格、高性能的16位定點運算數(shù)字信號處理器(DSP),它的性價比極高,目前已成為高檔單片機的理想替代品,在通信、語音處理、軍事、儀器儀表、圖像處理等領(lǐng)域得到了廣泛的應(yīng)用。在以TM
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飛機剎車模糊神經(jīng)網(wǎng)絡(luò)DSP嵌入式控制系統(tǒng)

液晶顯示器邊框精密檢測系統(tǒng)的實現(xiàn)

  • 液晶顯示器邊框精密檢測系統(tǒng)的實現(xiàn),液晶顯示器現(xiàn)在已實現(xiàn)了大規(guī)模生產(chǎn),其外部框架要求和液晶面板達到無縫結(jié)合,為了達到工業(yè)標(biāo)準(zhǔn),需要對批量生產(chǎn)的顯示器邊框的制作精度進行檢測。其檢測過程為用固定位置的12個傳感器對顯示器邊框上不同的12個點進行
  • 關(guān)鍵字: 實現(xiàn)  檢測系統(tǒng)  精密  邊框  液晶顯示  顯示器邊框檢測系統(tǒng)  接觸式測距  DSP  CAN  

基于ARM和FPGA的聲納波形產(chǎn)生系統(tǒng)設(shè)

  • 基于ARM和FPGA的聲納波形產(chǎn)生系統(tǒng)設(shè),1、引言  最佳聲納系統(tǒng)的設(shè)計需要從聲納波形、聲納信道和聲納接收機三方面進行綜合考慮[1]。在聲納信道一定的假設(shè)下,需要設(shè)計最佳聲納波形和最佳接收機,使聲納系統(tǒng)能在給定的聲納環(huán)境中對目標(biāo)有最佳的檢測效果。
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USB OTG的IP Core設(shè)計與FPGA驗證

  • 為了實現(xiàn)USB設(shè)備之間的直接通信,介紹一款USB 0TG IP核的設(shè)計與FPGA驗證。在分析OTG補充規(guī)范的基礎(chǔ)上,重點描述了USB OTG IP核的設(shè)計原理、模塊劃分以及每個模塊的功能,然后對USBOTG的部分特性進行詳細的闡述,最后給出該IP核在ModelSim中的功能仿真及FPGA驗證結(jié)果。結(jié)果表明,該IP核具備主機功能和設(shè)備功能,可作為一個獨立的IP模塊應(yīng)用到SoC系統(tǒng)中。
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CEVA-TeakLite-III擁有同類處理器中最高的面積及能源效率

  •   全球領(lǐng)先的知識產(chǎn)權(quán) (IP) 平臺解決方案和數(shù)字信號處理器 (DSP) 內(nèi)核的領(lǐng)先授權(quán)廠商CEVA公司宣布,Berkeley Design Technology, Inc. (BDTI) 已經(jīng)公布對32位 CEVA-TeakLite-III DSP進行之BDTI DSP Kernel Benchmarks? 認證測試所得的結(jié)果。BDTI 采用這個基準(zhǔn)工具套件進行認證,結(jié)果表明CEVA-TeakLite-II達到同類處理器中最高的DSP面積效率和能源效率。此外,CEVA-TeakLite-I
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