- 摘要：根據工業應用的實際需要以及網絡通信發展的功能要求，提出了基于FPGA智能變送器控制系統的總體方案，設計了以XILINX公司的Spartan3系列XC3S4005PO208C可編程邏輯器件為主控制器、DM9000A為以太網通信接口、SJA
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FPGA 智能變送器
- 該便攜式接觸網故障信號分析儀采用圖形化程序設計語言LabVIEW開發設計, 可實現數據的高速實時采集、在線分析、自動存儲、顯示等功能。高速數字化儀NI PXI- 5112卡采樣速度高、性能穩定可靠, 適宜對高速變化信號的實時監測。將軟件安裝在PXI- 1042工控機上, 具有體積小、抗干擾能力強、攜帶方便等特點, 同時具有故障性質判斷、故障定位功能。該系統目前已經在石家莊變電所現場運行, 效果良好。
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FPGA 8051 TCP IP
- 摘要 在分析Sony公司ICX098BQ面陣CCD圖像傳感器驅動時序的基礎上，對可調節曝光時間的CCD時序發生器及其硬件電路進行設計。選用FPGA器件作為硬件設計平臺，使用VHDL語言對時序關系進行了硬件描述。采用QuartusII 8.0
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FPGA CCD 面陣 發生器
- 隨著通信與網絡技術的不斷發展，使我國用現有的E1資源來傳輸以太網業務成為廣泛的應用。以太網數據要通過E1線路傳輸就必須對以太網凈荷數據進行幀封裝，才能從E1線路上恢復出以太網數據幀，完成以太網數據的交換。通常，以太網數據是通過HDLC協議或GFP協議來進行封裝的。本文介紹了中國移動標準協議轉換器中以太網到單路E1轉換器HDLC協議封裝的FPGA（現場可編程邏輯陣列）設計與實現。
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中國移動 FPGA 201106
- 摘要 基于Flash存儲器的Hamming編碼原理，在Altera QuartusⅡ7．0開發環境下，實現ECC校驗功能。測試結果表明，該程序可實現每256 Byte數據生成3 Byte的ECC校驗數據，能夠檢測出1 bit錯誤和2 bit錯誤，對于1 bit錯誤
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Flash FPGA NAND ECC
- 針對于傳統家居安防系統的布線煩瑣，無法實現移動訪問、施工周期長、后期維護困難、可擴展性差等問題種種弊端，我們運用TCP/IP網絡技術及藍牙無線通信技術，實現了真正意義上的無線智能家居安防系統。本系統能夠實時
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智能家居 安防系統 無線 網絡 TCP/IP 基于
- 1 概述 JPEG2000[1,2]是新的靜止圖像壓縮標準，它具有的多種特性使得它有著廣泛的應用前景。目前為止，JPEG2000的解決方案比較少，并且其中的絕大部分是軟件解決方案：Jasper[3]軟件是經IEC JTC1/SC29/WG1小組推薦
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IP 設計 編碼器 算術 Q-Coder 基于
- 隨著半導體工藝技術的迅猛發展，現場可編程邏輯器件FPGA的集成度迅速提高，已達到百萬門量級，與此同時，FPGA中的邏 ...
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ARM FPGA 加載配置
- 8位RISC MCU IP軟核仿真的新方法, 本文提出的建立虛擬指令存儲器模塊對MCU IP核仿真的方案和自動生成指令測試文件的方法，大大提高了MCU IP核仿真和驗證的效率。此方法不僅對本文中MCU IP核的仿真和驗證有效，也可用于同類中其它IP核的仿真和驗證。例如當對MCU進行升級設計、擴展尋址范圍或指令寬度時，只要修改仿真文件和轉化程序的相關參數即可。
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真的 方法 軟核 IP RISC MCU 8位
- PCI接口IP核的DVB碼流接收系統設計,隨著數字化廣播電視技術的迅速發展和基于MPEG-2標準的圖像壓縮和復用技術的完善，利用PC對大容量信息的處理變得日益重要，如基于PC的軟復用器的實現，使得通過PC接收DVB(數字視頻廣播)碼流已逐漸成為一項不可替代的多
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系統 設計 接收 DVB 接口 IP PCI
- 摘要：提出一種通過兩個二階節級聯構成四階IIR數字橢圓濾波器的設計方法，并利用Matlab仿真軟件設計了通帶內波紋不大于0．1 dB，阻帶衰減不小于42 dB的IIR數字濾波器。論述了一種采用可編程邏輯器件，通過VHDL硬件描
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Matlab FPGA IIR 數字濾波器
- 在現代數字通信中，對數據傳輸容量和傳輸效率的要求越來越高，因此經常依據時分復用[1]的原理通過數字復接與分...
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數字復接技術 FPGA 時分復用
- 摘要：在FPGA設計中，為了成功地操作，可靠的時鐘是非常關鍵的。設計不良的時鐘在極限的溫度、電壓下將導致錯誤的行為。在設計PLD／FPGA時通常采用如下四種類型時鐘：全局時鐘、門控時鐘、多級邏輯時鐘和波動式時鐘。
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FPGA 時鐘設計
- 1 引 言 在雷達及聲納信號處理系統中，波束形成算法通常采用DSP軟件編程實現，控制邏輯電路采用CPLD來完成，這種方法具有軟件編程靈活、功能易于擴展的優點，但對于實時性能要求很高的系統，如雷達、聲納探測和
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FPGA 自適應波束 算法
- 針對高清圖像在中值濾波預處理過程中排序量多、速度慢的特點，提出適合鄰域圖像并行處理機的分塊存儲方法。在流水線結構下，1個時鐘周期可以并行處理32個3×3鄰域的中值濾波運算，實現了高速、實時的1 920×1 080灰度圖像中值濾波器。
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FPGA 中值濾波 硬件實現
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