- 基于FPGA的神經網絡實現方法已成為實際實時應用神經網絡的一種途徑。本文就十多年來基于FPGA的ANN實現作一個系統的總結，例舉關鍵的技術問題，給出詳細的數據分析，引用相關的最新研究成果，對不同的實現方法和思想進行討論分析，并說明存在的問題以及改善方法，強調神經網絡FPGA實現的發展方向和潛力及提出自己的想法。另外，還指出基于FPGA實現神經網絡存在的瓶頸制約，最后對今后的研究趨勢作出估計。
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FPGA 人工神經網絡 實現方法
- LPC2214的IAP實現方案,引 言
IAP即在應用中編程，對于嵌入式產品，指在不影響產品正常運行的情況下實現應用程序的更新。許多ARM芯片都提供該操作接口，相對于ISP(在系統編程)方式，具有方便靈活且不需要借助專用boot裝載程序或工具的
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方案 實現 IAP LPC2214 ARM
- 嵌入式應用MCU業務被證明是半導體產品市場上一項賺錢的業務。根據市場調研公司iSuppli的統計,僅僅在中國,目前嵌入式應用MCU市場每年都有20億美元左右的規模。因此,在半導體業務增速放緩,經濟大環境并不樂觀的情況下,大多數擁有MCU業務的公司都在加強該項業務。而在此過程中,MCU廠商的策略各有不同。
CortexM3拓展消費和工業市場或將形成三足鼎立局面
毫無疑問,基于ARMCortex-M3的MCU產品目前在嵌入式MCU市場掀起了一股熱潮。多家MCU企業已經推出或計劃推出基于該核心的
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ARM Cortex MCU
- 為實現目標識別與跟蹤的應用目的，在基于TMS320DM642的FIFO基礎上擴展存儲空間，提出一種基于FPGA實現SDRAM控制器的方法。分析所用SDRAM的特點和工作原理，介紹FPGA中SDRAM控制器的組成和工作流程，給出應用中讀SDRAM的時序圖。FPGA采用模塊化設計，增強SDRAM控制器的通用性，更方便地滿足實際需求。
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FPGA FIFO
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神經網絡(Neural Networks)是人工神經網絡(Ar-tificial Neural Networks)的簡稱，是當前的研究熱點之一。人腦在接受視覺感官傳來的大量圖像信息后，能迅速做出反應，并能在腦海中重現這些圖像信息，這
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FPGA BP神經網絡 圖像壓縮 算法
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靶機是無人機家族中的一個重要分支，主要用于模擬作戰飛機、導彈等威脅目標，為防空武器系統試驗和訓練提供逼真的空中靶標。隨著技術的進步，現代反艦導彈多采取“超低空掠海”飛行的突防方式，與之相
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設計 實現 控制系統 飛行 無人 靶機 小型 ARM
- 基于ARM9的快速對星裝置設計與實現,0 引 言
大中型衛星站均具有相應的、完善的天線跟蹤伺服系統，天線伺服跟蹤系統依據信標信號強弱，決定天線轉向，驅動天線旋轉，達到準確對星。隨著通信技術和電子技術的發展，小型衛星站如車載站、便攜站受機
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設計 實現 裝置 快速 ARM9 基于 ARM
- 給出在ARM系列單片機S3C44B0x上移植嵌入式實時操作系統μC／OS-Ⅱ的一種方法，介紹了實時操作系統μC／OS-Ⅱ和S3C44B0x單片機的特點，討論μC／OS-Ⅱ在S3C44B0x上移植的可能性，并成功地將實時操作系統μC／OS-Ⅱ移植到S3C44BOx上。在移植過程中所做的主要工作就是對μC／OS-Ⅱ源代碼中的三個主要文件進行重新配置和修改。在S3C44B0x開發板上成功實現該移植過程，通過測試驗證了移植代碼的正確性。
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S3C44B0x 移植 單片機 系列 ARM OS-
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航天工程領域中，星地通訊等遠距離遙測遙控是嵌入式衛星數管計算機重要功能之一，利用三線制同步串行遙測遙控通道對指令和數據進行收發操作是通信鏈路的重要環節。
目前許多處理器芯片都已集成了
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接口 設計 控制器 通信 同步 串行 三線 PLD CPLD FPGA
- 設計基于AD7543和FPGA的數／模轉換電路，介紹AD7543的主要特點、封裝形式、引腳功能和工作原理，設計基于AD7543轉換芯片的具體的數／模轉換硬件電路，利用Verilog HDL語言描述AD7543的控制時序，并給出具體的Veril-og HDL代碼及其仿真結果。實踐結果表明，該設計可行，可取代傳統的“CPU+專用的數／模轉換(D／A)芯片”設計結構，可進一步提高系統的可靠性和抗干擾能力。
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7543 FPGA AD 模
- 在進行圖像采集過程中，重點需要解決采集系統的實時性問題。而這里選用的多線陣CCD拼接圖像的采集方法勢必導致在低級算法階段會產生極大的數據流，應用一個高速的嵌入式處理模塊則能很好地完成圖像處理的低級算法部分。在此分析了玻璃缺陷采集處理系統的工作過程，對系統內存控制做了詳細的描述，并在FPGA內實現了圖像的低級處理，從而使計算機從低級處理的大量數據中解脫出來。
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FPGA 玻璃 缺陷 處理系統
- 為設計一個項目可用的FIR數字帶通濾波器，采用Matlab／Simulink軟件中DSPBulider強大的算法模塊設計工具，結合Altera公司的FPGA開發板實現FIR數字帶通濾波器的系統集成、RTL級仿真、綜合編譯、下載等設計流程，并對正弦信號進行濾波，結果下載到開發板上用示波器觀測，達到了預期的濾波效果和目的。基于DSPBuilder完成系統建模，省去了復雜的VHDL編程，還可針對具體模塊進行參數設置從而適應不同的濾波需求。該方法實現簡單、可靠，還可類推實現其他復雜的嵌入式系統設計。
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FPGA FIR 帶通濾波器
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根升余弦成形濾波器是數字信號處理中的重要部件，它能對數字信號進行成形濾波，壓縮旁瓣，減少干擾的影響，從而降低誤碼率。根據文獻[1]，它的傳統FP-GA實現方式基于乘累加器(Multiplier Add Cell，M
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FPGA 多速率 濾波器
- 該設計利用FPGA的嵌入式軟核NiosⅡ處理器，通過嵌入式操作系統μC／OS-Ⅱ，實現了在FPGA內的自相關計算器；利用FPGA強大的并行運算功能和自帶存儲器實現的“乒乓”RAM，通過軟核NiosⅡ輸出控制字實時切換調用兩個“乒乓”RAM的存儲和讀取功能，使之同時完成對采集數據的緩沖存儲和向乘法器提供計算數據的功能，使芯片的整個數字處理鏈路連續化。另外，采用多比特進行自相關運算較之于現在天文臺使用的1 b量化自相關器，能有效地提高SNR退化比。
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FPGA 嵌入式 比特
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