采用90nm工藝制造的DDR3 SDRAM存儲器架構支持總線速率為600 Mbps-1.6 Gbps (300-800 MHz)的高帶寬，工作電壓低至1.5V，因此功耗小，存儲密度更可高達2Gbits。該架構無疑速度更快，容量更大，單位比特的功耗更低，但問
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SDRAM FPGA DDR3 存儲器
摘 要： 基于FPGA芯片Stratix II EP2S60F672C4設計了一個適用于寬帶數字接收機的帶寬可變的數字下變頻器（VB-DDC）。該VB-DDC結合傳統數字下變頻結構與多相濾波結構的優點，實現了對輸入中頻信號的高效高速處理，同
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FPGA 寬帶數字 接收機 帶寬
隨著通信協議的發展及多樣化，協議處理部分PE在硬件轉發實現方面，普遍采用現有的商用芯片NP(Network Processor，網絡處理器)來完成，流量管理部分需要根據系統的需要進行定制或采用商用芯片來完成。在很多情況下NP
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FPGA Core 定制
基于閃爍存儲器的DSP并行引導裝載方法,TMS3.0VC5409 是TI公司推出的第一代的高性能、低價位、低功耗數字信號處理器（DSP）。與現在流行的TMS320C5409相比，性能提高了60%，功耗效率提高了 50%。它的應用對象大多是要求能脫機運行的內嵌式系統，如機頂盒（
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DSP在交流異步電動機變頻調速中的應用, 目前交流調速電氣傳動已經成為電氣調速傳動的主流。隨著現代交流電機調速控制理論的發展和電力電子裝置功能的完善，特別是微型計算機及大規模集成電路的發展，交流電機調速取得了突破性的進展。 恒壓頻比(U／F=常
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應用 變頻調速 異步電動機 交流 DSP
基于ARM的可定制MCU可承擔FPGA的工作,如今的產品生命周期可能短至六個月，因此在這種情況下要想取得定制ASIC的低成本、低功耗和高性能優勢幾乎是不可能的。定制ASIC的設計周期通常要一年左右，這通常要比終端產品的生命周期還要長。另外，標準單元ASIC還
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ARM MCU FPGA
過去，對大音頻信號采用限幅方式，即對大信號進行限幅輸出，小信號不予處理。這樣，仍然存在音頻信號過小時，用戶自行調節音量，也會影響用戶的收聽效果。隨著電子技術，計算機技術和通信技術的迅猛發展，數字信號處
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DSP 設計 方案 算法 AGC 信號 采集 音頻
DDS(DirectDigitalFreqiaencySynthesizers)廣泛應用于雷達系統、數字通信、電子對抗、電子測量等民...
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DDFS DDWS FPGA
隨著SoC設計復雜度的提高，驗證所需時間已經占到整個設計周期的70%以上，如何減少驗證時間成為一個十分重要...
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GPS 基帶驗證系統 FPGA SoC
繼賽靈思今年年初發布了與ARM的合作計劃之后，Altera近日發布了與ARM、英特爾等的合作計劃，Actel則被模擬/混合信號公司Microsemi收購，這一系列事件都預示著在微控制器、模擬IC和FPGA領域正出現一些多層次的整合趨勢。針對這些整合趨勢，FPGA業內的另一些企業如Lattice、SiliconBlue、Acrhonix、Quicklogic和InPa未來會如何?
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ARM FPGA MCU
英特爾將與臺積電可程序邏輯門陣列(FPGA)客戶Achronix簽訂22納米晶圓代工合約，這是英特爾首度跨足晶圓代工市場，市場解讀英特爾此舉挑戰臺積電晶圓代工龍頭地位意圖已十分明顯。
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英特爾 晶圓代工 FPGA
MIMO技術、多載波技術與鏈路自適應技術是未來移動通信系統最值得關注的幾種物理層技術。MIMO技術在提高系統頻譜利用率方面性能卓越，多載波CDMA技術則能有效地對抗頻率選擇性衰落，將MIMO技術與MC-CDMA方案相結合，構成空域復用MC-CDMA系統，將在很大程度上提高系統的性能和容量,更有效地提高信息傳輸速率,完成基于FPGA的空域復用 MIMO MC一CDMA系統的基帶信號處理平臺的設計與實現的任務[1]。本文采用硬件仿真模型模擬MIMO信道的方法，實現了對系統的聯合調試與功能驗證，與軟件仿真結果進
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MC-CDMA FPGA 基帶系統
隨著計算機技術的迅速發展，電子信息技術越來越快地普及到各行各業的應用中去。傳統的物流信息采集工作方...
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RFID 無線通信 FPGA
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