- 電路的功能脈沖寬度調制的乘法運算器也叫作時間分割乘法電路，多作為低頻范圍的乘法電路使用。它與其他乘法電路在原理上存在根本性的差別。由于提高了PWM電路的性能，可作為穩定的高精度乘法器使用。本電路可以使用4
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PWM 電路 乘法運算電路
- 在用單片機制作的變送器類和控制器類的儀表中，需要輸出1―5V或4―20mA的直流信號的時候，通常采用專用的D/A芯片，一般是每路一片。當輸出信號的精度較高時，D/A芯片的位數也將隨之增加。 在工業儀表中，通常增
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12位 D/A 方法 PWM 高精度 利用 單片機 構成 基于
- 引言
信息處理機(圖1)用于完成導彈上多路遙測信息的采集、處理、組包發送。主要功能包括高速1553B總線的數據收發、RS422接口設備的數據加載與檢測、多路數據融合和數據接收、處理、組包發送的功能。其中，總線數據和其他RS422接口送來的數據同時進行并行處理;各路輸入信息按預定格式進行融合與輸出;數據輸出速率以高速同步RS422口的幀同步脈沖為源，如果高速同步RS422口異常不影響總線數據和其它RS422口的數據融合與輸出功能。在CPU發生異常或總線數據異常時不影響其它RS422口數據的融合與輸
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軍事電子 FPGA
- 以智能型混合信號FPGA開發真正符合需求的系統,要實現能夠將所有重要功能集成在單一器件的設計理由很簡單，因為這樣就能將材料成本、部件庫存及電路板面積減至最低。另外，相較于多芯片解決方案，單芯片方案的功耗也較低，同時也有助于提高對知識產權的保護。如果
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符合 需求 系統 真正 開發 混合 信號 FPGA 智能型
- 全球可編程平臺領導廠商賽靈思公司(Xilinx, Inc. (NASDAQ:XLNX) )日前宣布NEC子公司NEC Display Solutions有限公司的三款DLP 數字影院投影儀產品， 均采用了賽靈思Virtex®-5 FPGA系列產品。
DLP 數字影院投影儀符合美國數字影院計劃 (DCI1) 標準，擁有一系列優異的高安全特性，能夠滿足各種不同輸入信號的要求。該系統能忠實再現輸入源，而且集成的德州儀器 (TI) 高分辨率 2K(2,048 × 1,080 點)DL
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Xilinx Virtex FPGA DLP
- 在人手一支照相手機、數碼相機或者DV的年代，每個人都可以都在隨時隨地捕捉和制作畫面。在HDTV日漸盛行的年代，我們希望自己看到的每一幅畫面都絢麗多姿。不過，并非每個人都是攝影大師，我們許多人弄出來的畫面并不那么漂亮。過去，攝影大師都要借助于暗房技術來制作出精美的照片。如今，高水平的攝影愛好者都懂得使用Photoshop這類軟件來美化照片。現在的問題是，如果要對HDTV電視畫面進行美化，有多少Photoshop大師也不夠用啊!
有一位大師，他不僅懂得怎樣讓一幅畫面變得更美，而且發明了一種可以植入芯
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DarbeeVision FPGA IP GPU
- 引言
在智能車競賽中，速度控制不能采用單純的PID，而要采用能夠在全加速、緊急制動和閉環控制等多種模式中平穩切換的“多模式”速度控制算法，才能根據不同的道路狀況迅速準確地改變車速，實現穩定過彎。
系統硬件設計
按照競賽要求，本文設計的智能車速度控制系統，以飛思卡爾MC9S12DG128 單片機為核心，與車速檢測模塊、直流電機驅動模塊、電源模塊等一起構成了智能車速度閉環控制系統。單片機根據賽道信息采用合理的控制算法實現對車速的控制，車速檢測采用安裝于車模后軸上的
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智能車 速度控制 PWM
- 日前，德州儀器 (TI) 宣布推出專用于 DK-LM3S9B96 開發套件的新型 Stellaris FPGA 擴展板，可顯著加速開發低成本安全接入控制系統及其它需要高速外部處理單元接口的應用。這款全新電路板使開發人員能夠輕松評估 Stellaris 微處理器 (MCU) 高靈活性外設接口 (EPI) 的高帶寬機器對機器 (M2M) 并行接口功能。EPI 的 M2M 模式可支持高達 32 位的數據寬度以及高達每秒 150 MB 的數據速率，專用于幫助低成本安全接入控制應用的開發人員將攝像系統或低分辨率
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TI FPGA 開發套件
- 自適應濾波器的研究是近年來研究的熱門方向，在PFGA中實現高速的自適應濾波器的設計更是一個熱點，在此采用DSP Builder系統建模的方法，在FPGA中實現了歸一化LMS算法，實驗結果表明：用DSPBuilder設計的8階DNLMS算法比用底層的VHDL代碼設計效率更高，靈活性更大，速度更快。同樣比通用的DSP芯片設計的8階NLMS濾波器處理速度快了20多倍。如果將8階NLMS濾波器擴展到512階或者1 024階，可以很好地應用于自適應回聲消除等很多自適應濾波的領域。
- 關鍵字：
實現 FPGA 濾波器 DNLMS
- 半導體工藝技術進入深亞微米時代后，基于總線系統芯片SoC(SvstemonChip)的體系結構在物理設計、通信帶...
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FPGA NoC 驗證平臺
- 數字電壓表是大學物理教學和實驗中的重要儀表，其數字化是指將連續的模擬電壓量轉換成不連續、離散的數字...
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FPGA 數字電壓表 A/D
- 基于開源思想與SOPC技術，采用32位開源軟核處理器OR1200和開源軟核DDS，在FPGA上實現了頻率、相位可預置并且可調的3路正弦波信號發生器專用芯片的設計。該專用芯片基于OR1200固化專用程序實現，通過UART傳輸控制數據，可同時控制3路正弦波的產生，其頻率范圍為1 Hz~100 MHz，步進頻率為1 Hz，相位范圍為0°~359°。設計方案在DE2-70開發板上進行了實際驗證，證明了設計的正確性和可行性。
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FPGA 多路 正弦波信號 發生器
- AES算法中S-box和列混合單元的優化及FPGA技術實現,1 S-box的優化設計
在AES標準算法中定義了兩個較大的列表。S-box和逆S-box。將S-box用于兩個應用：字節替代和密鑰擴展。而逆S-box則用于逆字節替代。這兩個列表是不相同的，因此必須建立兩個不同的ROM(256×8 b)，
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FPGA 技術 實現 優化 單元 算法 S-box 混合 AES
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