當今的系統設計人員受益于芯片系統（SoC）設計人員在芯片級功耗管理上的巨大投入。但是對于實際能耗非常小的系 ...
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壓箱絕技 SoC設計 功耗管理
在加速復雜IC開發更容易的當下，益華電腦(Cadence Design Systems, Inc.)發表 Tempus 時序 Signoff解決方案(Timing Signoff Solution)，這是嶄新的靜態時序分析與收斂工具，精心設計讓系統晶片(System-on-Chip，SoC)開發人員能夠加速時序收斂，讓晶片設計更快速地投入制造流程。Tempus 時序Signoff解決方案意謂全新的時序signoff工具作法，讓客戶能夠縮短時序signoff收斂與分析，實現更快速的試產，同時創造良率更高
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Cadence SoC設計
摩爾定律確實是變慢了。依照摩爾定律，全球半導體的工藝制程技術平均每2年進入一個新世代。但是從工藝微縮角度講，所有業界人士有一個共識，即半導體遲早會遇到技術上無法克服的物理極限，無論是10nm、7nm，還是5nm，極限必然存在。傳統的光學光刻技術還在向細微化延伸，目前利用193nm浸液式，加上兩次圖形曝光技術已經可以實現20nm工藝技術的量產。但業界一致認為下一代14nm可能是個坎兒，要么采用更復雜的三次圖形曝光技術，但是那會大幅增加曝光次數和制造成本;或者采用具有革命性的14nmEUV光刻技術，但工藝
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摩爾定律 SoC設計
嵌入式存儲技術的發展已經使得大容量DRAM和SRAM在目前的系統級芯片(SOC)中非常普遍。大容量存儲器和小容量 ...
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嵌入式 存儲技術 SoC設計
摘要：現代大批量SoC產品設計要求重點關注可測性設計(DFT)和可制造性設計(DFM)問題。本文試圖通過具體的案例...
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SoC設計 測試要素
為數字消費、家庭網絡、無線、通信和商業應用提供業界標準處理器架構與內核的領導廠商 MIPS 科技公司(MIPS Technologies, Inc)今天宣布臺灣的揚智科技(ALi Corporation)已加入 MIPS 科技為推動 Android™ 平臺在 MIPSTM 架構上運行所啟動的早期使用計劃(Early Access Program)。通過早期使用計劃，MIPS 科技關鍵的戰略性客戶與合作伙伴可在程序代碼正式開放前，就先取得特定的 Android on MIPS 硬件和代碼優化
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MIPS Android SoC設計
ARM宣布東芝公司（Toshiba Corporation）與博通公司（Broadcom Corporation）授權獲得了ARM®; PrimeCell®; 產品，用于高性能片上系統（SoC）設計。 通過簽訂有關ARM® PrimeCell® 產品的綜合授權協議，東芝將在AMBA Designer環境下通過圖形用戶接口加快開發可直接部署的基礎設施解決方案。博通授權獲得了ARM®
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ARM IP PrimeCell SoC設計 博通 單片機 東芝授權 嵌入式系統 SoC ASIC
Tensilica發布預先定制的四款用于SoC設計的Diamond Standard VDO(ViDeO)處理器引擎，可以支持多標準多分辨率視頻模塊。面向移動手機和個人媒體播放器（PMPs）應用，這些視頻子系統的設計是完全可編程,可以支持所有流行的VGA和SD（也稱D1）視頻編解碼算法。包括H.264 Main Profile、VC-1 Main Profile, MPEG-4 Advanced Si
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SoC設計 Tensilica 視頻處理引擎 消費電子 SoC ASIC 消費電子
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