- FPGA其在眾多器件中能夠被工程師青睞的一個很重要的原因就是其強悍的處理能力。那如何能夠做到高速的數據處理，數據的并行處理則是其中一個很重要的方式。
數據的并行處理，從結構上非常簡單，但是設計上卻是相當復雜，對于現有的FPGA來說，雖然各種FPGA的容量都在增加，但是在有限的邏輯中達到更高的處理能力則是FPGA工程師面臨的挑戰。常用并行計算結構如下圖所示：
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上圖中：前端處理單元負責將進入數據信息，分配到多個計算單元中，圖中為3個計算單元(幾個根據所需的性能計算得
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FPGA 架構設計 并行
- 由于世界各國政府鼓勵消費者購買更安全的車輛，因此汽車制造商都在為開發能不斷獲得更高新車評估測試(NCAP)評級的車輛而全力以赴。日前，德州儀器(TI)宣布推出汽車片上系統(SoC)系列的最新產品 —— TDA3x解決方案。TDA3x處理器系列致力于幫助汽車制造商開發出符合或優于NCAP規定的尖端高級駕駛員輔助系統(ADAS)應用，此類應用可減少交通事故，并能使初、中級汽車實現更自主的駕駛體驗。TDA3x和其它TDA器件基于相同的架構開發，相較于TDA2x，其在前置攝像頭、全車環
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德州儀器 SoC ADAS
- 接口確定以后，FPGA內部如何規劃?首先需要考慮就是時鐘和復位。
時鐘：根據時鐘的分類，可以分為邏輯時鐘，接口時鐘，存儲器時鐘等;
(1)邏輯時鐘取決與邏輯的關鍵路徑，最終值是設計和優化的結果，從經驗而不是實際出發：低端FPGA(cyclone spantan)工作頻率在40-80Mhz之間，而高端器件(stratix virtex)可達100-200Mhz之間，根據各系列的先后性能會有所提升，但不是革命性的。
(2)接口時鐘，異步信號的時序一般也是通過FPGA片內同步邏輯產生，一般
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FPGA 架構設計 復位
- 敏捷開發宣言中，有一條定律是“可以工作的軟件勝過面面俱到的文檔”。如何定義可可以工作的，這就是需求確定后架構設計的首要問題。而大部分看這句話的同志更喜歡后半句，用于作為不寫文檔的借口。
FPGA的架構設計最首先可以確定就是外接接口，就像以前說的，穩定可靠的接口是成功的一半。接口的選擇需要考慮幾個問題。
1， 有無外部成熟IP。一般來說，ALTERA和XILINX都提供大量的接口IP，采用這些IP能夠提升研發進度，但不同IP在不同FPGA上需要不同license，這個
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FPGA ALTERA XILINX
- 勿用諱言，現在國內FPGA開發還處于小作坊的開發階段，一般都是三、四個人，七八臺機器.小作坊如何也能做出大成果。這是每個FPGA工程師都要面臨的問題。架構設計是面臨的第一關。經常有這樣的項目，需求分析，架構設計匆匆忙忙，號稱一兩個月開發完畢，實際上維護項目就花了一年半時間。主要包括幾個問題，一，性能不滿足需求。二，設計頻繁變更。三，系統不穩定，調試問題不收斂。
磨刀不誤砍柴工，FPGA設計的需求分析是整個設計第一步。如何將系統的功能需求，轉換成FPGA的設計需求，是FPGA架構設計的首要問題。首
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FPGA 架構設計 SOPC
- 1 引言
直接數字頻率合成(DDS)是近幾年一種新型的頻率合成法，其具有頻率切換速度快，頻率分辨率高，以及便于集成等優點。在此，設計了基于DDS的頻譜分析儀，該頻譜分析儀依據外差原理，被測信號與本征頻率混頻，實現信號的頻譜分析。
2 系統設計
圖1給出系統設計框圖，主要由本機振蕩電路、混頻電路、放大檢波電路、頻譜輸出顯示電路等組成。通過單片機和現場可編程門陣列(FPGA)共同控制AD985l，以產生正弦掃頻輸出信號，然后經濾波、程控放大得到穩定輸出，與經放大處理的被測信號混頻，再經放
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DDS FPGA AD985l
- 1 引言
目前，由于頻譜分析儀價格昂貴，高等院校只是少數實驗室配有頻譜儀。但電子信息類教學，如果沒有頻譜儀輔助觀察，學生只能從書本中抽象理解信號特征，嚴重影響教學實驗效果。
針對這種現狀提出一種基于FPGA的簡易頻譜分析儀設計方案，其優點是成本低，性能指標滿足教學實驗所要求的檢測信號范圍。
2 設計方案
圖1為系統設計總體框圖。該系統采用C8051系列單片機中的 C8051F121作為控制器，CvcloneⅢ系列EP3C40F484C8型FPGA為數字信號算法處理單元。系統設計
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FPGA 頻譜分析儀 AD603
- 頻譜分析儀是微電子測量領域中最基礎、最重要的測量儀器之一，是從事各種電子產品研發、生產、檢驗的重要工具。高分辨率、寬頻帶數字頻譜分析的方法和實現一直是該領域的研究熱點[1]。現代頻譜分析儀是基于現代數字信號處理理論的頻譜分析儀，信號經過前置預處理、抗混疊濾波、A/D變換、數字頻譜分析等環節而得到信號中的頻率分量， 達到與傳統頻譜分析儀同樣的結果。
本設計完全利用FPGA實現FFT，在FPGA上實現整個系統構建。其中CPU選用Altera公司的Nios II軟核處理器進行開發, 硬件平臺關鍵模塊使
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NIOS II 頻譜分析儀 FPGA
- Imagination Technologies 將于 2014 年 11 月 12 日(深圳)、11 月 14 日(上海)舉辦 Imagination 高峰論壇，針對網絡通信、視頻、圖形、顯示、數字信號處理(DSP)、嵌入式系統、系統級芯片(SoC)等尖端技術，邀請合作伙伴和各界專家就技術應用市場的發展發表專題演講。此高峰論壇為免費活動，歡迎 SoC 硬件或軟件設計和管理人員以及感興趣人士在線報名。
Imagination 將在高峰論壇發表最新 64 位處理器，推出設計最新穎的解決方案，展示
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Imagination DSP SoC
- 由于脈寬調制技術是通過調整輸出脈沖的頻率及占空比來實現輸出電壓的變壓變頻效果，所以在電機調速、逆變器等眾多領域得到了日益廣泛的應用。
而電磁法作為一種地球物理探測的有效方法，已經廣泛地應用于礦藏勘探、地質災害預測等領域。電磁法儀一般包括發射機和接收機兩大部分。現階段，電磁法儀器的發射機部分一般直接采用等寬PWM技術，其電流諧波畸變率較大，電壓利用率不高，效率很低。
本文利用FPGA技術，根據SPWM自然采樣法原理，設計了應用于電磁法儀的發射機的SPWM系統。該系統應用到現有的電磁法儀器中，
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FPGA SPWM Matlab
- 隨著電力電子開關器件及技術的不斷發展，SPWM(正弦波脈寬調制)技術在逆變控制領域得到廣泛應用。傳統的SPWM驅動芯片速度慢、不夠靈活，存在著電路設計復雜、體積大、抗干擾能力差、設計周期長等缺點，對于許多有特殊要求的場合，由專用芯片很難滿足實際的要求，因此，本文采用Altera公司的EP2C35F672C8N開發一種基于可編程片上系統的SPWM脈沖波形電路，SOPC技術將微處理器和SP-WM波形電路整合到一塊FPGA器件當中。可編程的片上系統SOPC(System 0n Programmable Ch
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SOPC SPWM FPGA
- 隨著信號處理技術及集成電路制造工藝的不斷發展，全數字化SPWM(正弦脈寬調制)算法在調速領域越來越受到青睞。實現SPWM控制算法的方法很多，其中模擬比較法因電路復雜、且不易與數字系統連接而很少采用;傳統的微處理器因不能滿足電機控制所要求的較高采樣頻率(≥1 kHz)而逐漸被高性能的DSP硬件系統所取代，但該系統成本高、設計復雜。與傳統方法相比，在現場可編程邏輯器件FPGA上產生一種新的SPWM控制算法，具有成本低、研發周期短、執行速度高、可擴展能力強等優點。該技術進一步推動了變頻調速技術的發展。
- 關鍵字：
Verilog HDL SPWM FPGA
- 聯發科已經提前發布了六核芯片，不過，只談核數是否有用？你的電源管理、多媒體引擎、基帶射頻，甚至DSP處理能力，做的怎樣？這篇文章可以告訴你手機SOC的諸多秘密。
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手機 SOC CPU 射頻前端
- 橫跨多重電子應用領域、全球領先的半導體供應商、世界領先的機頂盒芯片制造商意法半導體(STMicroelectronics，簡稱ST)推出四款新的低功耗系統芯片(SoC, System-on-Chips)，為具有UHDp60功能的4K機頂盒大規模應用奠定了基礎。第二代4K機頂盒將擁有纖薄、時尚的外觀，實現更豐富且臨場感更優越的Ultra-HD用戶體驗，呈現快速、清晰的體育動作，具有更高的色彩保真度和媒體內容分辨率。新產品將于2014年10月21-23日在杭州梅苑賓館舉行的意法半導體ICTC(國際傳輸與覆
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意法半導體 SoC Cannes/Monaco
- 基于以太網的組網技術是工業市場中增長最快的技術之一。大多數工業以太網標準使用IEEE 802.3標準以太網協議，因此這些網絡能夠傳輸標準的網絡業務和實時數據。但每個標準都采用不同的技術來提供實時性能，一些采用定制硬件，一些利用定制軟件，還有的采用完全標準的以太網/TCP/IP實現。結果就出現了眾多不同等級性能、不同成本的互不兼容標準。
針對以太網協議非確定性通信時間的一個越來越普及的對策是在每個設備內實現一個本地時鐘。由于大多數設備都有微處理器及(相對)高速度的時鐘，因此這種方法比較容易實現。若
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FPGA 以太網 ASSP
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