基于FPGA的擴頻測距快速捕獲仿真研究
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2 主要模塊仿真結果
2．1 PH碼產生模塊
本設計選取的PN碼為63位，本征多項式為x6+x+1。該PN碼產生器由VHDL語言編寫，其仿真結果如圖2所示。本文引用地址：http://cqxgywz.com/article/191337.htm
2．2 FFT轉換模塊
該模塊是本設計的核心模塊，由輸入緩沖器、FFT運算器、控制器構成，完成對數據的FFT變換。將PN碼發生器產生的數據存入輸入緩沖器中，在控制器的控制下，FFT運算模塊從輸入緩沖器中讀取出數據值進行FFT變換，然后得出輸出數據。圖3所示為FFT模塊的輸入輸出關系。fft_imag_out，fft_real_out分別為輸出數據的實部、虛部和修正因子，m_soutoe_sop為輸出數據的起始位。
2．3 計算模塊
設兩路信號進行FFT后的數據為
可見對進行FFT變換后需要進行的運算處理其實質是一個乘加，一個乘減和一個加法運算，其中乘加運算仿真結果如圖4、圖5所示。
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