基于多相濾波的數字接收機的FPGA實現 作者： 時間：2011-02-17 來源：網絡 加入技術交流群 掃碼加入和技術大咖面對面交流海量資料庫查詢 收藏 <a target='_blank'><img src='https://ad.eepw.com.cn/www/delivery/avw.php?zoneid=88&cb=INSERT_RANDOM_NUMBER_HERE&n=a635e61e' border='0' alt='' /></a> <a target='_blank'><img src='https://ad.eepw.com.cn/www/delivery/avw.php?zoneid=87&cb=INSERT_RANDOM_NUMBER_HERE&n=a576c0a2' border='0' alt='' /></a> 這樣得到實信號數字信道化的多相濾波實現模型如圖4所示。1．3 算法仿真 仿真時，設信號的采樣頻率為2 GHz，信道帶寬為62．5 MHz，共16個信道，輸入信噪比為0dB。輸入信號樣本為1 920點(每個信道120點)，信號的起始點為112 ns，脈沖寬度為600 ns。在62．5～937．5 MHz間對起始點、脈寬和頻率進行測量，頻率步長為250 kHz，參數的均方根誤差如圖5～圖7所示。 上一頁 1 2 3 下一頁
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