- 簡介:硬件輔助驗證的歷史根源半導體創新的不懈步伐繼續遵循一個不可阻擋的趨勢:給定硅面積內晶體管密度呈指數級增長。豐富的可用半導體織物激發了設計團隊的創造力,實現了指數級先進的片上系統 (SoC)。然而,賦予新可能性的規模也給設計驗證帶來了嚴峻的挑戰。隨著芯片變得越來越大、越來越復雜,驗證它們所需的測試環境在范圍和復雜性上都成比例地擴大。這些測試工作負載需要更長的執行時間才能實現有意義的覆蓋范圍。不斷膨脹的設計規模和更重的測試工作負載相結合,將傳統的硬件描述語言 (HDL) 仿真環境推向了極限。在許多情況下
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在線仿真 新思科技 Synopsys
- 關鍵Synopsys 速度適配器通過在仿真過程中允許真實硬件交互來顯著增強系統驗證,這有助于發現虛擬環境可能遺漏的關鍵設計缺陷。高保真在線仿真 (ICE) 平臺可以暴露與低級系統行為相關的錯誤,這些錯誤在虛擬平臺中逃脫檢測,正如在硅前識別錯誤的案例所證明的那樣。采用新思科技速度適配器可以實現準確的物理層表示,從而實現高效的硅前測試,并將編程和訓練 PHY 所需的時間從數月縮短到數周。最近,我有機會與新思科技在速度適配器和在線仿真 (ICE) 方面的杰出專家進行了交談。許多了解我專業背景的人都認為我是基于交
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