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vhdl 文章 最新資訊

高云半導體自主研發的邏輯綜合工具Gowin Synthesis支持VHDL硬件描述語言

  • 全球增長最快的可編程邏輯公司-廣東高云半導體科技股份有限公司（以下簡稱“高云半導體”）近日宣布，高云半導體自主研發的邏輯綜合工具Gowin Synthesis支持VHDL（Very-High-Speed Integrated Circuit Hardware Description Language）硬件描述語言流程綜合。VHDL語言誕生于1982年，最初是由美國國防部開發出來供美軍用來提高設計可靠性和縮減開發周期的一種使用范圍較小的設計語言。1987年，VHDL被IEEE確認為標準硬件描述語言。VHDL
  • 關鍵字： 半導體  VHDL  

一文看懂VHDL和Verilog有何不同

  • 　　當前最流行的硬件設計語言有兩種，即 VHDL 與 Verilog HDL，兩者各有優劣，也各有相當多的擁護者。VHDL 語言由美國軍方所推出，最早通過國際電機工程師學會(IEEE)的標準，在北美及歐洲應用非常普遍。而 Verilog HDL 語言則由 Gateway 公司提出，這家公司輾轉被Cadence所購并，并得到Synopsys的支持。在得到這兩大 EDA 公司的支持后，也隨后通過了 IEEE 標準，在美國、日本及中國臺灣地區使用非常普遍?！　∥覀儼堰@兩種語言具體比較下：　　1.整體結構　　點評
  • 關鍵字： VHDL  Verilog  

VHDL語言實現的幀同步算法

  • 數字通信網中，幀同步是同步復接設備中最重要的部分，他包括幀同步碼的產生和幀同步碼的識別，其中接收端的幀同步識別電路的結構對同步性能的影響是主
  • 關鍵字： VHDL  幀同步  算法  

基于CPLD的測試系統接口設計

  • 介紹了一種用CPLD(復雜可編程邏輯器件)作為核心控制電路的測試系統接口，通過時cPLD和竹L電路的比較及cPLD在系統中實現的強大功能，論述了CPLD在測試系
  • 關鍵字： EDA  CPLD  測試系統接口  VHDL  

基于VHDL邏輯電路設計與應用

  • 隨著集成電路技術的高速發展，VHDL已成為設計數字硬件時常用的一種重要手段。介紹EDA技術及VHDL語言特點，以串行加法器為例，分析串行加法器的工作原理
  • 關鍵字： EDA  VHDL  串行加法器  

基于FPGA的Petri網的硬件實現

  • Petri網是異步并發現象建模的重要工具，Petri網的硬件實現將為并行控制器的設計提供一種有效的途徑.本文在通用的EDA軟件Max+PlusII中，研究了基本Petr
  • 關鍵字： EDA技術  FPGA  VHDL  Petri網  

基于FPGA的數字密碼鎖

  • 基于FPGA的數字密碼鎖-本文介紹了一種以FPGA 為基礎的數字密碼鎖。采用自頂向下的數字系統設計方法， 將數字密碼鎖系統分解為若干子系統， 并且進一步細劃為若干模塊， 然后用硬件描述語言VHDL 來設計這些模塊， 同時進行硬件測試。
  • 關鍵字： VHDL  FPGA  液晶顯示驅動  QuartusII  

引入EDA技術進行數字電路設計的方案

  • 本文介紹了EDA技術主要特點和功能，并對將EDA技術引入到數字電路設計工作方案進行了探討。
  • 關鍵字： EDA技術  PCB  SOC芯片  VHDL  

基于VHDL語言為核心的EDA技術在醫學中的應用

  • VHDL超高速集成電路硬件描述語言是隨著集成電路系統化和高度集成化逐步發展起來的，是一種用于數字系統設計、測試，面向多領域、多層次的IEEE標準硬件描述語言。
  • 關鍵字： VHDL  Max+PlusⅡ  EDA  

EDA中的車載DVD位控主要VHDL源程序

FPGA系列相關圖書介紹

基于FPGA的數字式心率計的設計實現

  • 心率計是常用的醫學檢查設備，實時準確的心率測量在病人監控、臨床治療及體育競賽等方面都有著廣泛的應用。心率測量包括瞬時心率測量和平均心率測量。瞬時心率不僅能夠反映心率的快慢。同時能反映心率是否勻齊；平均心率雖只能反映心率的快慢，但記錄方便，因此這兩個參數在測量時都是必要的。
  • 關鍵字： VHDL  數字式  FPGA  心率計  設計  

VHDL結構體的行為描述法

  • 所謂結構體的行為描述（behavioral descriptions），即對設計實體按算法的路徑來描述。行為描述在EDA工程中稱為高層次描述或高級描述，
  • 關鍵字： VHDL  結構體  行為描述法  

異步FIFO的VHDL設計

  • 本文給出了一個利用格雷碼對地址編碼的羿步FIFO的實現方法，并給出了VHDL程序，以解決異步讀寫時鐘引起的問題。
  • 關鍵字： 異步  FIFO  VHDL  設計  

VHDL結構體的結構化描述法

  • 在結構體中，設計任務的程序包內定義了一個8輸入與門（and8）和一個二異或非門（xnor2）。把該程序包編譯到庫中，可通過USE從句來調用這些元件，并從work庫中的gatespkg程序包里獲取標準化元件。
  • 關鍵字： VHDL  結構體  結構化  描述法  
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