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arm+fpga
arm+fpga 文章 最新資訊
利用FPGA和分解器數(shù)字轉(zhuǎn)換器簡(jiǎn)化角度測(cè)量
- 1 編碼器和分解器的類型 編碼器分為增量和絕對(duì)兩個(gè)基本類別。增量編碼器可以監(jiān)控輪軸上的兩個(gè)位置,可以在輪軸每次經(jīng)過這兩個(gè)位置時(shí)產(chǎn)生A或B脈沖。獨(dú)立的外部電動(dòng)計(jì)數(shù)器然后從這些脈沖解讀出轉(zhuǎn)速和旋轉(zhuǎn)方向。雖然適用于眾多應(yīng)用,但是增量式計(jì)數(shù)器確實(shí)存在某些不足。例如,在輪軸停轉(zhuǎn)情況下,增量編碼器在開始運(yùn)行之前必須首先通過調(diào)回到某個(gè)指定校準(zhǔn)點(diǎn)來實(shí)現(xiàn)自身校準(zhǔn)。另外,增量式計(jì)數(shù)器易受到電氣干擾的影響,導(dǎo)致發(fā)送到系統(tǒng)的脈沖不準(zhǔn)確,進(jìn)而造成旋轉(zhuǎn)計(jì)數(shù)錯(cuò)誤。不僅如此,許多增量編碼器屬于光電器件,如果對(duì)目標(biāo)應(yīng)用有影響,則
- 關(guān)鍵字: 編碼器 分解器 RDC FPGA 脈沖
移動(dòng)芯片亂局交叉混戰(zhàn),誰(shuí)看得清?
- 2015年芯片大戰(zhàn)已經(jīng)開始,聯(lián)發(fā)科Helio=逆襲高端?三星Exynos 7420=跑分破表?高通驍龍820=810補(bǔ)救?Intel Sofia計(jì)劃落實(shí),智能手機(jī)芯片改名X3進(jìn)軍低端?中端市場(chǎng)仍是主戰(zhàn)場(chǎng),為爭(zhēng)奪份額芯片廠商們可謂是八仙過海,各顯神通。
- 關(guān)鍵字: ARM 移動(dòng)芯片
Tcl在Vivado中的應(yīng)用
- Xilinx的新一代設(shè)計(jì)套件 Vivado 相比上一代產(chǎn)品 ISE, 在運(yùn)行速度、算法優(yōu)化和功能整合等很多方面都有了顯著地改進(jìn)。 但是對(duì)初學(xué)者來說,新的約束語(yǔ)言 XDC 以及腳本語(yǔ)言 Tcl 的引入則成為了快速掌握 Vivado 使用技巧的最大障礙,以至于兩年多后的今天,仍有很多用戶缺乏升級(jí)到 Vivado 的信心。 本文介紹了 Tcl 在 Vivado 中的基礎(chǔ)應(yīng)用,希望起到拋磚引玉的作用,指引使用者在短時(shí)間內(nèi)快速掌握相關(guān)技巧,更好地發(fā)揮 Vivado 在 FPGA 設(shè)計(jì)中的優(yōu)勢(shì)。 1
- 關(guān)鍵字: Xilinx VivadoTcl FPGA cells
Altera: FPGA集成硬核浮點(diǎn)DSP
- 1 FPGA浮點(diǎn)運(yùn)算推陳出新 以往FPGA在進(jìn)行浮點(diǎn)運(yùn)算時(shí),為符合IEEE 754標(biāo)準(zhǔn),每次運(yùn)算都需要去歸一化和歸一化步驟,導(dǎo)致了極大的性能瓶頸。因?yàn)檫@些歸一化和去歸一化步驟一般通過FPGA中的大規(guī)模桶形移位寄存器實(shí)現(xiàn),需要大量的邏輯和布線資源。通常一個(gè)單精度浮點(diǎn)加法器需要500個(gè)查找表(LUT),單精度浮點(diǎn)要占用30%的LUT,指數(shù)和自然對(duì)數(shù)等更復(fù)雜的數(shù)學(xué)函數(shù)需要大約1000個(gè)LUT。因此隨著DSP算法越來越復(fù)雜,F(xiàn)PGA性能會(huì)明顯劣化,對(duì)占用80%~90%邏輯資源的FPGA會(huì)造成嚴(yán)重的布線擁
- 關(guān)鍵字: Altera FPGA LUT DSP 數(shù)據(jù)通路
三相SPWM波形發(fā)生器的設(shè)計(jì)與仿真
- 本文提出了一種采用VHDL硬件描述語(yǔ)言設(shè)計(jì)新型三相正弦脈寬調(diào)制(SPWM)波形發(fā)生器的方法。該方法以直接數(shù)字頻率合成技術(shù)(DDS)為核心產(chǎn)生三相SPWM信號(hào)。并且利用VHDL設(shè)計(jì)了死區(qū)時(shí)間可調(diào)的死區(qū)時(shí)間控制器,解決了傳統(tǒng)的模塊電路等待方法很難產(chǎn)生帶精確死區(qū)時(shí)間控制的SPWM信號(hào)的問題。該方法在Quartus II 9.1環(huán)境平臺(tái)下進(jìn)行了仿真驗(yàn)證,并將設(shè)計(jì)程序下載到DE2-70實(shí)驗(yàn)板進(jìn)行實(shí)驗(yàn)測(cè)試,用示波器測(cè)試得到了死區(qū)時(shí)間可控制的SPWM波形。
- 關(guān)鍵字: VHDL SPWM DDS 死區(qū)時(shí)間 FPGA 201505
聲納圖像動(dòng)態(tài)范圍擴(kuò)展與FPGA實(shí)現(xiàn)
- 本文針對(duì)成像聲納擴(kuò)展圖像動(dòng)態(tài)范圍和增強(qiáng)圖像細(xì)節(jié)的需求,提出了一種基于開方運(yùn)算的動(dòng)態(tài)范圍擴(kuò)展方法。基于課題組研制的多波束成像聲納原理樣機(jī)的研制,分析了數(shù)據(jù)動(dòng)態(tài)范圍壓縮導(dǎo)致圖像細(xì)節(jié)丟失的原因及其對(duì)成像質(zhì)量的影響,采用JPL快速平方根近似算法改善了開方運(yùn)算FPGA實(shí)現(xiàn)過程的資源占用和系統(tǒng)延時(shí)。最后,對(duì)改進(jìn)設(shè)計(jì)方案進(jìn)行了實(shí)驗(yàn)驗(yàn)證,通過多波束成像聲納系統(tǒng)的消聲水池實(shí)驗(yàn)證明了本文動(dòng)態(tài)范圍擴(kuò)展方法的有效性和可行性,系統(tǒng)成像質(zhì)量改善明顯,達(dá)到優(yōu)化設(shè)計(jì)的預(yù)期目標(biāo)。
- 關(guān)鍵字: 成像聲納 動(dòng)態(tài)范圍 平方根 FPGA 波束成像 201505
基于FPGA的LZO實(shí)時(shí)無(wú)損壓縮的硬件設(shè)計(jì)
- 本文通過對(duì)多種壓縮算法作進(jìn)一步研究對(duì)比后發(fā)現(xiàn),LZO壓縮算法是一種被稱為實(shí)時(shí)無(wú)損壓縮的算法,LZO壓縮算法在保證實(shí)時(shí)壓縮速率的優(yōu)點(diǎn)的同時(shí)提供適中的壓縮率。如圖1(A)給出了Linux操作系統(tǒng)下常見開源壓縮算法的壓縮速率的測(cè)試結(jié)果,LZO壓縮算法速率極快;如圖1(B)給出了Gzip壓縮算法和LZO壓縮算法的壓縮率測(cè)試結(jié)構(gòu),從圖中可以看出,LZO壓縮算法可以提供平均約50%的壓縮率。 1 LZO壓縮算法基本原理分析 1.1 LZO壓縮算法壓縮原理 LZO壓縮算法采用(重復(fù)長(zhǎng)度L,指回
- 關(guān)鍵字: LZO FPGA LZSS RAM 壓縮算法
使用FPGA實(shí)現(xiàn)靈活的USB Type-C接口控制
- 1 USB Type-C接口介紹 二十年前,第一代通用串行總線(Universal Serial Bus, USB 1.0)的出現(xiàn),為各自為政的電子行業(yè)通信標(biāo)準(zhǔn)注入了互通性。而最新發(fā)布的USB Type-C接口規(guī)范將USB技術(shù)提升到了一個(gè)新的高度,能夠滿足21世紀(jì)電子行業(yè)的需求,同時(shí)也將再一次改變計(jì)算機(jī)、消費(fèi)類電子產(chǎn)品以及移動(dòng)設(shè)備之間的互連方式。輕薄、堅(jiān)固、無(wú)需區(qū)分插頭方向的USB Type-C連接器拓展了由USB 3.1超速(SuperSpeed+)規(guī)范定義的各項(xiàng)功能,采用雙通道實(shí)現(xiàn)高達(dá)20
- 關(guān)鍵字: FPGA USB Type-C 充電器 嵌入式
最小化ARM Cortex-M CPU功耗的方法與技巧
- 1 理解Thumb-2 首先,讓我們從一個(gè)看起來并不明顯的起點(diǎn)開始討論節(jié)能技術(shù)—指令集。所有Cortex-M CPU都使用Thumb-2指令集,它融合了32位ARM指令集和16位Thumb指令集,并且為原始性能和整體代碼大小提供了靈活的解決方案。在Cortex-M內(nèi)核上一個(gè)典型的Thumb-2應(yīng)用程序與完全采用ARM指令完成的相同功能應(yīng)用程序相比,代碼大小減小到25%之內(nèi),而執(zhí)行效率達(dá)到90%(當(dāng)針對(duì)運(yùn)行時(shí)間進(jìn)行優(yōu)化后)。 Thumb-2中包含了許多功能強(qiáng)大的指令,能夠有效減少
- 關(guān)鍵字: ARM Cortex-M CPU 存儲(chǔ)器 MCU
用藍(lán)牙及ARM? Cortex?微控制器打造穿戴式產(chǎn)品
- 1 藍(lán)牙低功耗技術(shù) 低功耗無(wú)線連網(wǎng)功能,是穿戴式技術(shù)發(fā)展過程中一大要素。不論是活動(dòng)追蹤器等相對(duì)簡(jiǎn)單的單一傳感器穿戴式產(chǎn)品,或是內(nèi)建平視顯示器以顯示GPS/地圖與距離/速度數(shù)據(jù)的滑雪護(hù)目鏡等整合了眾多環(huán)境傳感器數(shù)據(jù)的高端產(chǎn)品,藍(lán)牙低功耗技術(shù)(Bluetooth LE,或依Bluetooch SIG命名為藍(lán)牙智能﹝Bluetooth Smart﹞)都是穿戴式科技眾多元素中的重要一環(huán)。 雖然還是有其他無(wú)線技術(shù)參與競(jìng)爭(zhēng),藍(lán)牙低功耗仍具備成為主流連網(wǎng)技術(shù)標(biāo)準(zhǔn)的條件。低功耗的特性,讓穿戴式產(chǎn)品只須小小
- 關(guān)鍵字: 藍(lán)牙 ARM 穿戴式產(chǎn)品 微控制器 物聯(lián)網(wǎng) Cortex
基于FPGA的高可靠全自動(dòng)加樣器
- 1 系統(tǒng)方案 智能加樣器系統(tǒng)以FPGA為控制核心,通過控制步進(jìn)電機(jī)的運(yùn)動(dòng),結(jié)合到位傳感器,控制整個(gè)設(shè)備機(jī)械平臺(tái)的正常運(yùn)轉(zhuǎn);通過處理液位傳感器信號(hào)和控制泵閥一體模塊,實(shí)現(xiàn)加樣功能;同時(shí),采用無(wú)線網(wǎng)絡(luò)與安卓手機(jī)通訊,將安卓手機(jī)作為無(wú)線控制終端和數(shù)據(jù)顯示平臺(tái)。系統(tǒng)的設(shè)計(jì)方案如圖1所示。 為了提高系統(tǒng)加樣速率與效率,設(shè)計(jì)了以試管架作為加樣單位的加樣方式。如圖2所示,系統(tǒng)由步進(jìn)電機(jī)帶動(dòng)機(jī)械推臂和行車,實(shí)現(xiàn)試管架在進(jìn)樣倉(cāng)、加樣區(qū)與出樣倉(cāng)之間的推動(dòng)轉(zhuǎn)移,并在加樣區(qū)實(shí)現(xiàn)對(duì)試管的依次加樣。這種新型的加樣
- 關(guān)鍵字: FPGA 傳感器 液位探測(cè) 注射器 單片機(jī)
基于ARM單片機(jī)的智能旋轉(zhuǎn)倒立擺系統(tǒng)設(shè)計(jì)
- 1 簡(jiǎn)易旋轉(zhuǎn)倒立擺及控制裝置及其功能要求 設(shè)計(jì)并制作一套簡(jiǎn)易旋轉(zhuǎn)倒立擺及其控制裝置。旋轉(zhuǎn)倒立擺的結(jié)構(gòu)如圖1所示。電動(dòng)機(jī)A固定在支架B上,通過轉(zhuǎn)軸F驅(qū)動(dòng)旋轉(zhuǎn)臂C旋轉(zhuǎn)。擺桿E通過轉(zhuǎn)軸D固定在旋轉(zhuǎn)臂C的一端,當(dāng)旋轉(zhuǎn)臂C在電動(dòng)機(jī)A驅(qū)動(dòng)下作往復(fù)旋轉(zhuǎn)運(yùn)動(dòng)時(shí),帶動(dòng)擺桿E在垂直于旋轉(zhuǎn)臂C的平面作自由旋轉(zhuǎn)。 1.2 基本要求 (1)擺桿從處于自然下垂?fàn)顟B(tài)(擺角0°)開始,驅(qū)動(dòng)電機(jī)帶動(dòng)旋轉(zhuǎn)臂作往復(fù)旋轉(zhuǎn)使擺桿擺動(dòng),并盡快使擺角達(dá)到或超過-60°~ +60°; (2)從擺桿
- 關(guān)鍵字: ARM 單片機(jī) PWM PID 旋轉(zhuǎn)臂
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