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asic-to-fpga 文章 最新資訊

將MicroTCA導(dǎo)入無線基帶設(shè)計

  • MicroTCA正在成為嵌入信號處理應(yīng)用，尤其是高性能的多處理器系統(tǒng)中日益普及的標準。這些標準采用了可滿足“運營商級”電信設(shè)備需求的先進中間卡（AdvancedMC），從而找到了進入電信應(yīng)用的途徑，如無線基帶處理。
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基于FPGA的高速定點FFT算法的設(shè)計方案

  • 基于FPGA的高速定點FFT算法的設(shè)計方案,引 言
    快速傅里葉變換(FFT)作為計算和分析工具，在眾多學(xué)科領(lǐng)域(如信號處理、圖像處理、生物信息學(xué)、計算物理、應(yīng)用數(shù)學(xué)等)有著廣泛的應(yīng)用。在高速數(shù)字信號處理領(lǐng)域，如雷達信號處理，F(xiàn)FT的處理速度往往是整個系
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基于FPGA的光電抗干擾電路設(shè)計方案

  • 基于FPGA的光電抗干擾電路設(shè)計方案,光電靶的基本原理是：當光幕內(nèi)的光通量發(fā)生足夠大的變化時，光電傳感器會響應(yīng)這種變化而產(chǎn)生電信號。這就是說，一些非彈丸物體在穿過光幕時也會使得光幕內(nèi)光通量發(fā)生變化以至光電傳感器產(chǎn)生電信號。從原理上，這種現(xiàn)
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基于FPGA和DDS的信號源研究與設(shè)計

  • 1引言直接數(shù)字頻率合成DDS(DirectDigitalSynthesizer)是基于奈奎斯特抽樣定理理論和現(xiàn)代器件生...
  • 關(guān)鍵字： FPGA  DDS  信號源  設(shè)計  

高速流水線浮點加法器的FPGA實現(xiàn)

  • 0引言現(xiàn)代信號處理技術(shù)通常都需要進行大量高速浮點運算。由于浮點數(shù)系統(tǒng)操作比較復(fù)雜，需要專用硬...
  • 關(guān)鍵字： 高速流水線  浮點加法器  FPGA  

FPGA硬件系統(tǒng)的調(diào)試方法

  • FPGA硬件系統(tǒng)的調(diào)試方法,在調(diào)試FPGA電路時要遵循一定的原則和技巧，才能減少調(diào)試時間，避免誤操作損壞電路。一般情況下，可以參考以下步驟進行FPGA硬件系統(tǒng)的調(diào)試。
    （1）首先在焊接硬件電路時，只焊接電源部分。使用萬用表進行測試，排除電
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基于FPGA的數(shù)據(jù)采集控制模塊的研究與設(shè)計

  • 0引言數(shù)據(jù)采集和控制系統(tǒng)是對生產(chǎn)過程或科學(xué)實驗中各種物理量進行實時采集、測試和反饋控制的閉...
  • 關(guān)鍵字： FPGA  數(shù)據(jù)采集  

基于MCU和基于ASIC的LED可控硅調(diào)光方案對比與解析

  • 作為一種新的、最有潛力的光源，LED照明以其節(jié)能、環(huán)保的優(yōu)勢越來越受到人們重視。加上國家和地方政府的政策鼓勵，我國的LED照明產(chǎn)業(yè)進入了加速發(fā)展階段，運用市場迅速增長。在室內(nèi)照明方面，用LED燈替代傳統(tǒng)的可調(diào)光
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FC-AL系統(tǒng)中FPGA的彈性緩存設(shè)計

  • 引 言一個簡化的異步數(shù)據(jù)通信系統(tǒng)如圖1所示。接收機端從接收到的來自串行鏈路的比特流中提取時鐘信號Clk1，作為其工作時鐘源；而發(fā)送機端采用本地晶振和鎖相環(huán)產(chǎn)生的時鐘Clk2，作為其工作時鐘源。接收機在時鐘Clk1的
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Altium推出采用Altera Cyclone III FPGA 的NanoBoard 3000

  • 　　繼去年 9 月發(fā)布基于 NanoBoard 3000 的快速原型設(shè)計全新方案后，Altium日前又宣布推出采用 Altera Cyclone III® FPGA 的最新 NanoBoard 3000，從而進一步擴展了這一理念。 　　新的開發(fā)板為電子設(shè)計人員繼續(xù)提供相同的軟硬件以及 NanoBoard 3000 可以直接使用的免專利費 IP，所不同的是，在其內(nèi)核中提供了具有 Altera 高性價比 Cyclone III® FPGA 電源。 　　電子設(shè)計人員采用 NanoBoard
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低功耗FPGA電子系統(tǒng)優(yōu)化方法

  • 首先與實測系統(tǒng)功耗進行對比，驗證了Xilinx公司ISE軟件包中FPGA功耗估算工具XPower的準確性。然后對FPGA設(shè)計中影響系統(tǒng)功耗的幾個相互關(guān)聯(lián)的參數(shù)進行取樣，通過軟件估算不同樣點下的系統(tǒng)功耗，找到功耗最低的取樣點，得到最佳設(shè)計參數(shù)，從而達到優(yōu)化系統(tǒng)設(shè)計的目的。實驗中通過這種方法，在一個FPGA讀寫SRAM的系統(tǒng)中，在單位時間讀寫操作數(shù)固定的條件下，選取了讀寫頻率與讀寫時間占空比這兩個參數(shù)來優(yōu)化系統(tǒng)功耗。最終測試數(shù)據(jù)證明了該方法的正確性。
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基于MPC8260處理器和FPGA的DMA接口設(shè)計

  • 引言在基于軟件無線電的某無線通信信號偵收平臺的設(shè)計中，天線接收到的信號經(jīng)過變頻器處理和A/D變換...
  • 關(guān)鍵字： FPGA  MPC8260  嵌入式  DMA接口  
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