- 有數據顯示，2009年前三季度，中國電子元件、器件行業銷售額與去年相比，分別下降2.8%和2.1%，但多數電子元器件三季度價格較二季度已出現上漲，四季度市場需求明顯回升，電子元器件行業目前處于“觸底回暖”時期。據中國電子元件協會預測，受2009年上半年基數較低的影響，2010年上半年同比將大幅提高，下半年隨著經濟的復蘇，同比增長仍然值得期待。這一趨勢也體現在業內廠商對2010年3月16日-18日舉行的慕尼黑上海電子展的參展熱情上。
據2010年慕尼黑上海電子展(由elec
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電子元器件 ASIC 連接器 電阻 電容
- 隨著紅外焦平面陣列技術的快速發展，紅外成像系統實現了高幀頻、高分辨率、高可靠性及微型化，在目標跟蹤、智能交通監控中得到了越來越多的應用，并向更加廣泛的軍事及民用領域擴展。
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DSP FPGA ASIC
- 受全球金融危機的拖累，2009年全球電子信息產業呈現低迷發展的態勢。處于電子信息產業上游的全球集成電路行業，在2008年出現衰退之后，2009年增速繼續下滑。據WSTS(World Semiconductor Trade Statistics)的最新數據顯示，預計2009年全球集成電路市場將下滑11.4%，下滑幅度比2008年增加了7.2個百分點。
中國集成電路市場一直以來都保持著平穩發展的態勢，雖然市場增速近幾年來有所放緩。在全球集成電路市場大幅下滑30%的2001年以及全球金融危機肆虐的 2
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集成電路 嵌入式處理器 ASIC CPU
- 引言 在高速源同步應用中，時鐘數據恢復是基本的方法。最普遍的時鐘恢復方法是利用數字時鐘模塊(DCM、)產生的多相位時鐘對輸入的數據進行過采樣。但是由于DCM的固有抖動，在頻率很高時，利用DCM作為一種數據恢復的
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SoftSerdes FPGA
- 1 引言
大多數非FPGA類型的、高密度IC(如CPU)對去耦電容都有非常明確的要求。由于這些器件僅為執行特定的任務而設計，所以其電源電流需求是固定的，僅在一定范圍內有所波動。 然而，FPGA不具備這種
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FPGA 分析
- 借助物理綜合提高FPGA設計效能,隨著FPGA密度的增加，系統設計人員能夠開發規模更大、更復雜的設計，從而將密度優勢發揮到最大。這些大規模設計基于這樣的設計需求――需要在無線通道卡或者線路卡等現有應用中加入新功能，或者通過把兩種芯片功能合
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設計 效能 FPGA 提高 物理 綜合 借助
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1 引 言由于雷達所處的環境的復雜性，除了地物、云雨、鳥群等干擾外，還可能來自臨近的雷達異步干擾、電臺干擾等。所有的干擾，經過接收機進入信號處理機，雖然經過了中頻信號的處理，但還可能有殘余。因
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FPGA 雷達視頻 積累 算法
- 0引言傳統氣體壓力測量儀器的傳感器部分與數據采集系統是分離的，抗干擾的能力較差，并且通常被測對...
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FPGA 智能壓力傳感器系統
- 摘要：溫度的監測與控制，對于工業生產的發展有著非常重要的意義。分析并設計了基于數字化一線總線技術的智能溫度測控系統。本系統采用FPGA實現一個溫度采集控制器，用于傳感器和上位機的連接，并采用微軟公司的Visu
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一線總線 異步通訊 FPGA MSCOMM
- 摘 要 介紹了采用FPGA和DSP直接控制硬盤進行數據存儲的方法，并采用一片FIFO作為數據緩存，能夠滿足80Khz數據采樣率系統的存盤要求。 關鍵詞 FPGA；DSP；硬盤；數據存儲 1 引言 數據存儲是數據采集過程中
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FPGA DSP 直接控制 硬盤
- 隨著系統級芯片技術的出現，設計規模正變得越來越大，因而變得非常復雜，同時上市時間也變得更加苛刻。通常RTL已經不足以擔當這一新的角色。上述這些因素正驅使設計師開發新的方法學，用于復雜IP(硬件和軟件)以及復雜
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SystemC FPGA TLM IP開發
- 為解決單片FPGA無法滿足復雜SoC原型驗證所需邏輯資源的問題，設計了一種可層疊組合式超大規模SoC驗證系統。該系統采用了模塊化設計，通過互補連接器和JTAG控制電路，支持最多5個原型模塊的層疊組合,最多可提供2 500萬門邏輯資源。經本系統驗證的地面數字電視多媒體廣播基帶調制芯片(BHDTMBT1006)已成功流片。
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FPGA SoC 層疊 組合式
- SPI(SerialPeripheralInteRFace，串行外圍設備接口)是一種高速、全雙工、同步的通信總線，在芯片的引腳上...
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FPGA SPI 復用配置 存儲器
- 在過去的幾年間，整個半導體產業面臨著巨幅的衰退，然而，這個衰退現象卻為可編程邏輯組件(PLD)產業帶來了實質的絕佳成長機會。雖然PLD公司之間的競爭仍然相當激烈，但ASIC仍然是主要的競爭對手，如今，這種競爭現象已經快速轉變為市場強烈喜好可編程解決方案的傾向。
目前，以先進制程來實行ASIC設計的成本，已經約是十年前的三倍，面對這些開發成本的劇幅提升，許多ASIC設計師迫使必須仰賴具有合理的經濟性、但在制程技術落后的方案。采用較舊的技術會有效能上的劣勢，例如將會限制住ASIC設計師在先進設計中支
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PLD ASIC
- 用FPGA動態探頭與數字VSA對DSP設計實時分析, 隨著 FPGA 在數字通信設計領域（蜂窩基站、衛星通信和雷達）的高性能信號處理電路中成為可行的選擇,分析和調試工具必須包括能幫助您在最短時間內得到電路最佳性能的新技術。 雖然現在已經有多種連接仿真與射頻
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