自即日起至2010年12月31日期間，合眾達聯合TI推出免費的、可永久持續升級的Code Composer Studio IDE v4.
凡購買任意一款合眾達公司(SEED)的基于TI處理器平臺的SEED-XDS560仿真器或SEED-XDS510仿真器，您將即刻免費獲得鉑金版支持永久持續升級的Code Composer Studio IDE v4.
同時，合眾達為回饋老客戶，凡購買過合眾達仿真器的朋友，
可免費下載Code Composer Studio IDE v4
注冊可
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合眾達 DSP
系統用FPGA實現了I2C總線控制器，以Altera公司的NiosⅡ嵌入式軟處理器為核心，結合高品質數字信號音頻編／解碼芯片WM8731成功地實現了語音的錄制及回放功能，同時利用Matlab 7．O．4軟件對所采集的語音數據進行仿真。系統采用SoPC技術，自行設計采集模塊和I2C協議驅動模塊，并通過AWALON總線掛裁在Nios軟核上實時高速采集與回放。實踐表明，系統具有集成度高，穩定性好，實時性強的特點。
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FPGA 語音 回放系統
為了方便外部設備與計算機進行串口通信，提出一種基于FPGA的PCI總線串口卡設計。利用Altera公司的FPGA芯片EP1C6SQ240實現了串口和PCI總線的連接。介紹了用FPGA實現PCI接口、UART的方法，將PCI接口、UART的核心功能集中在FPGA上，使整個設計緊湊、小巧。該設計符合PCI 2.2規范，傳輸速率高，可廣泛應用于各類測試設備、工廠自動化、有線通信等領域。
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FPGA PCI 總線 串口
提出一種設計全數字鎖相環的新方法，采用基于PI控制算法的環路濾波器，在分析模擬鎖相環系統的數學模型的基礎上，建立了帶寬自適應全數字鎖相環的數學模型。使用DSP Builder在Matlab／Simulink環境下搭建系統模型，并采用FPGA實現了硬件電路。軟件仿真和硬件測試的結果證明了該設計的正確性和易實現性。該鎖相環具有鎖頻速度快、頻率跟蹤范圍寬的特點。同時，系統設計表明基于DSP Builder的設計方法可縮短設計周期，提高設計的靈活性。
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相環 設計 實現 數字 適應 DSP Builder 帶寬 基于
基于中檔FPGA多相濾波器的設計實現, 在現代電子系統中，到處都可以看到數字信號處理( DSP )的應用，從MP3播放器、數碼相機到手機。DSP設計人員的工具箱的支柱之一是有限脈沖響應( FIR )濾波器。FIR濾波器越長(有大量的抽頭)，濾波器的響應越好。然而這
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設計 實現 濾波器 多相 FPGA 基于
FPGAs的DSP性能分析, FPGA在高性能數字信號處理領域越來越受關注，如無線基站。在這些應用中， FPGAs通常被用來和DSP處理器并行工作。有更多的選擇當然是好的，但這也意味著系統設計師需要一個確切的FPGAs及高端DSP信號處理器性能參數圖
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分析 性能 DSP FPGAs
日前，德州儀器 (TI) 宣布推出兩款免費軟件開發工具，幫助 ARM?、Linux? 以及系統開發人員便捷地利用 TI 集成型浮點與定點 DSP + ARM 處理器旗下 TMS320C6000? 數字信號處理器 (DSP) 的實時高密度信號處理功能。C6EZRun 與 C6EZAccel 軟件開發工具可幫助 ARM 開發人員便捷地進行 DSP 編程，不但可簡化和加速開發進程，而且還可縮短 DSP 的開發啟動時間與產品的上市時間，并降低開發成本。
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德州儀器 ARM DSP
基于FPGA的PCIE總線擴展卡的設計, PCIE(PCI express)是用來互聯諸如計算機和通信平臺應用中外圍設備的第三代高性能I/0總線。PCIE體系結構繼承了第二代總線體系結構最有用的特點，采用與PCI相同的使用模型和讀/寫通信模型，支持各種常見的事務。其存
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擴展 設計 總線 PCIE FPGA 基于
可程序邏輯閘陣列芯片(FPGA)雙雄賽靈思(Xilinx)與阿爾特拉 (Altera)先后推出28納米FPGA產品，不僅使FPGA市場戰火升溫，也讓晶圓代工市場激烈角逐，在Xilinx首度與臺積電攜手合作后，Altera在28納米產品的布局上亦相當積極，近期亦展示在28納米 FPGA平臺上的25-Gbps收發器，FPGA雙雄的激烈競賽，預料臺積電將成為最大受惠者。
Altera指出，在28納米FPGA中展示25-Gbps收發器，是收發器產品的里程碑，該芯片是Altera用于在28納米FPGA上，
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Xilinx FPGA 28納米
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