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fpga soc 文章 最新資訊

三個趨勢決定無線測試系統未來

  • 電子產品世界,為電子工程師提供全面的電子產品信息和行業解決方案,是電子工程師的技術中心和交流中心,是電子產品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網絡家園
  • 關鍵字: 無線測試系統  RF技術  片上系統  SoC  

SoC用低電壓SRAM技術介紹

  • 東芝在“2010 Symposium on VLSITechnology”上,發布了采用09年開始量產的40nm工藝SoC的低電壓SRAM技術。該技術為主要用于便攜產品及消費類產品的低功耗工藝技術。通過控制晶體管閾值電壓的經時變化,可抑
  • 關鍵字: SRAM  SoC  低電壓    

Altera發售業界最快、具有背板功能收發器的Stratix V FPGA

  •         2012年8月1號,北京——Altera公司(Nasdaq: ALTR)今天宣布,開始批量發售FPGA業界性能最好、具有背板功能的收發器。Altera的Stratix® V FPGA是業界唯一能夠提供14.1 Gbps收發器帶寬的FPGA,也是唯一支持最新一代光纖通道協議(16GFC)的FPGA。背板、交換機、數據中心、云計算應用、測試測量系統以及存儲區域網的開發人員采用Altera最新一
  • 關鍵字: Altera  FPGA  

利用FPGA搭建高等級視頻監控系統

  • 標簽:HD PCB全視頻幀速率下的高分辨率(HD)安全監控處理系統對處理器件的要求越來越高,單芯片DSP處理已經無法適應,多芯片、多核或者CPU+DSP的方式雖然在某些情況下能夠滿足需求,但其在PCB成本、系統資源占用以及
  • 關鍵字: 視頻  監控系統  高等級  搭建  FPGA  利用  

基于FPGA的34位串行編碼信號設計與實現

  • 摘要:為實現某專用接口裝置的接口功能檢測,文中詳細地介紹了一種34位串行碼的編碼方式,并基于FPGA芯片設計了該類型編碼的接收、發送電路。重點分析了電路各模塊的設計思路。電路采用SOPC模塊作為中心控制器,設計
  • 關鍵字: FPGA  串行  編碼  信號設計    

基于FPGA的DDC設計及仿真

  • 摘要:在軟件無線電數字接收機中,從AD前端采集過來的數字信號頻率高達72 MHz,如此高的頻率使得后端DSP不能直接完成相關的數字信號處理任務。因此合理的設計基于FPGA的DDC,以降低數字信號頻率,方便后端DSP實時完成
  • 關鍵字: FPGA  DDC  仿真    

基于FPGA部分動態可重構的信號解調系統的實現

  • 摘要:針對調制樣式在不同環境下的變化,采用了FPGA部分動態可重構的新方法,通過對不同調制樣式信號的解調模塊的動態加載,來實現了不同環境下針對不同調制樣式的解調這種方式比傳統的設計方式具有更高的靈活性、可
  • 關鍵字: FPGA  部分動態可重構  信號解調系統    

基于Verilog HDL語言的CAN總線控制器設計及驗證

  • 摘要:在此利用VerilogHDL設計了一款CAN總線控制器,首先根據協議把整個CAN總線控制器劃分為接口邏輯管理、寄...
  • 關鍵字: CAN總線  控制器  FPGA  Verilog  HDL  

基于FPGA的雙模式光伏電池測試儀

  • 摘要:為了解決傳統的光伏測試儀功能單一,只能夠測量光伏電池基本參數的問題,采用了增加采樣信道,由FPGA控制采樣模式的方法,設計完成了一款雙模式的光伏電池測試儀。在完成光伏電池I-V曲線等參數測量的同時可以實
  • 關鍵字: FPGA  雙模式  光伏電池  測試儀    

MP3數字播放機系統的FPGA設計介紹

  • MP3數字播放機系統的FPGA設計介紹,1 引 言

    MPEG(活動影像專業人員組織)是為數字音頻確定單一編碼和解碼(壓縮/解壓縮)方法于1988年建立的。1992年,國際標準組織(ISO)和國際電工委員會(IEC)為音頻和視頻編碼建立了MPEG1(ISO/IEC11172)標準
  • 關鍵字: 設計  介紹  FPGA  系統  數字  播放機  MP3  

FPGA時序收斂分析

  • FPGA時序收斂分析,您編寫的代碼是不是雖然在仿真器中表現正常,但是在現場卻斷斷續續出錯?要不然就是有可能在您使用更高版本的工具鏈進行編譯時,它開始出錯。您檢查自己的測試平臺,并確認測試已經做到 100% 的完全覆蓋,而且所有測試
  • 關鍵字: 分析  收斂  時序  FPGA  

基于VHDL和FPGA的多種分頻實現方法介紹

  • 基于VHDL和FPGA的多種分頻實現方法介紹,分頻器是數字系統設計中的基本電路,根據不同設計的需要,我們會遇到偶數分頻、奇數分頻、半整數分頻等,有時要求等占空比,有時要求非等占空比。在同一個設計中有時要求多種形式的分頻。通常由計數器或計數器的級聯
  • 關鍵字: 方法  介紹  實現  多種  VHDL  FPGA  基于  

如何在SoC設計中使用事務處理(二)

  • 如何在SoC設計中使用事務處理(二),建模、驗證與調試需要統一標準的符號和框架,以便使架構師和設計工程師能夠協同進行復雜SoC的開發。事務處理級模型(TLM)是進行這種分析的理想模型,在片上系統(SoC)設計中使用事務處理級建模,可讓設計從高效率協同仿
  • 關鍵字: 事務  處理  使用  設計  SoC  如何  

如何在SoC設計中使用事務處理(一)

  • 如何在SoC設計中使用事務處理(一), 建模、驗證與調試需要統一標準的符號和框架,以便使架構師和設計工程師能夠協同進行復雜SoC的開發。事務處理級模型(TLM)是進行這種分析的理想模型,在片上系統(SoC)設計中使用事務處理級建模,可讓設計從高效率協同
  • 關鍵字: 事務  處理  使用  設計  SoC  如何  

使用賽靈思 FPGA加速包處理

  • 隨著 10Gb 以太網發展趨于成熟,且業界甚至已開始期待 40GbE 和 100GbE 以太網的出現,新一代網絡基礎架構方興未艾。融合型網絡在流量處理方面向可擴展開放式平臺提出了全新的挑戰。新一代融合型基礎設施底板通常由高
  • 關鍵字: FPGA  賽靈思    
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fpga soc介紹

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