摘要：介紹一種基于四通道ADC的高速交錯采樣設計方法以及在FPGA平臺上的實現。著重闡述四通道高速采樣時鐘的設計與實現、高速數據的同步接收以及采樣數據的校正算法。實驗及仿真結果表明，同步數據采集的結構設計和預
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FPGA 高速并行 采樣技術
摘要：基于SRAM的FPGA對于空間粒子輻射非常敏感，很容易產生軟故障，所以對基于FPGA的電子系統采取容錯措施以防止此類故障的出現是非常重要的。三模冗余(TMR)方法以其實現的簡單性和效果的可靠性而被廣泛用于對單粒子
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FPGA 三模冗余 容錯 技術研究
吉比特媒體獨立接口是一種以太網接口，簡稱GMII（Gigabit Media Independent Interface）。簡化的吉比特媒體獨立接口稱為RGMII（Reduced Gigabit Media Independent Interface）。采用RGMII的目的是降低電路成本，使
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獨立 接口 媒體 比特 FPGA 橋接 LatticeXP
SHARC DSP與SJA1000的CAN總線接口設計,本文討論了DSP與CAN控制器SJA1000的總線接口的差別，提出了SJA1000和SHARC系列DSP接口設計的簡單方法和通用方法。測試表明，這種方法的穩定性好，傳輸效率高。
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接口 設計 總線 CAN DSP SJA1000 SHARC
摘要：介紹基于FPGA的智能小豐設計，小車包括在FPGA上構建以NiosⅡ嵌入式系統為核心的控制電路、傳感器電路、動力及轉向電路、LCM電路、溫度和濕度測量電路、無線數據收發電路。在NiosⅡ集成開發環境(IDE)縞寫C語言程
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設計 小車 智能 FPGA 基于
Tensilica今天驕傲地宣布以其面向密集計算數據平面和DSP（數據信號處理器）如成像、視頻、網絡和有線/無線基帶通信的處理器IP鞏固了其在IP內核領域的領導者地位，任何需要龐大數據處理的應用都將極大都受益于這些突破性功能――通過內建Tensilica面向SOC的Xtensa® LX4數據平面處理器（DPU）可以將這些應用數據帶寬提高4倍！
新的Xtensa LX4 DPU支持更高的本地數據存儲位寬，最高到每周期1024比特，支持更寬的128位VLIW（超長指令字）指令，從而提高指
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Tensilica DSP
萊迪思半導體公司和Helion Technology今日宣布一系列適用于LatticeECP3 FPGA系列的壓縮和加密的IP核現已上市。該系列具有有效載荷壓縮系統核，提高了有限信道帶寬的利用率，因此非常適合微波回程應用、寬帶無線接入適用于802.16e（WiMAX）以及潛在的其他多鏈路多輸入-多輸出（MIMO）應用中的使用。在LatticeECP3器件中，IP核可以從500Mbps無縫擴展至超過3Gbps，并可用于典型的網絡應用中的第2層或第3層。IP核采用了非常強大和成熟的LZRW無損壓縮算法，它
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萊迪思 FPGA
延續其在高清晰(HD)寬動態范圍(WDR)監控攝像機解決方案上的領先優勢，Altera公司、Apical有限公司(UK)以及AltaSens有限公司今天宣布，開始提供業界第一款HD WDR視頻監控芯片組。這一獨特的芯片組結合了Altera Cyclone® IV E FPGA和安全芯片，支持Apical的HD WDR全圖像信號處理(ISP)流水線IP和AltaSens的1080p60 A3372E3-4T圖像傳感器。這一獨特的解決方案能夠方便的使用Apical IP，降低了用戶在全傳感器處理解
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Altera 視頻監控 FPGA
摘要：分析了現有的視頻采集方案的研究現狀，對如何采用CCD攝像頭采集多通道、高分辨率、高質量的圖像以及基于FPGA的嵌入式圖像采集系統的實現方法做了研究。與傳統圖像采集系統相比，該系統主要利用四片視頻解碼芯片
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FPGA 多路 圖像采集系統 軟件設計
摘要：為了解決空間目標與航天器發生碰撞的問題，設計了一種基于FPGA，以在軌目標三維坐標為待處理數據進行快速并行處理的目標碰撞預警系統。該系統基于Xilinx公司FPGA芯片中的內容可尋址存儲器(Content Addressable
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FPGA 目標碰撞 預警系統
摘要：為解決現代電子戰對接收機處理帶寬寬、靈敏度高及實時性處理的要求，提出一種數字信道化接收機的設計方法。在推導高效信道化接收機模型的基礎上，采用多相濾波器結構實現的數字信道化接收機。該接收機利用超高
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FPGA 寬帶 接收機 數字信道化
摘要：介紹了在FPGA上利用SoPC技術設計實現某機載數據傳榆設備與機載專用計算機進行通信的ARINC429通信協議，實現了對ARINC429數據的一發一收。該系統模塊充分利用了FPGA硬件可編程性、高度集成性、實時性的特點。測
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設計 實現 協議 通信 FPGA ARINC429 基于
大多數電子產品由于包含一個或多個FPGA或DSP數字處理芯片而需要提供多個電源軌。在為這些數字IC供電時，有多種方案可以選擇，也有許多潛在的陷阱需要避免。在“具有多個電壓軌的FPGA和DSP應用的電源設計方法rd
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電源 設計 實例 DSP FPGA 多個 電壓 具有
摘要：本文從設計要求和功能出發，設計了一種用于混合動力汽車的電池管理系統。其中硬件系統包括：電源模塊、基于OZ890 的單體電壓采集電路和I2C 通信電路、基于DSP 的RS232
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DSP 890 OZ 電池管理
基于FPGA的DES、3DES硬件加密技術,傳統的加密工作是通過在主機上運行加密軟件實現的。這種方法除占用主機資源外，運算速度較慢，安全性也較差。而硬件加密是通過專用加密芯片、FPGA芯片或獨立的處理芯片等實現密碼運算。相對于軟件加密，硬件加密具有
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加密 技術 硬件 3DES FPGA DES 基于
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