- IPTV視頻廣播中采用FPGA作為編碼和解碼平臺的好處是明顯的。然而，為FPGA供電可能是一個挑戰，而采用根據電源要求設計的專用電源管理器件，如MIC68200，將極大地縮短新系統的上市時間。
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供電 問題 FPGA 系統 IPTV 基于 通信協議
- 全球領先的硅產品知識產權 (SIP) 平臺解決方案和數字信號處理器(DSP)內核授權廠商CEVA公司宣布提供CEVA-SATA3.0設備控制器IP。基于與固態硬盤 (SSD) 客戶廣泛的合作經驗，CEVA公司已經提升其SATA設備控制器IP性能，提供 6Gbps 線路速率 (line rate) 以實現更快的數據傳輸，使得吞吐量較上代產品提高一倍。該IP已經授權予一家領先的閃存半導體制造商，用于其未來的固態硬盤設計中。
CEVA-SATA3.0 IP 采用最新的原生指令排序 (Native Co
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CEVA 固態硬盤 DSP
- FPGA的嵌入式系統USB接口設計,摘要：設計基于FPGA的IP-BX電話應用系統，用于傳統的電話網絡(PSTN)與PC機之間的接口連接。USB2．0接口器件EZ-USB FX2 CY7C68013A-56工作在slave FIFO模式，為基于FPGA的嵌入式系統與PC機之間提供數據和命令通道，從
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接口 設計 USB 系統 嵌入式 FPGA
- DSP實現3G LTE應用技術簡介,3G LTE是第三代伙伴計劃(3GPP)的一個高級標準，為廣域網提供下一代寬帶無線技術。 與以前各階段的3GPP相比，3G LTE的目標是更高的吞吐量、更低的時延以及高效的IP回程，提供一種新的可以大規模部署的移動網絡技術，預
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應用技術 簡介 LTE 3G 實現 DSP
- 對許多包含并行性或可流水化的算法而言，由于裕量連接帶寬可實現用戶自定義的數據通路，這樣，邏輯可在一個時鐘周期內訪問存儲器或訪問另一個邏輯塊的結果，從而使FPGA的持續性能可接近峰值性能。由于固定架構具備預先確定的用以實現不同功能的邏輯塊集合，所以可以為FPGA配置支持某種給定算法的最優邏輯函數比例來實現器件資源的最佳利用。
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進展 處理 FPGA 交換
- Altera 公司今天宣布其Stratix® IV GT FPGA 實現了與Avago公司 的 40G 四通道小型可插拔 (QSFP) 光學模塊的互操作性。QSFP 光學模塊在單條光纖電纜鏈路上數據速率為 40-Gbps。利用 Stratix IV GT FPGA 中特有的 11.3-Gbps 嵌入式收發器，設計人員現在可以運用 FPGA 的靈活性和性能優勢在其線卡中將 40G QSFP 光學模塊橋接到其它器件，從而增加總系統帶寬。
QSFP 是一些計算及電信應用中使用的高性能交換機、路
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Altera FPGA Stratix QSFP
- 摘要：利用現場可編程門陣列(FPGA)設計并實現直接數字頻率合成器(DDS)。結合DDS的結構和原理，給出系統設計方法，并推導得到參考頻率與輸出頻率間的關系。DDS具有高穩定度，高分辨率和高轉換速度，同時利用Ahera公司
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FPGA DDS
- 摘要：介紹一種基于FPGA技術的時間間隔測量方法，通過分析FPGA的主要技術優勢及其在工業控制領域中所處的重要地位，給出設計時間間隔測量模塊所選用的FPGA器件并進行硬件設計，以及所選用的軟件并進行軟件設計。描述
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FPGA 時間間隔測量 模塊設計
- 基于雙DSP的大功率變流器通用控制平臺的設計, 摘要：介紹一種大功率變流器通用控制平臺，是以TMS320C6713B為浮點算法運算核，TMS320F2812為系統定點控制核的雙DSP的控制系統架構。詳細分析該系統設計各模塊硬件電路和軟件程序設計。該系統控制平臺運算性能強，
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控制 平臺 設計 通用 變流器 DSP 大功率 基于
- DSP內嵌PLL中的CMOS壓控環形振蕩器設計,本文設計了一種應用于DSP內嵌鎖相環的低功耗、高線性CM0S壓控環形振蕩器。電路采用四級延遲單元能方便的獲得正交輸出時鐘，每級采用RS觸發結構來產生差分輸出信號，在有效降低靜態功耗的同時．具有較好的抗噪聲能力。在延遲單元的設計時。綜合考慮了電壓控制的頻率范圍以及調節線性度，選擇了合適的翻轉點。 仿真結果表明．電路叮實現2MHz至90MHz的頻率調節范圍，在中心頻率附近具有很高的調節線性度，可完全滿足DSP芯片時鐘系統的要求。
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振蕩器 設計 環形 CMOS 內嵌 PLL DSP
- 電子產品世界,為電子工程師提供全面的電子產品信息和行業解決方案,是電子工程師的技術中心和交流中心,是電子產品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網絡家園
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TMS320C6713B DSP Flash
- 摘要：提出一個使用FPGA和ARM微控制器實現Profibus-DP主站(1類)通信平臺的解決方案；解析了Profibus-DP通信協議，重點是令牌輪轉協議；給出了該主站通信平臺的系統構建。該通信平臺可以獨立實現Profibus-DP主站(1類)
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Profibus-DP FPGA ARM 通信
- 摘要：討論了應用移位寄存器在Ahera的FPGA芯片中實現線性和非線性偽隨機序列的方法，該算法基于m序列本原多項式來獲得線性m序列和非線性m子序列移位寄存器的反饋邏輯式。文中給出了以Altera的QuartusⅡ為開發平臺，并
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FPGA 偽隨機序列 發生器
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