阿加瓦表示，如果要生產集成有大量內核的處理器，就必須解決如何相互連接各個內核的問題。 對這一問題多年的研究催生了Tilera。Tilera已經開發出整合有64個內核、支持高速網絡連接的芯片，各個內核間的數據傳輸速率將能夠達到32Tbps。 Tilera表示，其名為Tile64的芯片能夠提供相當于至強芯片10倍的性能，而能耗則要低得多。Tile
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嵌入式系統 單片機 芯片設計 EDA IC設計
手機多媒體功能年年翻新，從幾年前的和弦音、攝像頭，再到這兩年的MP3和MP4。而今年，多數廠家認為與大屏幕顯示有關的多媒體應用將成為主流趨勢。隨著技術發展，許多多媒體功能，如視頻下載、視頻分享、電子商務、Java游戲將越來越普及。由于手機多媒體功能種類繁多，發展變化速度極快，手機設計者希望采用功能可以擴展，能夠保護原有投資的設計方案，這使得基帶+應用處理器解決方案受到青睞。而專攻多媒體技術的本土芯片設計企業也紛紛瞄準應用處理器產品，陸續推出整套方案。
手機設計企業尋求可拓展方案
目前，手機
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IC設計 EDA IC設計
對于中國的電子產業來說，最務實的發展不外乎大量優秀本土IC設計公司的成長與壯大。然而，目前國內大多數IC設計公司還沒有走出襁褓，依然缺乏足夠頑強的生命力，并非許多IC設計公司的技術不夠先進，更重要的是沒有找到適合自己的市場切入點。雄心壯志，每個創業者總是為自己的未來勾畫了美好的藍圖，但如何一步一步擁抱夢想卻難住了大多數人。許多IC設計創業者總是希望能用最先進的芯片快速占領市場，殊不知走進了一條無底深淵。從經濟實力到科技實力，甚至是市場渠道，國際廠商早已經擁有高端芯片市場的絕對優勢，如果把創業初期的成敗寄托
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0706_A 雜志_業界風云 嵌入式系統 單片機 EDA IC設計
MosaidTechnologies公司半導體IP部副總裁MikeKaskowitz近日表示，IP業務現“已遭到破壞”，需要加以鞏固從而更好地為用戶服務。 Kaskowitz表示，“從IP的層面看，我們的生態系統已經遭到破壞，開發IP的成本非常昂貴，然而對于不合格的供應商而言，入行門檻卻非常低。因此其價值正由這些低端供應商確定，而與制造品質IP的實際價值相背離。” Kaskowitz是前MentorGraphics公司和VSIA聯盟的管理人員，他在第
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EDA IC設計
?????中國人自古崇尚胸懷壯志，而大國崛起之風自然吹過IC設計產業。可以說，中國人自從決心搞芯片的那天起，就從沒有放棄過對“芯”的熱捧，特別是對能達到國際先進水平的“芯”的崇拜幾乎達到無以復加的地步。?
????事實總是捉弄滿懷熱情的人，當我們為一顆顆芯的出現而擊掌相慶之際卻無法回避這樣的殘酷：樣品好出成本難產。在一個個國家重點支持的流產項目背后，我們看到的是IC設計行業真實的差距，同樣還有那如大煉鋼鐵
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IC設計 創業 商業模式 EDA IC設計
安捷倫科技公司日前宣布，GENESYS電子設計自動化（EDA）軟件的全新主要版本――GENESYS 2007已經開始發運。GENESYS 2007包括一種全新的設計功能――LiveReport，通過更簡明的用戶界面和自動執行文檔處理功能，使射頻與微波元器件和子系統的設計者能夠方便地進行通信和重復使用以前的設計。 LiveReport能夠幫助設計人員克服大型、多重設計項目的復雜性。它將示意圖、布局圖、曲線圖和方程式的實時視圖捕獲到一個互交文檔中。通過點擊LiveReport頁
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2007 EDA GENESYS 安捷倫 消費電子 EDA IC設計 消費電子
No.1 Writing Testbenches, Functional Verification of HDL Models
by Janick Bergeron
本書主要以HDL（verilog/vhdl）為例，詳細講述了在IC DESIGN FLOW中Verification 以及Test的設計思想、方法和技巧，涵概了測試的各個方面，是目前進行IC設計的同仁們最為推薦的一本寶典！！
作者的個人網頁有詳細的介紹：
http://www.janick.bergeron.co
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IC設計 書 EDA IC設計
中國臺灣地區半導體產業在上下游垂直專業分工的策略推動下，產業規模不斷擴充，漸臻至成熟。預期2007~2009年景氣持平發展的情境下，新增需求人數分別為13,600、16,700、5,500人，三年共計3萬5,800人。其中以IC設計工程師、工藝工程師、設備工程師等職務需求最大。
根據工研院IEK調查，中國臺灣地區IC設計產業蓬勃發展，家數與產值皆僅次于美國；IC制造業更靠著晶圓雙雄在全球持續雄霸；下游的封
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IC設計 半導體 EDA IC設計
SYNPLICITY 公司日前宣布推出最新 Synplify DSP ASIC版，進一步豐富了其旗下的 ESL 軟件系列。在該公司致力于提供各種技術獨立的解決方案這一發展戰略的引導下，新型 Synplify® DSP ASIC 版軟件將幫助用戶根據算法級設計的要求自動開發高質量 RTL 代碼，以適應 FPGA 或 ASIC 器件的需求。 S
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ASIC DSP SYNPLICITY 消費電子 EDA IC設計 消費電子
模擬/數.模混合信號 電路設計EDA工具
分類
產品名
制造商
模擬電路Simulator（仿真工具）
T-Spice Pro
美國 Tanner Research公司
SmartSpice
美國 Silvaco International公司
Eldo
美國 Mentor Graphics公司
混合信號□Simulator（仿真工具）
ICAP/4
美國 intusoft公司
混合信號□Simulat
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EDA EDA IC設計
CADENCE發布了Cadence Encounter 數字IC設計平臺的最新軟件版本，增加了業內領先的功能特性，包括全芯片優化、面向65納米及以下工藝的超大規模混合信號設計支持，具有對角布線能力的Encounter X Interconnect Option，以及之前已經公布支持的基于Si2通用功率格式（CPF）1.0版本的低功耗設計。新平臺提供了L、XL和GXL三種配置，為先進半導體設計提供更佳的易用性，更短的設計時間以及更高的性能。 “最新版本Enc
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CADENCE DFM ENCOUNTER 電源技術 模擬技術 EDA IC設計
Cadence設計系統公司發布Cadence Encounter® 數字IC設計平臺的最新軟件版本，增加了業內領先的功能特性，包括全芯片優化、面向65納米及以下工藝的超大規模混合信號設計支持，具有對角布線能力的Encounter X Interconnect Option，以及之前已經公布支持的基于Si2通用功率格式（CPF）1.0版本的低功耗設計。新平臺提供了L、XL和GXL三種配置，為先進半導體設計提供更佳的易用性，更短的設計時間以及更高的性能。
“最新版本Encounter平臺的發
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Cadence IC設計 單片機 嵌入式系統 EDA IC設計
Application-Specific Integrated Circuits (ASICs... the book) Michael John Sebastian Smith 06/1997
Bit-Slice Design: Controllers and ALUs Donnamaie E. White 07
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IC設計 EDA IC設計
Springsoft，近期宣布旗下關系企業美國Novas公司推出全新精確時序仿真再生技術~ Siloti Replay 模塊，此功能是屬于Siloti信號能見度增強系統Sim VE (Visibility Enhancement) 的附加模塊。這項正在申請專利中的新技術可提高芯片仿真過程中所發生時序問題的偵錯及修復效率。相較于傳統仿真方式，此技術有效提升仿真速度并節省十倍以上的文件存取空間，同時提供芯片偵錯過程中，偵錯系統所需的精確時序信息。
門級電路（gate level）的時序仿真至今仍是芯片驗證
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Siloti VE 測量 測試 單片機 嵌入式系統 EDA IC設計
2006年6月21日，2006年（第四屆）泛珠三角集成電路聯誼暨市場推介會在深圳的麒麟山莊舉行。與往年不同，此屆聯誼會的范圍已擴大到全國，來自全國7個IC產業基地的代表以及香港科技園的負責人均參加了此次盛會。會上，中國半導體行業協會（CSIA）理事長俞忠鈺對中國半導體產業過去5年來取得的成績進行了回顧，對近期的市場進行了展望，并且指出中國集成電路設計業的新思路：“中國IC設計公司不要太強調高技術水平的產品，而是要強調擁有自主知識產權、掌握核心技術、有品牌、有市場競爭力
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IC設計專題 EDA IC設計
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