FPGA實現時分多址的一種改進型方法
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2 FPGA的實現
實驗所采用的FPGA是XILINX公司的SPARTAN 3E系列中的XC3SS00E芯片，該芯片的封裝是PQ208，芯片速度為-5，采用的程序開發語言是VHDL，綜合工具為XILINX公司的ISE 10．1，仿真工具采用的是ModelSim se 6．2。
與理論算法對應，硬件實現的VHDL程序包括了以下幾個模塊。
使用芯片內部的雙口RAM的IP核，通過例化IP核，利用一個雙口RAM有兩套讀寫地址，將程序的輸入輸出與雙口RAM的輸入輸出進行映射，則內部電路將程序的輸入輸出連接到了雙口RAM的輸入輸出上。對程序的輸入輸出腳的操作相當于對雙口RAM進行操作。圖1是雙口RAM的VHDL代碼在Xilinx ISE中綜合后的寄存器傳輸級電路圖。
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