第五屆RISC-V中國峰會于2025年7月16至19日在上海張江科學會堂隆重舉辦，本屆峰會設置1場主論壇、9場垂直領域分論壇、5場研習會、11項同期活動，以及4,500平方米未來科技展覽區。預計將吸引近2,000名國內外專業觀眾線下參與 (80%來自產業界)，線上直播及回放覆蓋超過50萬人次行業人群，匯聚數百家企業、研究機構及開源技術社區參會。 上海是中國集成電路設計業規模最大的城市，也是全球RISC-V技術創新的戰略高地。作為全球三大RISC-V峰會之一，本次中國峰會匯聚了上海市政府和工信部的
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RISC-V 中國峰會
業界越來越多地談論 RISC-V 架構帶來的好處，但它甚至是正確的起點嗎？雖然它可能并不完美，但它可能會提供逐步前進所需的靈活性。計算機架構和軟件追隨了 80 年前開發的處理器的腳步。他們的目標是使用一種基礎技術來解決順序標量算術問題，只要它有足夠的內存，就可以解決任何有限問題。芯片行業已經表明不愿意放棄這種方法，尤其是在仍在運行 50 年前開發的軟件的行業。軟件范式和向后兼容性具有巨大的影響。編程以任何有意義的方式從單處理器遷移到多處理器架構花了幾十年的時間，直到 NVIDIA 開發了 CUDA，針對大
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RISC-V
德國RISC-V 處理器開發商Codasip的董事會將要出售公司。該公司在首席執行官 Ron Black 的領導下，希望在未來三個月內出售該公司。它開發了使用開放式 RISC-V 指令集生產處理器內核的工具，并獲得了高達 380m 歐元的資金，其中包括各種股權和贈款，其中包括后續項目資金。目前有 250 名員工，其中 57% 從事硬件工作，30% 從事軟件工作。近年來，RISC-V 開發一直在努力，市場競爭更加激烈。Synopsys 去年推出了全系列 RISC-V 內核 IP，而主要芯片制造商的
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RISC-V 處理器 Codasip
智能汽車時代的加速到來，使車載智能系統面臨前所未有的算力需求。隨著越來越多車型引入電子電氣架構轉向中心化、智能駕駛的多傳感器融合、智能座艙的多模態交互以及生成式AI驅動的虛擬助手等創新技術，都要求車用主芯片能夠同時勝任圖形渲染、AI推理和安全計算等多重任務。當下，功能安全、高效高靈活性的算力、產品生命周期，以及軟件生態兼容性這“四大核心要素”，已成為衡量智能汽車AI芯片創新力和市場競爭力的核心標準。傳統汽車計算架構中，往往采用CPU與GPU或/和NPU等計算單元組成異構計算模式；隨著自動駕駛算法從L1向L
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作為全球三大RISC-V峰會之一，備受矚目的第五屆RISC-V中國峰會將于7月16日至19日在上海張江科學會堂隆重舉行。本屆峰會由上海開放處理器產業創新中心（SOPIC）主辦，上海國有資本投資有限公司、上海張江高科技園區開發股份有限公司、RISC-V國際開源實驗室和中電標協RISC-V工委會聯合主辦，中國RISC-V產業聯盟（CRVIC）、中國開放指令生態（RISC-V）聯盟（CRVA）、RISC-V中國社區（CNRV）等多方協辦，將匯聚全球頂尖企業和專家，共同探討RISC-V技術的前沿發展與產業應用。峰
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RISC-V RISC-V中國峰會
中國數字EDA/IP龍頭企業上海合見工業軟件集團有限公司（簡稱“合見工軟”）近日發布國產自主研發支持多協議的32G SerDes PHY 解決方案UniVista 32G Multi-Protocol SerDes IP (簡稱UniVista 32G MPS IP)。該多協議PHY產品可支持PCIe5、USB4、以太網、SRIO、JESD204C等多種主流和專用協議，并支持多家先進工藝，成功應用在高性能計算、人工智能AI、數據中心等復雜網絡領域IC企業芯片中部署。隨著全球數據量呈指數級增長，這場由數據驅
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合見工軟 SerDes IP
RISC-V 或許并非許多應用的完美解決方案，但它或許能提供一條演進路徑。
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RISC-V
全球領先的嵌入式軟件解決方案供應商IAR正式發布其旗艦產品的重大更新版本：Arm開發工具鏈v9.70和RISC-V開發工具鏈v3.40，大幅提升了IAR開發平臺在性能、安全性和自動化方面的能力，助力汽車、工業、醫療和物聯網等行業中的敏捷、可擴展嵌入式應用。為應對嵌入式系統日益增長的復雜性，全新的IAR開發工具鏈支持云端許可、CI/CD管道集成和多種架構的開發。隨著Arm和RISC-V持續推動技術演進，IAR推出統一的開發平臺，提供高質量且具安全保障的開發體驗。新版本幫助客戶提升研發效率、降低研發成本、縮短
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IAR RISC-V
人工智能（AI）在邊緣計算領域正經歷著突飛猛進的高速發展，根據IDC的最新數據，全球邊緣計算支出將從2024年的2280億美元快速增長到2028年的3780億美元*。這種需求的增長速度，以及在智能制造、智慧城市等數十個行業中越來越多的應用場景中出現的滲透率快速提升，也為執行計算任務的硬件設計以及面對多樣化場景的模型迭代的速度帶來了挑戰。AI不僅是一項技術突破，它更是軟件編寫、理解和執行方式的一次永久性變革。傳統的軟件開發基于確定性邏輯和大多是順序執行的流程，而如今這一范式正在讓位于概率模型、訓練行為以及數
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并行計算 GPU GPU IP
芯原股份（芯原）近日宣布其超低能耗且高性能的神經網絡處理器（NPU）IP現已支持在移動端進行大語言模型（LLM）推理，AI算力可擴展至40 TOPS以上。該高能效NPU架構專為滿足移動平臺日益增長的生成式AI需求而設計，不僅能夠為AI PC等終端設備提供強勁算力支持，而且能夠應對智慧手機等移動終端對低能耗更為嚴苛的挑戰。芯原的超低能耗NPU IP具備高度可配置、可擴展的架構，支持混合精度計算、稀疏化優化和并行處理。其設計融合了高效的內存管理與稀疏感知加速技術，顯著降低計算負載與延遲，確保AI處理流暢、響應
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芯原 NPU 大語言模型推理 NPU IP
近日，一站式定制芯片及IP供應商——燦芯半導體（上海）股份有限公司宣布推出基于28HKC+?0.9V/1.8V平臺的Ternary Content-Addressable Memory (TCAM) IP。該IP具有高頻率和低功耗特性，隨著網絡設備中快速處理路由表與訪問控制列表（ACL）等需要高效查找的場景不斷增加，該IP將被高端交換機、路由器等芯片廣泛采用。燦芯半導體此次發布的TCAM IP包含全自研Bit cell，符合邏輯設計規則，良率高；在可靠性方面，這款TCAM抗工藝偏差強，具有高可靠
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燦芯 28HKC+ 工藝平臺 TCAM IP
英國芯片設計公司 Aion Silicon（前身為 Sondrel）贏得了一個 $12m 的項目，用于開發用于高性能計算 （HPC） 和人工智能 （AI） 應用的 RISC-V 加速器。該項目涵蓋了從完整的 RTL 架構和驗證到可測試設計、物理實現和使用 RISC-V 開放指令集架構 （ISA） 和矢量擴展在前沿節點上流片的所有設計工作，以加速 AI 工作負載。Aion 已經從設計服務（例如最近的視頻芯片 ASIC 合同）轉變為提供全方位服務的芯片供應，包括與代工廠合作。它之前曾為“全球 HPC 競賽需要
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Aion Silicon RISC-V AI芯片
提到服務器 CPU 芯片，X86 和 ARM 架構是大眾認知中的「常客」。而最近，隨著一系列熱點事件的發布，基于 RISC-V 架構的服務器 CPU 迅速 「破圈」，闖入大眾視野。RISC-V 服務器 CPU，紛紛亮相RISC-V 架構有著開源、指令精簡和可擴展的優勢，在注重能效比的物聯網領域收獲頗豐。不過，這并不意味著 RISC-V 無法進軍有更高性能要求的 PC 和服務器市場。如今，已有多家公司的 RISC-V 架構服務器 CPU 芯片亮相。玄鐵C930阿里巴巴達摩院旗下品牌玄鐵，
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RISC-V 服務器CPU
芬蘭的 Flow Computing 已開始對其并行處理單元 （PPU） AI 模塊的 RISC-V 編譯器進行 alpha 測試。PPU 能夠通過使用編譯器使源代碼利用該架構，將任何 CPU 架構增加多達 100 倍。第一次目標編譯表明，通過重新編譯現有代碼，可以顯著減少 RISC-V CPU 模型中常見的循環，達到 100 倍的預期性能。相比之下，只需將一些 CPU 內核替換為 PPU，即可在不更改源代碼的情況下進行 2 倍的改進，而無需重新編譯。編譯器識別現有源代碼中可由 PPU 有效加速的并行元素
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并行AI RISC-V 編譯器 Alpha測試
西班牙的 SemiDynamics 開發了一種完全可編程的神經處理單元 （NPU） IP，它結合了 CPU、向量和張量處理，可為大型語言模型和 AI 推薦系統提供高達 256 TOPS 的吞吐量。Cervell NPU 基于 RISC-V 開放指令集架構，可從 8 個內核擴展到 64 個內核。這使設計人員能夠根據應用的要求調整性能，從緊湊型邊緣部署中 1GHz 的 8 TOPS INT8 到數據中心芯片中高端 AI 推理中的 256 TOPS INT4。這是繼 12 月推出的一體化架構之后發布的，本白皮書
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SemiDynamics RISC-V NPU
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