? 根據牧本定律(Makimoto’s?Wave),從2007年開始的10年,進入了在可編程性基礎上的客戶定制產品流行時代。專做標準產品的FPGA也在悄然分化，更加面向特定的應用。 圖1?牧本浪潮 中小廠商：面向便攜式應用 盡管每年ASIC的新開工數量不斷走低，但是FPGA玩家圈子似乎沒有因此擴大，還好像越來越小——誰也不愿意成為圈內兩大FPGA巨頭血斗的第三者。并且以低功耗見長的QuickLogic首先跳出了這個“紅海”，直奔便攜式應用的藍海——CSSP(客戶特殊標
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FPGA ASIC USB Xilinx Altera
摘要：傳統的人工耳蝸語音處理器采用ASIC設計，投入成本高，可移植性差，設計了一種基于A的人工耳蝸語音處理器。該處理器采用雙麥克風接受語音信號，實現了語音信號的自適應噪聲消除和CIS(Continuous Interleaved Sampling)方案。同一段語音由DSP采樣處理得到的刺激脈沖與MATLAB采樣處理的結果基本相同。實驗結果表明，基于DSP的人工耳蝸語音處理器能實現語音信號中噪聲的消除并得到良好的刺激脈沖。
關鍵詞：DSP;人工耳蝸;自適應噪聲消除;語音處理器
人工耳蝸又稱人造耳蝸、電子
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DSP ASIC
電子產品世界,為電子工程師提供全面的電子產品信息和行業解決方案,是電子工程師的技術中心和交流中心,是電子產品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網絡家園
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ASIC 嵌入式存儲器 SoC IP
恩智浦半導體日前宣布任命鄭力擔任大中華區全球市場與銷售資深副總裁兼中國區總裁，辦公地點位于上海。鄭力接替即將退休的葉昱良(Mike?Yeh)資深副總裁。葉先生服務半導體行業逾30年，成績斐然。 出任此職務前，鄭力是中芯國際(SMIC?Corp)的全球營銷資深副總裁，負責產品藍圖、技術完整性管理、技術推廣以及攜手核心客戶開發項目。鄭力曾擔任多個高級管理職務，包括瑞薩電子(Renesas)中國和香港區總裁兼首席執行官，以及日電電子(NEC?Electronics)中國和香港
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恩智浦 SMIC NFC AFC
凌力爾特公司?(Linear?Technology?Corporation)?推出雙相同步降壓型從屬控制器?LTC3870，當與一個伙伴主控制器配對使用時，其能夠通過擴展多相應用中的相位數目產生高達?240A?的電流。兼容的主控制器包括?LTC3880?和?LTC3883?數字電源系統管理控制器。 LTC3870?是凌力爾特全功能控制器的一種替代方案，并提供了適合多相從屬設計的基本
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Linear LTC3870 ASIC
ASIC、FPGA和DSP的應用領域呈現相互覆蓋的趨勢，使設計人員必須在軟件無線電結構設計中重新考慮器件選擇策略...
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ASIC DSP FPGA 無線電
1DPO的特點數字熒光示波器DPO（DigitalphosphorOscilloscopes）是Tektronix公司新推陳出新出的一種示...
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DPO 示波器技術 ASIC
摘要：本文提出了一種基于低成本FPGA的高清低碼流安防攝像機SoC實現方式，該設計已經完全實現，開創了高清低碼流安防攝像機SoC的先河。
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FPGA SoC ASIC 攝像機 傳感器
在汽車電子中廣為采用的微控制器(MCU)正快速面臨時間和成本的壓力。使用MCU的主要優勢一直以來都是‘創造具有高性價比的高階系統整合’。然而，在此一優勢之下，有一些與元件本身相關的潛在成本是超乎于其單價水平的。例如，若選用的元件無法創造所需特性，則必須增加外部邏輯、軟件或其它整合元件。
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微控制器 FPGA ASIC CPU 嵌入式
近年來，能量收集(energy harvesting)話題在電子設計群體內獲得了廣泛關注。通過能量收集過程，能夠捕獲、收集然后透過電子設備來利用小批量的能量，從而能夠完成簡單的任務，而無須在系統設計中集成傳統電源。
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安森美 能量收集 OEM 太陽能 ASIC
電子產品世界,為電子工程師提供全面的電子產品信息和行業解決方案,是電子工程師的技術中心和交流中心,是電子產品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網絡家園
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傳感器 ASIC MEMS 協同設計
中國人行不承認比特幣(Bitcoin)為交易貨幣，但比特幣在PayPal等網站上仍可使用，全球仍有許多「礦工」投入挖礦行列。由于專業「挖礦機」需要強大的平行運算功能來進行比特幣挖礦，高階繪圖晶片及專用特殊應用晶片(ASIC)需求強勁，臺積電(2330)受惠最大。
比特幣的發行不需透過第三方單位，而是由蘊藏比特幣的礦山，每10分鐘主動產生一個區塊，只要完成區塊內數據運算，就可獲得比特幣。由于比特幣每4年的每一區域產量將減少一半，現在每區域只能生產25個比特幣，所以參與運算的「礦工」，就得利用專業「
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臺積電 ASIC
在OTN幀結構中，Serdes在從高速的串行數據中恢復出數據后，數據只是按順序以64bit為寬度重新放置，并沒有按字節對齊，所以后續電路無法直接使用這樣的數據。需要幀頭定位電路找到幀頭后，把所有的數據按字節對齊。但是將OTN數據轉換為并行的數據后，存在著數據速率高，位寬大的問題。在ASIC或FPGA中，大量的大位寬的數據，是不容易運行在較高的速率下的。所以需要對幀定位電路進行簡化，以使得電路在大位寬時，仍然能夠進行高速運行。研究了OTN數據的幀結構后，提出了一種適合于高速率的、大位寬的處理電路。
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OTN FPGA Serdes ASIC 幀定位 201401
賽靈思宣布推出20nm All Programmable UltraScale?產品系列，并配套提供產品技術文檔和Vivado?設計套件支持。繼2013年11月首款20nm芯片發貨后，賽靈思繼續積極推動UltraScale器件系列發貨進程。該器件系列采用業界唯一的ASIC級可編程架構以及Vivado ASIC增強型設計套件和UltraFast?設計方法，提供了可媲美ASIC級的性能優勢。
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賽靈思 UltraScale ASIC 以太網
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