基于SBC+DSP 的嵌入式系統設計與應用,根據嵌入式系統知識，利用其優點，針對星圖識別的特征，設計一種以SBC+DSP為硬件平臺的嵌入式系統，通過試驗驗證，系統能夠滿足星圖識別大數據量、實時響應速度和高可靠性的要求。
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設計 應用 系統 嵌入式 SBC DSP 基于 數字信號
本文首先簡單的介紹了總線的發展，從而引出一種新型的串行點對點交換結構RapidIO。DSP 在高性能處理系統中的重要性毋庸置疑，但是目前的很多DSP 并沒有RapidIO接口。本文提出了利用FPGA，將DSP 的總線橋接到一個RapidIO IP 上，從而實現了DSP與RapidIO 網絡的互聯。
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RapidIO 網絡互聯 DSP 實現 FPGA 基于 RapidIO
日前，德州儀器 (TI) 宣布推出一款基于 TI 多核數字信號處理器 (DSP) 的新型片上系統 (SoC) 架構，該架構在業界性能最高的 CPU 中同時集成了定點和浮點功能。TI 全新的多內核 SoC 運行頻率高達 1.2GHz，引擎性能高達 256 GMACS 和 128 GFLOPS，與市場中現有的解決方案相比，能夠實現 5 倍的性能提升，從而可為廠商加速無線基站、媒體網關以及視頻基礎架構設備等基礎局端產品的開發提供通用平臺。
知名的技術分析公司 BDTI 在其《InsideDSP》通訊中
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TI DSP SoC
CEVA公司與業界領先的網絡基礎設施應用半導體解決方案供應商Mindspeed Technologies宣布，CEVA用于無線基站應用的經驗證的高性能CEVA-X1641 DSP已獲Mindspeed選用于全新的Transcede 4000無線基帶處理器。Transcede 4000是能夠實現全新級別之高性能、低功耗、軟件可編程設備，應對下一代移動網絡的計算挑戰。
Mindspeed的Transcede 4000器件在功能強大的多核架構中集成了10個CEVA-X1641 DSP，能夠提供下一代移
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CEVA DSP 處理器
賽靈思公司今天所發布的消息“賽靈思采用28 納米高性能、低功耗工藝加速平臺開發，推進可編程勢在必行”凸顯了功耗在目前系統設計中所起的重要作用，也充分顯示了在賽靈思考慮將 28 納米工藝技術作為其新一代 FPGA 系列產品的技術選擇時， 功耗如何在一定程度上影響到了最終的決策。。
眾所周知，FPGA 在摩爾定律作用下不斷發展，每一代新產品的推出，都提高了系統功能，加強了計算能力。不過，也存在著自相矛盾的地方。隨著 FPGA 按照摩爾定律不斷發展，設計和構建 FPGA 的工程
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Xilinx 28納米 FPGA
全球可編程邏輯解決方案領導廠商賽靈思公司 (Xilinx Inc.? ) 今天宣布，為推進可編程勢在必行之必然趨勢，正對系統工程師在全球發布賽靈思新一代可編程FPGA平臺。和前代產品相比， 全新的平臺功耗降低一半，而性能提高兩倍。通過選擇一個高性能低功耗的工藝技術，一個覆蓋所有產品系列的、統一的、可擴展的架構，以及創新的工具，賽靈思將最大限度地發揮 28 納米技術的價值， 為客戶提供具備 ASIC 級功能的 FPGA，以滿足其成本和功耗預算的需求。同時還能通過簡單的設計移植和 IP 再利用，
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Xilinx 28納米 FPGA
Altera公司今天宣布，40-nm Stratix® IV FPGA系列最近榮獲電子編輯媒體的多個獎項。Stratix IV系列因其在密度、性能和功耗上的優勢，以及在前沿工藝技術上的領先地位獲得《電子技術應用》、中國電子報以及《VME和關鍵系統雜志》(VME and Critical Systems)的編輯的認可。Stratix IV FPGA器件自2008年12月開始發售起，已有10家電子行業媒體授予它12項產品和技術獎。最新的獎項包括：
《電子技術應用》雜志授予Strati
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Altera Stratix FPGA
Tensilica日前發布第二代基帶引擎ConnX BBE16，用于LTE(長期演進技術)及4G基帶SoC(片上系統)的設計。ConnX BBE16的16路MAC(乘數累加器)架構經過特別優化，以滿足無線DSP(數字信號處理)算法需求，包括：OFDM(正交頻分復用)、FFT(快速傅氏變換)、FIR(有限脈沖響應)、IIR(無限脈沖響應)以及矩陣運算。ConnX BBE16針對芯片面積以及低功耗應用進一步優化，相比原先的ConnX BBE在某些關鍵算法上提供高達三倍的性能。該架構適用于可編程無線手持設備
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Tensilica 基帶 DSP
DSP系統中的EMC和EMI的解決方案, 在任何高速數字電路設計中，處理噪音和電磁干擾(EMI)都是必然的挑戰。處理音視訊和通訊訊號的數字訊號處理(DSP)系統特別容易遭受這些干擾，設計時應該及早厘清潛在的噪音和干擾源，并及早采取措施將這些干擾降到最小
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解決方案 EMI EMC 系統 DSP DSP
一、摘要 從簡單SRAM接口到高速同步接口，TimingDesigner軟件允許設計者在設計流程的初期就判斷出潛在的時序問題，盡最大可能在第一時間解決時序問題。在設計過程的早期檢測到時序問題，不僅節省時間，而且可以更
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FPGA 時序
1 引言 20世紀末，全球范圍內興起的信息革命浪潮，為汽車工業的突破性發展提供了千載難逢的機遇，信息技術的廣泛應用是解決汽車帶來的諸如交通擁擠、交通安全、環境污染、能源枯竭等問題的最佳途徑。同時，隨著
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FPGA DSP 汽車電子
本白皮書介紹FPGA中的壓穩態，為什么會出現這一現象，它是怎樣導致設計失敗的。介紹怎樣計算壓穩態MTBF，重...
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FPGA 壓穩態 MTBF 寄存器
MicroTCA正在成為嵌入信號處理應用，尤其是高性能的多處理器系統中日益普及的標準。這些標準采用了可滿足“運營商級”電信設備需求的先進中間卡（AdvancedMC），從而找到了進入電信應用的途徑，如無線基帶處理。
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FPGA RapidIO 無線 導入 MicroTCA
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