并行

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并行資訊

從并行到串行再返回：對SerDes的理解

串行化/去串行化電路，統(tǒng)稱為SerDes，為數(shù)字通信系統(tǒng)提供了重要的好處，尤其是當需要高數(shù)據(jù)速率時。在我工程生涯的早期，我認為并行通信通常比串行通信更可取。我很欣賞同時移動所有8個（或16個，或32個…）數(shù)據(jù)位的簡單性和...

202408 SerDes 2024-05-17

Xilinx哈夫曼編碼系統(tǒng)設(shè)計　

在圖像處理、文件傳真、視頻壓縮編碼中，哈夫曼編碼是最常用的一種編碼方式。本文設(shè)計并實現(xiàn)了對一段數(shù)字序列進行哈夫曼編碼并將編碼結(jié)果串行輸出的電路模塊，電路由輸入數(shù)據(jù)的排序、數(shù)據(jù)的哈夫曼編碼、數(shù)據(jù)序列編碼的結(jié)果輸出三個核心模...

哈夫曼編碼流水線 2017-10-27

基于FPGA的串并集合排序在雷達系統(tǒng)中的應(yīng)用

在雷達抗干擾處理以及空時二維處理過程中數(shù)據(jù)排序?qū)⒈夭豢擅猓趥鹘y(tǒng)的DSP、CPU等常規(guī)軟件排序已經(jīng)不能夠滿足雷達系統(tǒng)實時性要求，使用 FPGA排序的趨勢將勢不可當。FPGA由于具有較高的并行處理能力，目前已成為雷達陣列信...

排序 FPGA 2016-10-15

FPGA研發(fā)之道(9)架構(gòu)設(shè)計漫談(四)并行與復用

　　FPGA其在眾多器件中能夠被工程師青睞的一個很重要的原因就是其強悍的處理能力。那如何能夠做到高速的數(shù)據(jù)處理，數(shù)據(jù)的并行處理則是其中一個很重要的方式。　　數(shù)據(jù)的并行處理，從結(jié)構(gòu)上非常簡單，但是設(shè)計上卻是相當復雜，對...

FPGA 架構(gòu)設(shè)計 2014-10-27

用FIFO實現(xiàn)DSP間的雙向并行異步數(shù)字通信

用FIFO實現(xiàn)DSP間的雙向并行異步數(shù)字通信,在多CPU的分布式信號處理系統(tǒng)中,往往涉及CPU間的通訊與數(shù)據(jù)交換,大數(shù)據(jù)量的數(shù)據(jù)傳輸一般采用DMA方式,而小數(shù)據(jù)量的數(shù)據(jù)交換采用并行接口則比較快速靈活。因此,對于傳輸速度要...

異步數(shù)字 2013-02-01

基于Petri網(wǎng)的并行控制器的VHDL實現(xiàn)

Petri網(wǎng)是異步并發(fā)系統(tǒng)建模與分析的一種重要工具，1962年由德國科學家C.A.Petri博士創(chuàng)立。40多年來，Petri網(wǎng)理論得到了很大的豐富和發(fā)展，其應(yīng)用領(lǐng)域也在不斷擴大，越來越受到國際同行的重視，已成為計算機、自...

VHDL 實現(xiàn) 2012-11-21

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