EEPW
技術(shù)應(yīng)用
復(fù)雜可編程邏輯器件 CPLD采用CMOS EPROM、EEPROM、快閃存儲器和SRAM等編程技術(shù),從而構(gòu)成了高密度、高速度和低功耗的可編程邏輯器件。 1組成 CPLD主要由邏輯塊、可編程互連通道和I/O塊三部分構(gòu)成。 2規(guī)模 CPLD中的邏輯塊類似于一個小規(guī)模PLD,通常一個邏輯塊包含4~20個宏單元,每個宏單元一般由 乘積項陣列、乘積項分配和可編程寄存器構(gòu)成。每個宏單元有多種配置方式,各宏單元也可級聯(lián)使用, 因此可實現(xiàn)較復(fù)雜組合邏輯和時序邏輯功能。查看更多>>
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