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ASIC設(shè)計

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高速可配置RSA密碼協(xié)處理器的ASIC設(shè)計

提出了一種基于嵌入式系統(tǒng)的高速、可配置RSA密碼協(xié)處理器的ASIC設(shè)計方案，可實現(xiàn)256 bit到2 048 bit的RSA加密運(yùn)算。為了提高運(yùn)算速度，采用改進(jìn)的高基模乘算法和流水線結(jié)構(gòu)；為了消除協(xié)處理器與內(nèi)存之間的通信...

加解密協(xié)處理器 ASIC設(shè)計 2017-06-05

如何在FPGA和ASIC設(shè)計中結(jié)合高速USB功能

通用串行總線已經(jīng)很普遍了，這是由于其使用簡單，隨插即用，并具有魯棒性的優(yōu)點(diǎn)。USB已經(jīng)找到了進(jìn)入曾經(jīng)使用串口......

FPGA ASIC設(shè)計 2013-08-06

燦芯半導(dǎo)體攜SoC解決方案參加ICCAD盛宴

“中國集成電路設(shè)計業(yè)2012年會暨重慶集成電路跨越發(fā)展高峰論壇”于2012年12月06日在重慶隆重召開，本次年會以“開拓創(chuàng)新，發(fā)揮優(yōu)勢，優(yōu)化產(chǎn)業(yè)結(jié)構(gòu)，打造電子信息產(chǎn)業(yè)高地”為主題。...

燦芯 SoC 2012-12-12

一個典型的嵌入式系統(tǒng)設(shè)計和實現(xiàn)

　　通常來說，一個嵌入式系統(tǒng)的開發(fā)過程如下：　　1.確定嵌入式系統(tǒng)的需求；　　2.設(shè)計系統(tǒng)的體系結(jié)構(gòu)：選擇處理 ......

嵌入式系統(tǒng) mvb系統(tǒng) 2012-11-01

Synopsys公司Design Compiler拓樸繪圖技術(shù)助ST加速ASIC設(shè)計

　　Synopsys宣布意法半導(dǎo)體在其90nm和65nm 的ASIC設(shè)計流程中，應(yīng)用Design Compiler拓樸繪圖技術(shù)，縮短了整個設(shè)計時間。意法半導(dǎo)體在其ASIC方法集中應(yīng)用Design&nb...

ASIC設(shè)計 Compiler拓樸繪圖技術(shù) 2007-03-06

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ASIC設(shè)計教程

工業(yè)概述

ASIC設(shè)計中基于Verilog語言的inout(雙向)端口程序設(shè)計

ASIC設(shè)計中基于Verilog語言的inout

ADI家庭總線數(shù)據(jù)線供電解決方案

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