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Vivado

　　Vivado 　　Vivado設計套件，是FPGA廠商賽靈思公司2012年發布的集成設計環境。包括高度集成的設計環境和新一代從系統到IC級的工具，這些均建立在共享的可擴展數據模型和通用調試環境基礎上。集成的設計環境——Vivado設計套件包括高度集成的設計環境和新一代從系統到IC級的工具，這些均建立在共享的可擴展數據模型和通用調試環境基礎上。這也是一個基于AMBAAXI4互聯規范、IP-XACTIP封裝元數據、工具命令語言（TCL）、Synopsys系統約束（SDC）以及其它有助于根據客戶需求量身定制設計流程并符合業界標準的開放式環境。

  • Vivado資訊

重磅升級，不止于快！米爾ZYNQ 7010/7020全面適配Vivado & PetaLinux 2024.2，精修實戰痛點，前瞻布局CRA法案！

米爾科技 ZYNQ 2025-10-23

做了個無線的FPGA調試器！支持Vivado！

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Board從入門到精通系列（七）

MP3 Board 2017-10-11

使用VIVADO對7系列FPGA的高效設計心得

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Board從入門到精通系列（六）

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創建ZYNQ處理器設計和Logic Analyzer的使用

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Xilinx 廣泛部署動態重配置技術

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FPGA 101：用Vivado HLS為軟件提速

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Xilinx 開源TCL庫正式發布

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揭開未擴展時鐘的秘密

嘗試通過算法重構和Vivado HLS生成高效的處理流水線

算法重構 Vivado 2016-10-16

用Vivado IPI和賽靈思IP實現更快速的設計輸入

Vivado 2016-10-16

Vivado設計套件提升設計生產力的九大優勢

Vivado IPI 為 Aurora 設計開放 FPGA 共享資源

Vivado Aurora 2016-01-27

Xilinx 宣布Vivado設計套件開始支持16nm UltraScale+產品早期試用

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Vivado HLS推動協議處理系統蓬勃發展(上)

Vivado FIFO 2015-04-28

Vivado HLS推動協議處理系統蓬勃發展(下)

Vivado FIFO 2015-04-29

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Xilinx: Stay Young, Stay energetic

Vivado HLS FPGA 2014-05-15

用OpenCV和Vivado HLS加速基于Zynq SoC的嵌入式視覺應用開發

賽靈思 Vivado 2014-03-06

使用賽靈思Vivado設計套件的九大理由

賽靈思 Vivado 2013-11-11

賽靈思推出Vivado設計套件WebPACK版本

賽靈思 WebPACK 2012-12-25

賽靈思發布Vivado設計套件2012.3將生產力提升數倍

賽靈思 FPGA 2012-10-25

賽靈思新一代Vivado設計套件首次面向公眾開放

賽靈思 DSP 2012-07-27

賽靈思重回DAC并提出關鍵問題

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Vivado震撼來襲 FPGA進入全面可編程時代

Vivado FPGA 2012-04-27

賽靈思客戶共賀Vivado設計套件推出

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針對未來十年 “All Programmable”器件的顛覆之作

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賽靈思Vivado設計套件震撼登場

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賽靈思公開發布Vivado設計套件常見問題解答

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